fpga的uart完整設(shè)計(文件)
【正文】 中Cpu發(fā)送為檢測：是指將ks寄存器置位，即數(shù)據(jù)發(fā)送完畢module rxd(dat_out,cs,read,reset, clk_enable3,clk,read_enable,clear3,counters)。output cs,clear3,clk_enable3。reg[7:0] data_out。 end else begin clear3=1。 parity_check_result=parity_check_result + read。 end else if (counters==839。b01001000) //4 begin data_out[4]=read。 parity_check_result=parity_check_result + read。 end else if (counters==839。b10001000) //8 begin data_out[0]=read。 parity_result=2 (parity_check_result == parity_result) ? 1:0。b10101010) //01給cpu發(fā)送接收信號 begin cs=(cs1 amp。 //clk_enable=0。 end else clear1=0。計數(shù)器 0 1~~~~8 9 10操作數(shù)據(jù)起始位檢測數(shù)據(jù)接收和奇偶校驗奇偶校驗數(shù)據(jù)判斷 其基 本 特 點是:UART 接收狀態(tài) 一 共 有 4個:state0(檢測起始位)，stat e1( 對數(shù)據(jù)位進行采樣，并串/并轉(zhuǎn)換),state2(奇偶校驗 分析)，state3(接收數(shù)據(jù)正確與否檢測)。② 數(shù)據(jù)接收 :該狀態(tài)下，每間隔16位倍頻采樣一位 串行數(shù)據(jù)，接收8位異步數(shù)據(jù)并進行串/并轉(zhuǎn)換。校驗結(jié)束以后，轉(zhuǎn)到state3狀態(tài)。output send,clk_enable4,clear4。reg send,parity_result,ks。 !reset)//當send_enable為高電平時為發(fā)送操作狀態(tài) begin clk_enable4=1。 !reset) begin if(counters==839。 end else if(counters==839。b00100000)//2 begin send=date_s[1]。 parity_result=parity_result + date_s[0]。 end else if(counters==839。b01100000)//6 begin send=date_s[5]。 parity_result=parity_result + date_s[0]。 end else if(counters==839。 end else if(counters==839。 parity_result) ? 1:0。 end else send=1。//程序計數(shù)寄存器input clk,state,t1,read,reset,clear。//read_enable為接收控制位?//////////send_enable為發(fā)送控制位，control為程序計數(shù)寄存器為零狀態(tài)寄存位reg[7:0] counters。 end else begin send_enable=0。amp。 else counters=counters + 1。波特率發(fā)生器實際上就是分頻器，設(shè)計比較簡單。//output[8:0] counter1。b10010111)//當counter等于156時 begin counter1=839。 t1=t1。 endendmodule如圖311；圖311UART波特發(fā)生器程序仿真圖由圖判讀：1. 當clk_enable為0時，時鐘不計時；2. 當clk_enable為1時，時鐘計時 譯文 51 。b00000000。//counter清零 t1=t1 + 1。reg[7:0] counter1。//時鐘計數(shù)器模塊input clk,clk_enable。b00000000。b10101111) counters=839。 read_enable=0。 end///////////////////////////////////////////////////////////////////////////////////////always(negedge read)//uart發(fā)送或接收狀態(tài)判斷 if(control) begin if(state) begin if(!read) begin read_enable=1。output read_enable,send_enable。當計數(shù)到指定數(shù)據(jù)時，觸發(fā)指定模塊的制定操作。b00000000) begin send=1。 ks=(send amp。 end else if(counters==839。b10000000)//8 begin send=date_s
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