eda技術(shù)課程設(shè)計報告-wenkub
2023-04-07 00:27:04 本頁面
【正文】 tebas模塊圖、樂譜輸出（ToneTaba模塊）該模塊主要是是樂曲簡譜碼對應(yīng)的分頻預(yù)置數(shù)查找表電路，其中設(shè)置了樂曲的全部音符對應(yīng)的分頻置數(shù)，每一音符的停留時間由音樂節(jié)拍和音調(diào)發(fā)生器模塊NoteTabs的CLK的輸入頻率決定，這些值由對應(yīng)于ToneTaba的4位輸入值Index[3..0]確定，最多有16種可選值。用戶可以將自己編制的樂曲存入硬件演奏電路，演奏時可以選擇鍵盤輸入樂曲或者自動演奏已存入的樂曲。EDA技術(shù)作為現(xiàn)代電子設(shè)計最新技術(shù)的結(jié)晶，其廣闊的應(yīng)用前景和深遠(yuǎn)的影響已毋庸置疑，它在信息工程類專業(yè)中的基礎(chǔ)地位和核心作用也逐漸被人們所認(rèn)識。其中各個模塊的功能如下：（1）按鍵輸入模塊主要由控制按鍵和音符輸入按鍵組成，黨控制按鍵按下時開始自動播放；（2）音符輸出模塊主要實現(xiàn)將存儲在rom表中的音符讀出并送入音調(diào)輸出模塊中。（3）音調(diào)輸出模塊主要是通過查表來實現(xiàn)找到各個音調(diào)對應(yīng)的分頻預(yù)置數(shù)；（4）選擇輸出模塊主要是通過按鍵控制來實現(xiàn)自動播放和手動彈奏輸出功能；（5）數(shù)控分頻模塊實現(xiàn)在給定分頻預(yù)置數(shù)的情況下分頻輸出驅(qū)動蜂鳴器輸出相應(yīng)的音調(diào)。許多高等學(xué)校開設(shè)了相應(yīng)的課程，并為學(xué)生提供了課程設(shè)計、綜合實踐、電子設(shè)計競賽、畢業(yè)設(shè)計、科學(xué)研究和產(chǎn)品開發(fā)等EDA技術(shù)的綜合應(yīng)用實踐環(huán)節(jié)。第二章 設(shè)計要求、FPGA配合按鍵、蜂鳴器演奏一段簡單音樂；、當(dāng)前演奏音調(diào)對應(yīng)的阿拉伯?dāng)?shù)字用一位數(shù)碼管顯示；、用LED燈亮的個數(shù)指示當(dāng)前演奏音調(diào)。輸向ToneTaba中Index[3..0]的值ToneIndex[3..0]的輸出值與持續(xù)的時間由模塊NoteTabs決定。 選擇輸出模塊、數(shù)控分頻模塊數(shù)控分頻器的功能是當(dāng)在輸入端給定不同的輸入數(shù)時,將對輸入的時鐘信號有不同的分頻比，數(shù)控分頻器是用計數(shù)值可并行預(yù)置的加法計數(shù)器來完成的。SpkS 的輸出頻率將決定每一音符的音調(diào)，這樣分頻計數(shù)器的預(yù)置值Tone[10..0]與SpkS的輸出頻率就有了對應(yīng)關(guān)系。USE 。 END。 END COMPONENT。 then IF Counter=11101000 THEN Counter =00000000。)THEN Counter =Counter+1。 U1: data1 PORT MAP (address=counter, q=ToneIndex,clock=clk1)。USE 。 LED:OUT STD_LOGIC_VECTOR(7 DOWNTO 0)。CODE=0000。led=00000011。912WHEN0011=Tone=10000001100。CODE=0101。led=00111111。1372WHEN1000=Tone=10110000010。CODE=0010。led=00000111。1622WHEN1101=Tone=11010000100。CODE=0001。led=00000001。 按鍵輸入模塊 VHD源程序LIBRARY IEEE。 SOUND:OUT STD_LOGIC。ARCHITECTURE ONE OF AJ ISSIGNAL G:STD_LOGIC_VECTOR(7 DOWNTO 0)。 THEN IF S8=39。 IF ( S1=39。AND S3=39。AND S5=39。AND S7=39。 ELSIF ( S2=39。AND S3=39。AND S5=39。AND S7=39。 ELSIF ( S3=39。AND S2=39。AND S5=39。AND S7=39。 ELSIF ( S4=39。AND S2=39。AND S5=39。AND S7=39。 ELSIF ( S5=39。AND S2=39。AND S4=39。AND S7=39。 ELSIF ( S6=39。AND S2=39。AND S4=39。AND S7=39。 ELSIF ( S7=39。AND S2=39。AND S4=39。AND S6=39。 END IF。PL=01100000101。PL=10000001100。PL=10010101101。PL=10101011100。PL=00000000000。LIBRARY IEEE。 lo,lt :in STD_LOGIC_VECTOR(7 DOWNTO 0)。 s9 :IN STD_LOGIC)。
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