數(shù)字時(shí)鐘設(shè)計(jì)報(bào)告-wenkub
2022-10-18 05:55:36 本頁面
【正文】 CLK和 CLK1，CLK=1Hz，對秒進(jìn)行計(jì)數(shù)，當(dāng)秒計(jì)數(shù)為 60 時(shí)，產(chǎn)生脈沖控制分，當(dāng)分計(jì)數(shù)為 60 時(shí)對，產(chǎn)生脈沖控制時(shí)，當(dāng)時(shí)計(jì)數(shù)為 23，分為 59，秒為59 時(shí)，下一脈沖來臨時(shí)則重新計(jì)時(shí)恢復(fù)為 00 時(shí) 00 分 00 秒，并且報(bào)時(shí)，時(shí)間為兩秒，報(bào)時(shí)頻率由 CLK1 控制。 按鍵部分：復(fù)位鍵：高低平有效；設(shè)定時(shí)間鍵：高電平有效；時(shí)間控制鍵：高電平控制對分的設(shè)定，低電平控制對時(shí)的設(shè)定；鍵（ IO49，IO42， IO48， IO43）四個(gè)控制時(shí)分的高四位，鍵（ IO47， IO44， IO46，IO45）四個(gè)控制時(shí)分的低四位。 USE 。 SEC:BUFFER STD_LOGIC_VECTOR(7 DOWNTO 0)。139。139。 清零，驅(qū)動分模塊 ELSIF 進(jìn)位語句 SEC(3 DOWNTO 0)=1001 THEN SEC(7 DOWNTO 4)=sec(7 DOWNTO 4)+1。039。 END。 USE 。 ENMIN:OUT STD_LOGIC)。THEN MIN=00000000。139。139。清零，驅(qū)動時(shí)模塊 ELSIF MIN(3 DOWNTO 0)=1001 THEN 進(jìn)位語句 MIN(7 DOWNTO 4)=MIN(7 DOWNTO 4)+1。039。 END。 USE 。 END。 ELSIF SET=39。THEN HOUR=SET1。THEN IF HOUR=00100011THEN HOUR=00000000。 END IF。 6 圖 7 報(bào)時(shí)模塊 圖 8 LIBRARY IEEE。 ENTITY ALARM1 IS 報(bào)時(shí)實(shí)體 PORT(RESET,CLK1:IN STD_LOGIC。 ARCHITECTURE A OF ALARM1 IS 報(bào)時(shí)結(jié)構(gòu)體 BEGIN PROCESS(CLK1,SEC,MIN,RESET) BEGIN IF MIN=00000000 AND RESET=39。039。 7 圖 9 五、 全系統(tǒng)聯(lián)調(diào)，整機(jī)電路，波形圖 圖 10 8 圖 11 圖 12 六、 硬件測試及說明 本項(xiàng)目實(shí)驗(yàn)包括四個(gè)模塊，分別為秒計(jì)時(shí)模塊（ SECOND），分計(jì)時(shí)模塊（ MINTUE），時(shí)計(jì)時(shí)模塊（ HOUR）以及整點(diǎn)報(bào)時(shí)模塊（ ALARM1）。當(dāng)時(shí)間為整點(diǎn)時(shí)，蜂鳴器報(bào)時(shí)，時(shí)間持續(xù) 2 秒。 EDA 軟件，可方便地在計(jì)算機(jī)上進(jìn)行電路設(shè)計(jì)、仿真，其電路結(jié)構(gòu)及設(shè)計(jì)觀念可以很容易地被修正；也 可方便地更換所需要的元件。我必需 感謝同學(xué)和老師們無私的幫助， 因?yàn)?是你們讓我感受到團(tuán)結(jié)的力量，更讓我學(xué)會了更多的知識，在這里真誠的感謝你們！ 回顧總結(jié)，通過此次 課程 設(shè)計(jì)論文，讓我學(xué)到了許多，不止是一些新的理論知識和具體的動手實(shí)踐。理論與實(shí)踐都匱乏，不僅是專業(yè)知識，其它方面的知識了解的也少。知道老師認(rèn)真負(fù)責(zé)的工作態(tài)度，嚴(yán)謹(jǐn)?shù)闹螌W(xué)精神和深厚的理論水平都使我獲益非淺。 USE 。 ALARM:OUT STD_LOGIC。 SEC:BUFFER STD_LOGIC_VECTOR(7 DOWNTO 0)。 SET1: IN STD_LOGIC_VECTOR(7 DOWNTO 0)。 COMPONENT HOUR1 時(shí)元件的例化 PORT(CLKH,RESET,SET,MINH: IN STD_LOGIC。 COMPONENT ALARM1 報(bào)時(shí)元件的例化 PORT(RESET,CLK1: IN STD_LOGIC。 SIGNAL ENM,ENH:STD_LOGIC。 u3:HOUR1 12 PORT MAP(RESET=RESET,SET=SETT,SET1=SET11,MINH=MINHH,HOUR=HOUR, CLKH=ENH)。 USE 。 SEC:BUFFER STD_LOGIC_VECTOR(7 DOWNTO 0)。139。139。 清零，驅(qū)動分模塊 ELSIF 進(jìn)位語句 SEC(3 DOWNTO 0)=1001 THEN SEC(7 DOWNTO 4)=sec(7 DOWNTO 4)+1。039。 END。 USE 。 ENMIN:OUT STD_LOGIC)。THEN MIN=00000000。139。139。清零，驅(qū)動時(shí)模塊 ELSIF MIN(3 DOWNTO 0)=1001 THEN 進(jìn)位語句
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