cpld第2章(已修改)
2025-01-08 05:58 本頁面
【正文】 1數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用 可編程邏輯器件的設(shè)計流程可編程邏輯器件的設(shè)計流程 在系統(tǒng)可編程技術(shù)在系統(tǒng)可編程技術(shù) 第 2章 可編程邏輯器件的設(shè)計 邊界掃描技術(shù)邊界掃描技術(shù) 2數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用可編程邏輯器件的設(shè)計 是指利用開發(fā)軟件和編程工具對器件進(jìn)行開發(fā)的過程。 設(shè)計過程包括以下四個步驟： 1 . 設(shè)計準(zhǔn)備 2 . 設(shè)計輸入 3 . 設(shè)計處理 4 . 器件編程其中還包括三個設(shè)計驗證過程： 1 . 功能仿真（前仿真） 2 . 時序仿真（后仿真） 3 . 器件測試 167。 可編程邏輯器件的設(shè)計流程可編程邏輯器件的設(shè)計流程3數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用圖 HDPLD的設(shè)計流程 設(shè)計輸入 ? 原理圖輸入 ? 硬件描述語言輸入 ? 波形圖輸入 設(shè)計處理 ? 優(yōu)化、綜合 ? 適配、分割 ? 布線、布局器件測試時序仿真功能仿真器件編程設(shè)計準(zhǔn)備4數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用基于 PLD設(shè)計流程 基于可編程邏輯器件設(shè)計分為三個步驟：設(shè)計輸入、設(shè)計實現(xiàn)、編程。其設(shè)計流程如下圖。器 件 編 程功能仿真設(shè)計輸入 原理圖 硬件描述語言設(shè)計實現(xiàn) 優(yōu)化 合并、映射 布局、布線器件測試時序仿真設(shè)計實現(xiàn)： 生成下載所需的各種文件。器件編程： 即 “下載 ”和 “配置 ”，即將編程數(shù)據(jù)放到具體的可編程器件中。5數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用 設(shè)計準(zhǔn)備 設(shè)計準(zhǔn)備過程 主要是指在對可編程邏輯器件設(shè)計之前，首先要進(jìn)行方案論證、系統(tǒng)設(shè)計和器件選擇等工作。 對于設(shè)計人員首先要根據(jù)任務(wù)要求，如系統(tǒng)所完成的功能及復(fù)雜程度，對系統(tǒng)的工作速度、器件資源、成本和布線可行性等方面進(jìn)行權(quán)衡，最終選擇一個比較合理設(shè)計方案和合適的器件類型。6數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用 設(shè)計輸入（ Design Entry） 所謂 設(shè)計輸入 是指設(shè)計者將所設(shè)計的系統(tǒng)或電路以開發(fā)軟件要求的某種形式表示出來并送入計算機(jī)的過程。 設(shè)計輸入通常有以下幾種形式： 使用軟件系統(tǒng)提供的元件庫及各種符號和連線畫出原理圖，形成原理圖輸入文件。 使用場合：通常用在設(shè)計者對系統(tǒng)及各部分很熟悉的情況。7數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用 優(yōu)點： 容易實現(xiàn)仿真，便于信號的觀察和電路的調(diào)整。 缺點： 當(dāng)系統(tǒng)功能較復(fù)雜時，原理圖輸入方式效率低。 2．硬件描述語言輸入方式 硬件描述語言是用文本方式描述設(shè)計，它分為普通硬件描述語言和行為描述語言。 普通硬件描述語言 有 ABELHDD、 CUPL等，它們支持邏輯方程、真值表、狀態(tài)機(jī)等邏輯表達(dá)方式。 行為描述語言 是目前常用的高層硬件描述語言，有VHDL和 Verilog—HDL 等，它們都已成為 IEEE標(biāo)準(zhǔn)。 8數(shù)字系統(tǒng)設(shè)計與數(shù)字系統(tǒng)設(shè)計與 CPLD應(yīng)用應(yīng)用 行為描述語言有許多突出的 優(yōu)點 ： ① 語言與工藝的無關(guān)性，可以使設(shè)計者在系
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