基于veriloghdl密碼鎖設(shè)計-閱讀頁
2024-11-30 15:49本頁面
【正文】 101101。b1111101。b0000111。b1111111。b1101111。b10) begin ss1=1。 case(C) 0:Q=39。 1:Q=39。 2:Q=39。 3:Q=39。 4:Q=39。 5:Q=39。 6:Q=39。 7:Q=39。 8:Q=39。 9:Q=39。 endcase end end Endmodule 控制模塊用于密碼的設(shè)置 控制模塊 功能 實現(xiàn) ： 模塊可以通過程序的執(zhí)行實現(xiàn)對密碼進(jìn)行設(shè)置和進(jìn)行開瑣，開始時鎖處于關(guān)閉的狀態(tài)，即為 1，輸入事先設(shè)置的萬能密碼開瑣，在鎖開的狀態(tài)時設(shè)置密碼，然后將鎖關(guān)閉，再輸入三位數(shù)字進(jìn)行開鎖，正確時為 1既燈亮，否則為 0 為 1，即蜂鳴器響。 output[3:0]num1,num2,num3。 reg lock,warning。 reg[11:0]code。b0000000000) begin case({n9,n8,n7,n6,n5,n4,n3,n2,n1,n0}) 1039。d0。b0000000010:temp=139。 1039。d2。b0000001000:temp=139。 1039。d4。b0000100000:temp=139。 1039。d6。b0010000000:temp=139。 1039。d8。b1000000000:temp=139。 endcase num3=num2。 num1=temp。 num2=0。 end end always(posedge clk) begin if(lock==0amp。set) begin if(code=={num3,num2,num1}) lock=1。b000000000111) lock=1。 end if(lock==1amp。close) lock=0。 end always(posedge clk) begin if(lock==1amp。set) code={num3,num2,num1}。說明開鎖成 功 。實現(xiàn)設(shè)置密碼的功能。因為輸入的密碼正確所以使 lock置 1，表示開鎖成功。 圖 開鎖失敗的波形 總結(jié) 通過本 設(shè)計可以學(xué)的到很多的東西，同時不僅可以鞏固所學(xué)過的知識，而且學(xué)到了很多在書本上所沒有學(xué)到過的知識。每一個子模塊編寫調(diào)試， 都需要非常用心 。 通過這次設(shè)計使我懂得了理論與實際相結(jié)合 的重要性 ，只有理論知識是遠(yuǎn)遠(yuǎn)不夠的，只有把所學(xué)的理論知識與實踐相結(jié)合起來，從理 論中得出結(jié)論， 用于實踐 ，提高自己的實際動手能力和獨立思考的能力。 需要耐心，信心去完
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