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計(jì)算機(jī)組成原理考研補(bǔ)習(xí)(ppt50)-考試學(xué)習(xí)-在線瀏覽

2024-10-16 20:59本頁面
  

【正文】 /片)組成 4KB存儲器。 ( 1)芯片數(shù): 8片 ( 2)存儲空間安排: 任意連續(xù)區(qū)間 ( 3)芯片地址分配與片選邏輯: 4KB: 12位地址 A11~ A0 哪幾位分配給芯片?哪幾位形成片選 邏輯? 來自 庫下載 芯片 芯片地址 片選邏輯 1KB 1KB 1KB 1KB ( 4)邏輯圖 A9 ~ A0 A9 ~ A0 A9 ~ A0 A9 ~ A0 CS0=A11A10 CS1=A11A10 CS2=A11A10 CS3=A11A10 例 用 4KB ROM芯片、 2K 4位和 1K 4位 RAM芯片組成 7KB存儲器。 ( 1)芯片數(shù): 5片 連續(xù)區(qū)間,先安排大容量芯片,后安排小容量芯片 ( 2)存儲空間安排: 來自 庫下載 芯片 芯片地址 片選邏輯 4KB 2KB 1KB ( 4)邏輯圖 A11 ~ A0 A10 ~ A0 A9 ~ A0 CS0=A12 CS1=A12A11 CS2=A12A11A10 ( 3)芯片地址分配與片選邏輯: 7KB: 13位地址 A12 ~ A0 例 存儲器空間分配: ROM區(qū): 2020H ~ 27FFH (按字節(jié)編址) RAM區(qū): 2800H ~ 33FFH 選用芯片: EPROM 2KB/片 RAM 2KB/片、 1KB/片 來自 庫下載 芯片 芯片地址 片選邏輯 2KB 2KB 1KB A10 ~ A0 A10 ~ A0 A9 ~ A0 CS0=A12A11 CS1=A12A11 CS2=A12A11A10 ( 3)芯片地址分配與片選邏輯: 5KB: 13位地址 A12 ~ A0 ROM區(qū): 2KB RAM區(qū): 3KB ( 1)計(jì)算容量: ( 2)芯片數(shù): EPROM 1片、 RAM 2片 A15 ~ A13 為 001 即 A15A14A13 來自 庫下載 芯片 芯片地址 片選邏輯 ( 2)芯片地址分配與片選邏輯: 64KB: 16位地址 A15 ~ A0 例 主存 64KB,其中高地址區(qū) 2KB用于 I/O空間。 ( 1)芯片數(shù): 8片 8KB 8KB 8KB 8KB 8KB A12 ~ A0 A12 ~ A0 A12 ~ A0 A12 ~ A0 A12 ~ A0 CS0=A15A14A13 CS1=A15A14A13 CS2=A15A14A13 CS6=A15A14A13 CS7=A15A14A13 A12A11 來自 庫下載 基本概念 存儲原理 SRAM:利用雙穩(wěn)態(tài)觸發(fā)器內(nèi)部交叉反饋存儲信息。 動態(tài)刷新 ( 1)定義:按所存信息定期向電容補(bǔ)充電荷。 ( 3)刷新周期安排方式 集中刷新、分散刷新、異步刷新 來自 庫下載 ( 1)隨機(jī)存取方式 存取方式 1)可按地址直接訪問任一單元; 2)訪問時間與單元地址無關(guān)。 ( 2)順序存取方式 ( 3)直接存取方式 訪問時先直接指向一個小區(qū)域,再按順序查找,訪問時間與數(shù)據(jù)所在位置有關(guān)。 1) CPU內(nèi)總線 : CPU芯片內(nèi)寄存器和算邏部件之間互連的總線。 3) 系統(tǒng)總線 :計(jì)算機(jī)系統(tǒng)內(nèi)各功能部件之間或各插件板之間互連的總線。 ( 2)按時序控制方式 分類 1) 同步總線 :由控制模塊提供統(tǒng)一的同步時序信號控制總線傳送操作。
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