[理學(xué)]微機(jī)原理第二章-文庫吧資料
2025-01-25 09:07本頁面
【正文】 s2(B) 多路轉(zhuǎn)換 A B C D 共享總線 s3(C) s4(D) CDM ? 總線時序 同步總線時序 總線上所有信號之間的時間關(guān)系以同一個時鐘為參考 T CLK AB RD/WR* DB CLK上升沿發(fā)出地址，下降沿讀 /寫 協(xié)調(diào)總線設(shè)備的步驟和配合，實(shí)現(xiàn)可靠的尋址和數(shù)據(jù)傳輸 電路簡單 ,傳輸率高 異步總線時序 DB AB ① ② ③ ④ RD/WR* Master Slave 讀 寫 ① ② ③ ④ 無絕對時間關(guān)系，采用握手方式保證數(shù)據(jù)傳輸同步 ② S：知道，開始發(fā)送（ S線變高） （ DB有數(shù)據(jù)， RD/WR=1 讀 ） ④ S：那就結(jié)束了。 I/O控制方式 2 中斷控制 何謂中斷？ 中斷請求 中斷服務(wù)程序 CPU現(xiàn)行處理流程 中斷返回 特點(diǎn) 外部事件 (中斷源 )主動 ,CPU被動。 查詢控制方式 ——交換前先查詢對方狀態(tài)，決定下一步操作。 EPROM 位線 位線輸出 字線 VCC 浮柵管 S D p p n siO2 浮柵 n+ n+ p 控制柵極 浮空柵極 S D 源線 位線 隧道氧化物 FLASH 存儲單元 注入電荷（寫 0） VGSVDS0，S= 0， D低電位 擦除電荷（寫 1） VGS反向 讀出 S=0，字線 5V邏輯高 G ? 存取方式 ?隨機(jī)存取 ?順序存取（ FIFO） ?堆棧存?。?LIFO） SP SS=1050H 堆棧深度 入棧 出棧 B2H 10H 0x10500 0x10501 0x10502 0x10503 0x10504 0x10505 0x10506 0x10507 79H 1AH ? 輸入 /輸出 計(jì)算機(jī)與外設(shè)的數(shù)據(jù)交換通過總線（信息通道）和接口（實(shí)現(xiàn)交換的硬件電路），并確保雙方同步的條件下進(jìn)行。由于刷新時列選擇信號總為 0，因此，電容上的信息不可能被送到數(shù)據(jù)總線上。 刷新是逐行進(jìn)行的，當(dāng)某一行選擇信號為 1時，選中了該行，該行上所連接的各存儲單元中的電容信息都被送到各自對應(yīng)的刷新放大器上，刷新放大器將信息放大后又立即重寫到電容 C。 然后 ， 再重寫到存儲電容上 。 （ 5） 為輸出使能信號 ， 通常用于讀操作控制 ， 低電平時數(shù)據(jù)被從 SRAM中讀出 。 （ 3） 為片選信號 ， 低電平表示該芯片被選中 。 628128 128K 8 A0~A16 D0~D7 CSWEOECS WE OE 數(shù)據(jù)線 功 能 H 輸出高阻 未選中 L L H Din 寫入操作 L H L Dout 讀出操作 L H H 輸出高阻 無操作 （ 1） A0～ A16： 17位地址線 ， 用于選擇片內(nèi)的某個存儲單元 。 SRAM的速度快，接口簡單，讀寫操作簡便 。每個觸發(fā)器存放一位信息。 尋址空間 =2n。 MPU M I/O 總線 單總線 MPU I/O M 存儲器總線 I/O總線 雙總線 MPU 局部 I/O 局部 M 緩沖器 總線控 制邏輯 全局 全局 M I/O DMA控制器 雙重總線 局部總線 全局總線 ? CPU 控制器 :指令 譯碼 (根據(jù)指令要求產(chǎn)生對應(yīng)控制電平 )和確定 操作時序(這些控制電平在什么時刻產(chǎn)生 ?維持多長時間 ) 指令 控制電平 時序發(fā)生器 譯碼邏輯 … 控制信號 時鐘 時鐘周期 ——計(jì)算機(jī)系統(tǒng)中最小計(jì)時單位，由系統(tǒng)時鐘確定 指令周期 ——執(zhí)行一條指令的時間，包括取指令 +譯碼 +執(zhí)行 工作周期 ——指令執(zhí)行分成幾個階段，每個階段的時間 指令地址計(jì)算 取指令 指令譯碼 計(jì)算操作數(shù)地址 取操作數(shù) 運(yùn)算 計(jì)算操作 數(shù)地址 存操作數(shù) 暫存器 ALU 狀態(tài)標(biāo)志寄存器 寄存器組 ALU bus 寄存器組、暫存器為 ALU提供操作數(shù)和結(jié)果存放 ALU ( Arithmetic Logic Unit 算數(shù)邏輯單元 ) 完成基本算數(shù)、邏輯運(yùn)算 狀態(tài)標(biāo)志寄存器 根據(jù)運(yùn)算結(jié)果設(shè)置狀態(tài)標(biāo)志 運(yùn)算器 整個 CPU內(nèi)部各單元用片內(nèi)總線互連 ? 存儲
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