mqam調(diào)制與解調(diào)的設(shè)計(jì)(參考版)
2025-07-31 09:53本頁(yè)面
【正文】 八、參考文獻(xiàn) 1. 《無(wú)線通信FPGA設(shè)計(jì)》 田耘 電子工業(yè)出版社 2. 《通信原理教程》 樊昌信 電子工業(yè)出版社 3. 《現(xiàn)代通信原理》22。課程設(shè)計(jì)是培養(yǎng)學(xué)生綜合運(yùn)用所學(xué)知識(shí),發(fā)現(xiàn),提出,分析和解決實(shí)際問題, 鍛煉實(shí)踐能力的重要環(huán)節(jié),是對(duì)學(xué)生實(shí)際工作能力的具體訓(xùn)練和考察過程. 回 顧起此次通信原理課程設(shè)計(jì),至今我仍感慨頗多,的確,從選題到定稿,從理 論到實(shí)踐,在整整一星期的日子里,可以說得是苦多于甜,但是可以學(xué)到很多 很多的的東西,同時(shí)不僅可以鞏固了以前所學(xué)過的知識(shí),而且學(xué)到了很多在書 很重要的,只有理論知識(shí)是遠(yuǎn)遠(yuǎn)不夠的,只有把所學(xué)的理論知識(shí)與實(shí)踐相結(jié)合 起來,從理論中得出結(jié)論,才能真正為社會(huì)服務(wù),從而提高自己的實(shí)際動(dòng)手能 ,可以說得是困難重重,這畢 竟第一次做的,難免會(huì)遇到過各種各樣的問題,同時(shí)在設(shè)計(jì)的過程中發(fā)現(xiàn)了自 己的不足之處,對(duì)以前所學(xué)過的知識(shí)理解得不夠深刻,掌握得不夠牢固。首先，通過學(xué)習(xí)使自己這學(xué)期對(duì)課本上的專業(yè)知識(shí)可以應(yīng)用于實(shí)際，使得理論與實(shí)際相結(jié)合，加深自己對(duì)課本知識(shí)的更好理解，同時(shí)短學(xué)期也鍛煉了自己個(gè)人的動(dòng)手能力；能夠充分利用圖書館、網(wǎng)絡(luò)資源去查閱相關(guān)資料，增加了許多課本以外的知識(shí)，慢慢地能達(dá)到學(xué)以致用。在設(shè)計(jì)的過程中經(jīng)歷和克服了許多的困難，暴露我們知識(shí)和經(jīng)驗(yàn)的不足的同時(shí)，也積累了實(shí)踐經(jīng)驗(yàn)，檢閱了大學(xué)的知識(shí)，使所學(xué)的知識(shí)得到復(fù)習(xí)和鞏固。經(jīng)過三個(gè)星期的課程設(shè)計(jì)，我們得到了充分的鍛煉，不僅對(duì)單片機(jī)的學(xué)習(xí)有了深刻的理解，同時(shí)也增強(qiáng)了我們的毅力和處理突發(fā)問題的能力。endmodule七、心得體會(huì)本次課程設(shè)計(jì)雖然時(shí)間很短，但收獲卻很大。 end endcase endend//計(jì)算調(diào)制輸出assign y = reset ? {csignal[16], csignal} + {ssignal[16], ssignal}:0。 end default: begin csignal = 0。 ssignal[16:1] = !sine[15:0]。b1111: begin // 2cps2sin csignal[16:0] = cosine[15:0]。 ssignal[0] = 0。 csignal[15:0] = cosine[15:0]。 end 439。 ssignal[16:1] = !sine[15:0]。b1101: begin // 2cossin csignal[16:0] = cosine[15:0]。 ssignal[15:0] = !sine[15:0]。 csignal[15:0] = cosine[15:0]。 end 439。 ssignal[16:1] = !sine[15:0]。b1011: begin //2cos2sin csignal[16:0] = !cosine[15:0]。 ssignal[0] = 0。 csignal[15:0] = !cosine[15:0]。 end 439。 ssignal[16] = !sine[15]。b1001: begin // 2cossin csignal[16:0] = !cosine[15:0]。 ssignal[15:0] = !sine[15:0]。 csignal[15:0] = !cosine[15:0]。 end 439。 ssignal[16:1] = sine[15:0]。b0111: begin // 2cos+2sin csignal[16:0] = !cosine[15:0]。 ssignal[0] = 0。 csignal[15:0] = !cosine[15:0]。 end 439。 ssignal[16] = sine[15]。b0101: begin // 2cos+sin csignal[16:0] = !cosine[15:0]。 ssignal[15:0] = sine[15:0]。 csignal[15:0] = !cosine[15:0]。b0100: begin // cos+sin // 這里采用了近似操作，即各位取反，得到相應(yīng)的負(fù)值， // 會(huì)有1的誤差，但相對(duì)于17比特?cái)?shù)，可以忽略不計(jì)。 ssignal[0] = 0。 csignal[0] = 0。 end 439。 ssignal[16:1] = sine[15:0]。b0010: begin // cos+2sin csignal[16] = cosine[15]。 ssignal[15:0] = sine[15:0]。 csignal[0] = 0。 end 439。 ssignal[16] = sine[15]。b0000: begin // cos+sin csignal[16] = cosine[15]。 csignal = 0。assign data = 2684355。 else x_t = x_t。 x_t_1[3:0] = {x_t_1[2:0], x}。 t = 0。 //完成輸入比特的寄存用于控制DDS的輸出always (posedge clk) begin if(!reset) begin x_t = 0。wire [15 : 0] cosine。wire [24 : 0] data。reg [16 : 0] csignal。reg [1:0] t。input x。input clk12p5MHz。六、程序代碼16QAM調(diào)制源代碼`timescale 1ns / 1ps/////////////////////////////////////////////////////////////////////////// Company: // Engineer: // // Create Date: 22:55:47 09/16/2007 // Design Name: // Module Name: qam16 // Project Name: // Target Devices: // Tool versions: // Description: //// Dependen
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