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2024-09-25 19:39 本頁面
【正文】 END architec。 C(3) = 39。 C : OUT STD_LOGIC_VECTOR(7 DOWNTO 0) )。 USE 。 全加器”和”的布林函數(shù) CY = (A and B) or ( B and C ) or ( A and C )。 訊號表示式是以 =來設(shè)定運算。 = 3。 ……………. 使用者自訂資料型態(tài) 使用記錄資料型態(tài) SIGNAL T1,T2,T3 : clock_rec。 使用者自訂資料型態(tài) 記錄資料型態(tài) 多種資料型態(tài)組成一個記錄 (Record)群集 例 : 記錄資料型態(tài)宣告如下 : TYPE clock_rec IS RECORD Seconds : integer 0 to 59。 使用者自訂資料型態(tài) 陣列資料型態(tài) 例 : TYPE nibble IS ARRAY(3 DOWNTO 0)。 …… signal lighting : traffic_light。39。l39。 高阻抗狀態(tài) HiZ 配合資料型態(tài)的數(shù)值設(shè)定 39。 邏輯狀態(tài) :?0? 39。X39。 CONV_STD_LOGIC_VECTOR(參數(shù) ) 將括號內(nèi)的參數(shù)轉(zhuǎn)換成 STD_LOGIC_VECTOR 。 數(shù)值設(shè)定範例如 : Td := 100nS。 VHDL標準的資料型態(tài) 字元 Character 字元型態(tài)資料長度為 8位元 , 宣告範例如下 : variable char_val: character。 位元 Bit 值域在 {1,0}宣告範例如下 : signal en_bit: bit。 這個資料型態(tài)因與整數(shù)型態(tài)相同所以在設(shè)計時大多數(shù)會使用整數(shù)方式宣告。 例 : a := 15。 VHDL標準的資料型態(tài) 布林代數(shù)(Boolean)位元向量(Bit_Vector)位元(Bit)標準邏輯向量(Std_Logi c_Vector)標準邏輯(Std_Logi c)邏輯訊號正整數(shù)(P o sitiv e )自然數(shù)(N atural)整數(shù)(In teg er, U n sig n ed )實數(shù)(Real)數(shù)值訊號 字元(Character)字串(String)時間(Time)基本資料型態(tài)VHDL標準的資料型態(tài) 整數(shù) (integer) 整數(shù) (integer)型態(tài)是資料長度最長是 32bits ,整數(shù)
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