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數(shù)字電子技術第4章習題解答-資料下載頁

2025-10-18 08:42本頁面

【導讀】4-1寫出圖T4-1電路的輸出函數(shù)式,證明a、b有相同的邏輯功能。由JT4-2式可知,電路實現(xiàn)的是二變量同或功能。4-3圖T4-3是一個選通電路。M為控制信號,通過M電平的高低來選擇讓A還是讓。B從輸出端送出。由JT4-3式可知,電路能夠?qū)崿F(xiàn)選通要求,當M=1時,Y=A;當M=0時,Y=B。設四個人的意見為變量A、B、C、D,表決結(jié)果為函數(shù)Y。為“1”,不同意為“0”;提案通過為“1”,沒通過為“0”,所列真值表如表JT4-4所示。在評判時,按少數(shù)服從多數(shù)的原則通過,但主評判員認為合格也可。4-7試用基本門設計一個組合邏輯電路,該電路輸入端接收兩個兩位二進制數(shù)M、N,解4-7令兩個兩位二進制數(shù)分別為M=AB,N=CD。式JT4-8不可再化簡。此函數(shù)的與非—與非式為。用與非門按式JT4-8畫電路圖,如圖JT4-8所示。

  

【正文】 1 00 0 1 1 10 1 0 0 00 1 0 0 10 1 0 1 00 1 0 1 10 1 1 0 00 1 1 0 10 1 1 1 00 1 1 1 11 0 0 0 01 0 0 0 11 0 0 1 01 0 0 1 1二 進 制 數(shù) 加 6 修 正 的 結(jié) 果0 0 0 0 00 0 0 0 10 0 0 1 00 0 0 1 10 0 1 0 00 0 1 0 10 0 1 1 00 0 1 1 10 1 0 0 00 1 0 0 11 0 0 0 01 0 0 0 11 0 0 1 01 0 0 1 11 0 1 0 01 0 1 0 11 0 1 1 01 0 1 1 11 1 0 0 01 1 0 0 1CO 1 S3 S2 S1 S0CO 1 S3 S2 S1 S0CO 2 S3 S2 S1 S0 17 將 0~ 19 的二進制數(shù)和 與用 8421BCD 碼表示的 和 進行比較發(fā)現(xiàn),當 和 數(shù)< 1001(9)時,二進制碼與 8421BCD 碼相同;當數(shù)> 1001 時,只要在二進制 和 上加 0110(6)就可以把二進制和 轉(zhuǎn)換為 8421BCD 碼 的和 ,同時產(chǎn)生進位輸出。這一轉(zhuǎn)換可以由一個修正電路來完成。 ( 2) 修正電路的 設計 設計 修正電路,先列設計一覽表 ,見表 JT425(b). 表 J T 4 2 5 ( b ) 修 正 值 0 0 0 00 0 0 0 00 0 0 0 10 0 0 1 00 0 0 1 10 0 1 0 00 0 1 0 10 0 1 1 00 0 1 1 10 1 0 0 00 1 0 0 11 0 0 0 01 0 0 0 11 0 0 1 01 0 0 1 11 0 1 0 01 0 1 0 11 0 1 1 01 0 1 1 11 1 0 0 01 1 0 0 1第 2 片 7 4 L S 8 3 的 輸 入 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 00 0 0 0 00 0 0 0 10 0 0 1 00 0 0 1 10 0 1 0 00 0 1 0 10 0 1 1 00 0 1 1 10 1 0 0 00 1 0 0 10 1 0 1 00 1 0 1 10 1 1 0 00 1 1 0 10 1 1 1 00 1 1 1 11 0 0 0 01 0 0 0 11 0 0 1 01 0 0 1 1第 2 片 7 4 L S 8 3 的 輸 出兩 個 8 4 2 1 B C D 碼 相 加 的 和 A3 A2 A1 A0CO 1 S3 S2 S1 S0 B3 B2 B1 B0CO 2 S3 S2 S1 S0 由表 JT425(b)可寫出修正函數(shù) B3( CO 1A3A2A1A0) = B0 = 0 約 束 項 : ∑ d = ( 2 0 ~ 3 1 )( J T 4 2 5 a )B2( CO 1A3A2A1A0) = B1 = ∑ m ( 1 0 ~ 1 9 ) 用卡諾圖化簡 修正函數(shù) ,化簡過程如圖 JTP424(c)所示,結(jié)果得 B2=B1=CO1+A3A1+A3A2 ( JT425b) 從表 JT225(b)還可看出, 兩個 8421BCD 碼相加時的進位 CO 等于 A2 或 A1。 根據(jù)式JT424b 和上述分析 畫電路圖,如圖 JT425(d)所示。 18 0 0 0 0 0 1 0 1 1 0 1 0 1 1 0 1 1 1 1 0 1 1 0 00 00 11 11 00 0 0 0 圖 J T 4 2 5 ( c ) 0 0 0 0 CO 1A3A2A1A0 0 0 1 11 1 1 11 1 1 1 C OC I8 4 2 1 B C D 碼相 加 的 和C OC I7 4 L S 2 8 38 4 2 1 B C D 碼被加數(shù)加數(shù)CO 1CO 2A3A2A1A0B3B2B1B0S3S2S1S0( 1 )A3A2A1A0B3B2B1B0S3S2S1S0( 2 )7 4 L S 2 8 3 圖 J T 4 2 5 ( d )
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