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工學(xué)電路分析ppt課件-資料下載頁

2025-01-19 08:14本頁面
  

【正文】 0) I(A=B) ?Y(AB) = A3B3+(A3⊙ B3)A2B2+(A3⊙ B3)(A2⊙ B2)A1B1 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)A0B0 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)(A0⊙ B0) I(AB) ?Y(AB) = Y(AB)+Y(A=B) 實(shí)現(xiàn)基本功能時(shí),需令: I(AB)=0, I(A=B)=1,此時(shí),邏輯式可寫成: 邏輯式(不考慮 I(AB),即 I (AB) =1 ): ?Y(A=B) = (A3⊙ B3)(A2⊙ B2)(A1⊙ B1)(A0⊙ B0) ?Y(AB) = Y(AB)+Y(A=B) ?Y(AB) = A3B3+(A3⊙ B3)A2B2+(A3⊙ B3)(A2⊙ B2)A1B1 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)A0B0 ?當(dāng) A3 A2 A1 A0 =B3 B2 B1 B0 時(shí), Y(A=B)=1; 否則, Y(A=B)=0 ?當(dāng) Y(AB)=0, Y(A=B)=0時(shí), Y(AB)=1。否則, Y(AB)=0 當(dāng) A3=0, B3=1時(shí), Y(AB)=1; 當(dāng) A3=B3,而 A2=0, B2=1時(shí), Y(AB)=1; 當(dāng) A3=B3, A2=B2,而 A1=0, B1=1時(shí), Y(AB)=1; 當(dāng) A3A2A1=B3B2B1,而 A0=0, B0=1時(shí), Y(AB)=1; ?當(dāng) AB時(shí), Y(AB)=1;否則, Y(AB)=0。 ?Y(A=B) = (A3⊙ B3)(A2⊙ B2)(A1⊙ B1)(A0⊙ B0) ?Y(AB) = Y(AB)+Y(A=B) ?Y(AB) = A3B3+(A3⊙ B3)A2B2+(A3⊙ B3)(A2⊙ B2)A1B1 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)A0B0 擴(kuò)展功能: (用兩片 4位比較器級(jí)聯(lián)實(shí)現(xiàn) 8位數(shù)比較) 例:比較 C=C7C6C5C4C3C2C1C0, D=D7D6D5D4D3D2D1D0的大小。 方法:低 4位接第 (1)片輸入,高 4位接第 (2)片輸入; 第 (1)片 Y(AB)、Y(A=B)接第 (2)片 I(AB)、 I(A=B) ;第 (2)片輸出作總輸出 。 B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(1) D3 D2 D1 D0 C3 C2 C1 C0 Y(AB) Y(A=B) Y(AB) B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(2) D7 D6 D5 D4 C7 C6 C5 C4 Y(AB) Y(A=B) Y(AB) 0 1 Y(CD) Y(C=D) Y(CD) 重新分析邏輯式 (考慮 I(AB) 和 I(A=B) ) 說明當(dāng) A≠B時(shí),比較結(jié)果與 I無關(guān);當(dāng) A=B時(shí),比較結(jié)果決定于 I。且Y(AB)=I(AB), Y(A=B)= I(A=B)。 當(dāng) AB時(shí), 不管 I為何值, 都有 Y(AB)=1, Y(A=B)=0, Y(AB)=0; ?Y(A=B) = (A3⊙ B3)(A2⊙ B2)(A1⊙ B1)(A0⊙ B0) I(A=B) ?Y(AB) = A3B3+(A3⊙ B3)A2B2+(A3⊙ B3)(A2⊙ B2)A1B1 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)A0B0 +(A3⊙ B3)(A2⊙ B2)(A1⊙ B1)(A0⊙ B0) I(AB) ?Y(AB) = Y(AB)+Y(A=B) 當(dāng) AB時(shí), 不管 I為何值, 都有 Y(AB)=0, Y(A=B)=0, Y(AB)=1; 當(dāng) A=B時(shí), Y(AB)=I(AB), Y(A=B)= I(A=B), Y(AB)= Y(AB)+Y(A=B) 。 由于當(dāng) 高位不相等 時(shí),輸出決定于高位比較結(jié)果,與控制端無關(guān);當(dāng) 高位相等 時(shí),輸出應(yīng)決定于低位比較結(jié)果。 D3 D2 D1 D2 C3 C2 C1 C0 D7 D6 D5 D4 C7 C6 C5 C4 0 1 Y(CD) Y(C=D) Y(CD) B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(1) Y(AB) Y(A=B) Y(AB) B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(2) Y(AB) Y(A=B) Y(AB) 級(jí)聯(lián)方法 ?低 4位接第 (1)片輸入,高 4位接第 (2)片輸入; ?第 (2)片輸出作總輸出 。 ?故 將第 (1)片 Y(AB)、 Y(A=B)接第 (2)片 I(AB)、 I(A=B) ; ?第 (1)片 I(AB)接 0, I(A=B)接 1, 兩片的 I(AB)接 1。 D3 D2 D1 D2 C3 C2 C1 C0 D7 D6 D5 D4 C7 C6 C5 C4 0 1 Y(CD) Y(C=D) Y(CD) B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(1) Y(AB) Y(A=B) Y(AB) B3 B2 B1 B0 A3 A2 A1 A0 I(AB) I(A=B) I(AB) CC14585(2) Y(AB) Y(A=B) Y(AB) 例 1: C=10000001, D=11000001,則 Y(CD)=1, Y(C=D)=0, Y(CD)=0; 1 0 0 0 1 0 例 2: C=10000001, D=10001001,則 Y(CD)=1, Y(C=D)=0, Y(CD)=0; 10 I(AB)的作用: 當(dāng) I(AB)=1時(shí),不影響比較結(jié)果輸出; 當(dāng) I(AB)=0時(shí),只影響到 Y(AB)的輸出,使 Y(AB) =0。 故 I(AB)的作用是在需要的時(shí)候,屏蔽 Y(AB)的輸出。 正常使用時(shí),應(yīng)令 I(AB)=1。 從邏輯圖可以看出: 在級(jí)聯(lián)擴(kuò)展時(shí),也可將前一片的 Y接至后一片的 I(AB)上。 因 Y(AB) = Y(AB)+Y(A=B) )+I(A=B) 3. 4 競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象 競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象及其原因 當(dāng) A=1, B=0時(shí), Y=0; 當(dāng) A=0, B=1時(shí), Y=0; A B Y 毛刺 1 當(dāng) A=1, B=0時(shí), Y=1; 當(dāng) A=0, B=1時(shí), Y=1; A B Y 毛刺 0 當(dāng) A由 1變 0, B由 0變 1時(shí),若 B變得快 ,則 Y出現(xiàn)不應(yīng)有的毛刺 1。 amp。 A B Y 例 1: Y=AB ≥1 A B Y 例 2: Y=A+ B 當(dāng) A由 1變 0, B由 0變 1時(shí),若 A變得快 ,則 Y出現(xiàn)不應(yīng)有的毛刺 0。 產(chǎn)生毛刺的原因: 兩個(gè)輸入信號(hào)同時(shí)向相反的邏輯電平跳變, 但快慢不同,我們把這種現(xiàn)象稱作 競(jìng)爭(zhēng) 。 有競(jìng)爭(zhēng),有可能產(chǎn)生毛刺,但不一定產(chǎn)生毛刺 ,如例 1中, A變得快,則不會(huì)出現(xiàn)毛刺。 由于競(jìng)爭(zhēng)而在電路輸出端可能產(chǎn)生毛刺的現(xiàn)象叫做 競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象 。 amp。 A B Y A B Y 例: 2— 4線譯碼電路 當(dāng) A=0, B=1時(shí),;當(dāng) A=1, B=0時(shí), Y0=0; 毛刺的危害: 毛刺雖然很窄,但是會(huì)使后面的電路產(chǎn)生錯(cuò)誤輸出,故應(yīng)避免 。 A B Y0 毛刺 1 該電路中, Y Y Y Y0都有可能出現(xiàn)毛刺。 以 Y0=0為例 當(dāng) A由 0變 1, B由 1變 0時(shí),若 G4慢, G5快,則 Y0會(huì)出現(xiàn)毛刺 1。 1 1 A B Y3 Y2 Y1 Y0 A B G4慢 G5快 amp。 amp。 amp。 amp。 檢查競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象的方法 一次只有一個(gè)變量發(fā)生變化的情況,可通過觀察邏輯式判斷。 因?yàn)樵谶壿嬰娐分校粋€(gè)信號(hào)的原變量和反變量一定是通過不同的 路徑到達(dá)輸出門電路,或者是經(jīng)過的門的個(gè)數(shù)不同,或者是門的速 度不同,所以在上述情況下,當(dāng)這個(gè)信號(hào)變化時(shí),輸出一定有競(jìng)爭(zhēng) 冒險(xiǎn)現(xiàn)象。 則一定會(huì)有競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象。 若在一定條件下,輸出可以寫成: Y=AA; Y=A+A的形式 例: CAABY ??上式在 B=1, C=1的條件下 , 能化成 Y=A+A的形式 , 故有競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象 。 amp。 1 amp。 ≥1 A B C Y A A 這種方法局限性很大,只適用于每次只有一個(gè)變量發(fā)生變化的 情況。 更好的方法是 ①計(jì)算機(jī)輔助分析 (因?yàn)榭梢苑治龆喾N情況 ), ②試驗(yàn)方法 (輸入變量變化,觀察輸出)。 例: ))(( CBBAY ???上式在 A=0, C=0的條件下 , 能化成 Y=BB的形式 , 故有競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象 。 1 amp。 A B C Y B B ≥1 ≥1 消除競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象的方法 一、電容濾波 此方法簡(jiǎn)單 , 但使輸出波形變壞 , 上升沿和下降沿不陡 。因電容充放電需時(shí)間 。 將毛刺濾掉。(濾波)(幾十至幾百皮法) A B Y0 毛刺 1 amp。 amp。 amp。 1 1 A B Y3 Y2 Y1 Y0 A B amp。 二、引入選通脈沖 此方法不簡(jiǎn)便 , 要進(jìn)行信號(hào)的時(shí)序配合 。 例譯碼器電路中,在輸出門引入選通脈沖 p, 等 AB均變?yōu)榭煽侩娖綍r(shí)再輸出 Y0。 A B p Y0 p 1 1 A B Y3 Y2 Y1 Y0 A B G4慢 G5快 amp。 amp。 amp。 amp。 三、修改邏輯設(shè)計(jì) BCCAABY ???在邏輯式中,增加 BC項(xiàng),得: 當(dāng) B=1, C=1時(shí), Y=1,而不是 Y= A+A。 當(dāng) A變化時(shí),不會(huì)出現(xiàn)毛刺。 此方法有局限性。 只消除了 B、 C不變, A單獨(dú)變化時(shí)的競(jìng)爭(zhēng)冒險(xiǎn)。 但是當(dāng) AB同時(shí)由 10變?yōu)?01時(shí),仍存在競(jìng)爭(zhēng)冒險(xiǎn) 實(shí)際情況中,根據(jù)具體情況,選擇合適的方法。 例: CAABY ??amp。 1 amp。 ≥1 A B C Y A A 同時(shí)將電路改為: amp。 1 A B C Y amp。 1 ≥1 amp。 ※ 掌握組合邏輯電路的分析方法和設(shè)計(jì)方法。 ※ 了解 5種組合電路的內(nèi)部結(jié)構(gòu)、工作原理。 ※ 掌握 5種組合邏輯電路的功能、使用方法。 (包括基本使用方法 和級(jí)聯(lián)擴(kuò)展,會(huì)分析和設(shè)計(jì)電路。 ) ※ 掌握用譯碼器,數(shù)據(jù)選擇器,加法器設(shè)計(jì)組合邏輯電路的方法。 ※ 掌握競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象的概念,掌握判斷方法,了解消除方法。 第三章 組合邏輯電路總結(jié) 主要內(nèi)容 ※ 組合邏輯電路的分析方法 (已知邏輯圖,分析邏輯功能。) ※ 組合邏輯電路的設(shè)計(jì)方法 (已知邏輯問題,畫出邏輯圖。) ※ 五種常用的組合邏輯電路 (編碼器,譯碼器,數(shù)據(jù)選擇器, 加法器,數(shù)值比較器) ※ 競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象 (原因,判斷,消除) 重點(diǎn)掌握 [題 ] 試畫出用 4片 8線 3線優(yōu)先編碼器 74LS148組成 32線 5線優(yōu)先 編碼器的邏輯圖。允許附加必要的門電路。 (要求原碼輸出) 31A 24A 23A 16A ( 1) 7I012 YYYY EXS SY0I... ... ( 2) 7I012 YYYY EXS SY0I... ... ( 3) 7I012 YYYY EXS SY0I... ... ( 4) 7I012 YYYY EXS SY0I... ...
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