電子技術(shù)課程設(shè)計(jì)——數(shù)字鐘(編輯修改稿)
2025-08-10 01:13 本頁(yè)面
【文章內(nèi)容簡(jiǎn)介】 ，不受其他輸入端狀態(tài)的影響。正常工作時(shí)必須使RD處于高電平。圖中的數(shù)碼1—8為器件引腳的編號(hào)。555定時(shí)器是一種中規(guī)模集成電路，只要在外部配上適當(dāng)阻容元件，就可以方便地構(gòu)成脈沖產(chǎn)生和整形電路。555集成定時(shí)器由五個(gè)部分組成： 基本RS觸發(fā)器：由兩個(gè)“與非”門(mén)組成 比較器：CC2是兩個(gè)電壓比較器 分壓器：阻值均為5千歐的電阻串聯(lián)起來(lái)構(gòu)成分壓器，為比較器C1和C2提供參考電壓。 晶體管開(kāi)卷和輸出緩沖器：晶體管VT構(gòu)成開(kāi)關(guān)，其狀態(tài)受端控制。輸出緩沖器就是接在輸出端的反相器G3，其作用是提高定時(shí)器的帶負(fù)載能力和隔離負(fù)載對(duì)定時(shí)器的影響。其邏輯框圖如下： 圖七、邏輯框圖邏輯符號(hào)如下： 圖八、555邏輯符號(hào)邏輯功能表如下圖：表四 555邏輯功能表輸 入輸 出閾值輸入(vI1)觸發(fā)輸入(vI2)復(fù)位()輸出()放電管T00導(dǎo)通 11截止10導(dǎo)通1不變不變邏輯功能描述如下：555定時(shí)器的主要功能取決于比較器，比較器的輸出控制RS觸發(fā)器和放電管T的狀態(tài)。圖中RD為復(fù)位輸入端，當(dāng)RD為低電平時(shí)，不管其他輸入端的狀態(tài)如何，輸出v0為低電平。因此在正常工作時(shí)，應(yīng)將其接高電平。由圖可知，當(dāng)5腳懸空時(shí)，比較器C1和C2比較電壓分別為2/3VCC和1/3VCC。當(dāng)vI12/3VCC，vI21/3VCC時(shí)，比較器C1輸出低電平，比較器C2輸出高電平，基本RS觸發(fā)器被置0,放電三極管T導(dǎo)通，輸出端vO為低電平。 當(dāng)vI12/3VCC，vI21/3VCC時(shí)，比較器C1輸出高電平，比較器C2輸出低電平，基本RS觸發(fā)器被置1,放電三極管T截止，輸出端vO為高電平?！ ‘?dāng)vI12/3VCC，vI21/3VCC時(shí)，基本RS觸發(fā)器R =S =1,觸發(fā)器狀態(tài)不變，電路亦保持原狀態(tài)不變。綜合上述分析。如果在電壓控制端（5腳）施加一個(gè)外加電壓（其值在0VCC之間），比較器的參考電壓將發(fā)生變化，電路相應(yīng)的閾值、觸發(fā)電平也將隨之變化，進(jìn)而影響電路的工作狀態(tài)。 74LS160為十進(jìn)制同步加法計(jì)數(shù)器邏輯框圖如圖： 邏輯符號(hào)如圖： 圖十、74LS160邏輯符號(hào)圖九、74LS160邏輯框圖邏輯功能表如下：表五、74LS160邏輯功能CPEP ET工作狀態(tài)0 置零10 預(yù)置數(shù)110 1保持11 0保持（但C=0）111 1計(jì)數(shù)邏輯功能描述如下：由邏輯圖與功能表知，在CT74LS160中LD為預(yù)置數(shù)控制端，D0D3為數(shù)據(jù)輸入端，C為進(jìn)位輸出端，RD為異步置零端，Q0Q3位數(shù)據(jù)輸出端，EP和ET為工作狀態(tài)控制端。當(dāng)RC=0時(shí)所有觸發(fā)器將同時(shí)被置零，而且置零操作不受其他輸入端狀態(tài)的影響。當(dāng)RC=LD=0時(shí)，電路工作在預(yù)置數(shù)狀態(tài)。這時(shí)門(mén)G16G19的輸出始終是1，所以FF0FF1輸入端J、K的狀態(tài)由D0D3的狀態(tài)決定。當(dāng)RC=LD=1而EP=0、ET=1時(shí)，由于這時(shí)門(mén)G16G19的輸出均為0，亦即FF0FF3均處在J=K=0的狀態(tài)，所以CP信號(hào)到達(dá)時(shí)它們保持原來(lái)的狀態(tài)不變。同時(shí)C的狀態(tài)也得到保持。如果ET=0、則EP不論為何狀態(tài)，計(jì)數(shù)器的狀態(tài)也保持不變，但這時(shí)進(jìn)位輸出C等于0。當(dāng)RC=LD=EP=ET=1時(shí)，電路工作在計(jì)數(shù)狀態(tài)。從電路的0000狀態(tài)開(kāi)始連續(xù)輸入16個(gè)計(jì)數(shù)脈沖時(shí)，電路將從1111的狀態(tài)返回0000的狀態(tài)，C端從高電平跳變至低電平。利用C端輸出的高電平或下降沿作為進(jìn)位輸出信號(hào)。其內(nèi)部原理圖如下圖所
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