【文章內(nèi)容簡(jiǎn)介】 45,142,139,136,133,130,126,123,120,117,114,111,108,104 DB 101,98,95,92,89,86,83,80,77,75,72,69,66,63,61,58,55,53,50,48,45,43 DB 41,38,36,34,32,30,28,26,24,22,20,19,17,16,14,13,11,10,9,8,7,6,5,4,3 DB 3,2,2,1,1,0,0,0,0,0,0,0,1,1,1,2,2,3,4,4,5,6,7,8,10,11,12,13,15,16,18 DB 20,21,23,25,27,29,31,33,35,37,39,42,44,47,49,51,54,57,59,62,65,67,70 DB 73,76,79,82,85,88,91,94,97,100,103,106,109,112,115,119,122,125,128 。延時(shí)程序，輸入?yún)?shù)R0，R1DELAY:MOV 31H,R1 。將R1數(shù)據(jù)保存在31H MOV 30H,R0 。將R0數(shù)據(jù)保存在30HD1:MOV R1,31H 。將R1原始數(shù)據(jù)送回R1D2:DJNZ R1,D2 。R1遞減循環(huán) DJNZ R0,D1 。R0遞減循環(huán) MOV R1,31H ?；謴?fù)R1數(shù)據(jù) MOV R0,30H ?；謴?fù)R1數(shù)據(jù) RET。輸出程序，入口參數(shù)A,將其輸出 OUTPUT: MOV R6,8 。八個(gè)數(shù)據(jù)輸出次數(shù) SETB LOAD 。置位LOAD，開始輸入數(shù)據(jù) CLR DAT 。設(shè)置A1=0 LCALL CLK1 。輸出A1 CLR DAT 。設(shè)置A0=0 LCALL CLK1 。輸出A0 CLR DAT 。設(shè)置RGN=0 LCALL CLK1 。輸出RGN=0SDATA:RLC A 。將A中的數(shù)據(jù)逐位輸出，高位在前，低位在后 MOV DAT,C LCALL CLK1 DJNZ R6,SDATA CLR LOAD LCALL DELAY SETB LOAD RET。產(chǎn)生下降沿的子程序，產(chǎn)生同步時(shí)鐘，將數(shù)據(jù)輸出CLK1:SETB CLKCLR CLKRETEND第3章 結(jié)論最后D/ A 輸出的信號(hào)經(jīng)過濾波后得到的信號(hào)波形如圖31 所示。 圖31正弦波 實(shí)驗(yàn)結(jié)論通過設(shè)計(jì)和實(shí)驗(yàn),得出以下結(jié)論:(1) 本設(shè)計(jì)通過鍵盤控制波形輸出的頻率和相位,波形頻率可調(diào)范圍為:20 Hz～20 KHz ,相位可調(diào)范圍為:0176?！?60176。,頻率步進(jìn)值為20 Hz。(2) 波形失真度與儲(chǔ)存波形ROM 的位數(shù)及主工作時(shí)鐘頻率有關(guān)。(3) 使用FPGA 中的嵌入式鎖相環(huán)或者增加采樣波形數(shù)據(jù)的點(diǎn)數(shù)(此時(shí)需要外配置ROM) ,可以大大提高主工作時(shí)鐘的頻率,消除波形失真。采用哪種方法或同時(shí)采用兩種方法,取決于實(shí)際應(yīng)用的需要。采用VHDL 語(yǔ)言,具有很強(qiáng)的電路描述和建模能力,能從多個(gè)層次對(duì)數(shù)字系統(tǒng)進(jìn)行建模和描述,從而大大簡(jiǎn)化了硬件設(shè)計(jì)任務(wù),提高了設(shè)計(jì)效率和可靠性。(4) 基于FPGA 和VHDL 的在系統(tǒng)可重編程的特點(diǎn),系統(tǒng)更新只需修改VHDL 程序即可,無(wú)需重新制作系統(tǒng)。外圍電路數(shù)/ 模轉(zhuǎn)換器的控制也可由VHDL 程序?qū)崿F(xiàn),因此數(shù)/ 模轉(zhuǎn)換芯片更換方便。(5) 采用AT89C51 單片機(jī),可實(shí)現(xiàn)在線編程,方便靈活,提高了開發(fā)效率,同時(shí)采用串行數(shù)據(jù)傳送方式占用口線少,減少了資源的浪費(fèi)。(6) 本設(shè)計(jì)中的DDS 電路與專用DDS 集成芯片相比,其靈活性更好,可生成任意波形,頻率分辨率高,轉(zhuǎn)換速度快,穩(wěn)定性好,精度高,且均可對(duì)頻率、相位、幅度實(shí)現(xiàn)程控,更重要的是,他如果作為IP 核將具有更大的可移植性。第4章 未來展望據(jù)市場(chǎng)調(diào)查機(jī)構(gòu)統(tǒng)計(jì)，2009年依然是示波器、頻譜分析儀、信號(hào)發(fā)生器和萬(wàn)用表這四大測(cè)試設(shè)備占據(jù)主要市場(chǎng)份額，%，并且在未來的幾年中，信號(hào)發(fā)生器將成為增長(zhǎng)最強(qiáng)勁的測(cè)試產(chǎn)品。為應(yīng)對(duì)更高的測(cè)試需求，電子測(cè)試設(shè)備展現(xiàn)出了更多的變化。持續(xù)走向高性能、多功能、小型化及高性價(jià)比的發(fā)展道路?？梢?，除了硬件性能上的不斷提高，電子測(cè)試設(shè)備的未來發(fā)展，也不再只以單一儀器的性能參數(shù)為主，由多種不同儀器、軟件和配件組成的整體解決方案展現(xiàn)在不同設(shè)備供應(yīng)商的產(chǎn)品規(guī)劃中。以往軟件的使用必須借助于外部的計(jì)算機(jī)，隨著計(jì)算機(jī)制造水平的提高，體積不斷減小，很多儀器已經(jīng)內(nèi)置有高速計(jì)算機(jī)和強(qiáng)大的DSP。因此將這些軟件移植到儀器內(nèi)部的計(jì)算機(jī)將會(huì)是一個(gè)趨勢(shì)。 參考文獻(xiàn)[1] 張富貴,姚振東. 基于DDS 的高性能信號(hào)發(fā)生器的實(shí)現(xiàn)[J ] .成都信息工程學(xué)院學(xué)報(bào):自然科學(xué)版,2006 ,21 (1) :12217.[2] 劉開輝,朱平云. 基于DDS 技術(shù)的高精度微波信號(hào)發(fā)生器[J ] . 電子技術(shù)應(yīng)用,2006 ,32 (2) :1212123.[3] 王峰．信號(hào)發(fā)生器[M]．沈陽(yáng)：東北大學(xué)出版社，2004[4] 余永權(quán)，汪明慧，黃英．單片機(jī)在控制系統(tǒng)中的應(yīng)用[M]．北京：電子工業(yè)出版社，2003[5] 爾桂花，竇曰．移相信號(hào)發(fā)生器[M]．北京：清華大學(xué)出版社，2002.[6] 王曉明．電動(dòng)機(jī)的單片機(jī)控制[M]．北京：北京航空航天大學(xué)出版社，2002[7] 黃堅(jiān)．自動(dòng)控制原理及其應(yīng)用[M]．北京：高等教育出版社，[8] 孫涵芳．Intel16位單片機(jī)[M]．北京：北京航空航天大學(xué)出版社，1995[9] 何熙文．Intel 8XC196MC/MD高檔單片機(jī)原理及實(shí)用設(shè)計(jì)[M]．大連理工大學(xué)出版社，1995[10] 李宏，張翌．高性能集成六輸出高壓MOS門極驅(qū)動(dòng)器—IR2130及其在電力電子技術(shù)中的應(yīng)用[J]．1994(6)[11] 張繼和．a(chǎn)vr基礎(chǔ)[M]．成都：西南交通大學(xué)出版社，2000[12] 王曉明．單片機(jī)控制[M]．北京：北京航空航天大學(xué)出版社，2002[13] 徐愛卿．Intel16位單片機(jī)[M]．北京：北京航空航天大學(xué)出版社，2002[14] 蘇家鍵，曹柏榮，汪志峰．單片機(jī)機(jī)原理及應(yīng)用技術(shù)[M]．北京：高等教育業(yè)出版社，[15] 陳永校．無(wú)傳感器無(wú)刷直流位置誤差的分析[J]．微特電機(jī)，1999[16] 海濤，龍軍．8096單片機(jī)原理及應(yīng)用[M]．重慶：重慶工業(yè)大學(xué)出版社，2003[17] 丁元杰．單片微機(jī)原理及應(yīng)用[M]．北京：機(jī)械工業(yè)出版社，[18]Nicholas H T , Samueli H. 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The PLL will produce a voltage proportional to the frequency of the ining signal which, in the case of FM, is the original modulating signal.Figure 1354 shows a typical connection for the LM565 as an FM demodulator. If the IF input is frequency modulated by a sinusoidal signal, you get a sinusoidal signal on the output as indicated. Since the maximum operating frequency is 500 kHz, this device must be used in doubleconversion FM receiver is one in which essentially two mixers are used to first convert the RF to a MHz IF and then convert this to a 455 kHz IF.The freerunning frequency of the VCO is adjusted to approximately 455 kHz, which is the center of the modulated IF range, C? can be any value, but R? should be in the range from 2kΩ to 20kΩ ,The input van be directly coupled as long as there is no dc voltage difference between pins 2 and VCO is connected to the phase detector by an external wire between pins 4 and 5.Determine the values for R?,C? and C? for the LM565 in Figure 1354 for a freerunning frequency of 455 kHz and a capture range of 177。 dc supply voltages are 177。 6V.Solution Use Equation (135) to calculate C?.Choose R? =.■ COMMUNICATIONS CIRCUITSThe lock range and capture range must be determined before C? can be calculated. The lock range isUse Equation (137) to calculate C?.Therefore,Practice Exercise What can you do to increase the capture range from 177。10 kHz to 177。 15 kHz ?138 REVIEW QUESTIONS 1. List the three basic ponents in a phaselocked loop. 2. What is another circuit used in some PLLs other than the three listed in Question 1? 3. What is the basic function of a PLL? 4. What is the difference between the lock range and the capture range lf a PLL? 5. Basically, how does a PLL track the ining frequency? ■ A SYSTEM APPLICATION The DCE (data munications equipment) system introduced at the opening of this chapter includes an FSK (frequency shift keying) modem (modulator/demodulator). FSK is one method for modulating digital data for transmission over voice phone lines and is basically a form of frequency modulation .In this system application, the focus is on the lowspeed modulator/demodulator (modem) board, which is implemented wi