【文章內(nèi)容簡(jiǎn)介】 論文研究?jī)?nèi)容 本文介紹 了一個(gè)智能交通燈控制系統(tǒng)的設(shè)計(jì)。該智能交通燈控制系統(tǒng)可以實(shí)現(xiàn)的功能主要有：對(duì)某市區(qū)的主要交通路口進(jìn)行控制；使各路口有固定的工作周期，并且在道路擁擠時(shí)中控中心能夠改變交通燈的變換周期。 其詳細(xì)功能是在 路口的無緊急情況時(shí)，以時(shí)間為依據(jù)控制信號(hào)燈，使其按照正常順序運(yùn)行，而當(dāng)有緊急情況時(shí)則按照緊急處理規(guī)則改變信號(hào)燈的狀態(tài)變換。所以，路口交通燈的控制規(guī)律是以是否有緊急情況而發(fā)生改變。使信號(hào)燈能按預(yù)設(shè)的規(guī)律在不同情況下按要求有不同的配置輸出，這就是交通燈信號(hào)控制器的基于 DSP 的設(shè)計(jì)與實(shí)現(xiàn)。 該設(shè)計(jì)以 DSP TMS320VC5509 為路口控制核心， 配合 CPLD 實(shí)現(xiàn)對(duì)外部器件的控制。研究對(duì)象為 單個(gè)路口控制，與 PC 機(jī)之間的的通信采用 MAX232 進(jìn)行轉(zhuǎn)換。作為整個(gè)交通網(wǎng)絡(luò)最小研究單元的單個(gè)交叉路口，對(duì)于單個(gè)路口的控制方法的研究是整個(gè)交通燈控制網(wǎng)路的研究基礎(chǔ)， 所以本設(shè)計(jì) 對(duì)于整個(gè)交通控制網(wǎng)絡(luò) 有 著 非常重要的意義。 哈爾濱理工大學(xué)學(xué)士學(xué)位論文 4 第 2章 DSP 芯片選擇 DSP的含義及其用途 自從 20 世紀(jì) 80 年代初期第一片數(shù)字信號(hào)處理器 (Digital Signal Processor)問世以來， DSP 就以數(shù)字器件特有的穩(wěn)定性、可重復(fù)性、可大規(guī)模集成，尤其是可編程性和易于實(shí)現(xiàn)自 適應(yīng)處理的特點(diǎn)，給數(shù)字信號(hào)處理的發(fā)展帶來巨大的機(jī)遇，使得信號(hào)處理手段更加靈活，功能更加強(qiáng)大。近年來， DSP 作為一種新型的微處理器在各種消費(fèi)類、通信、醫(yī)療和工業(yè)產(chǎn)品中得到了非常廣泛的應(yīng)用。DSP 處理器是一類針對(duì)數(shù)字信號(hào)處理領(lǐng)域進(jìn)行了優(yōu)化的微處理器。和普通的微處理器相比，它們具有特殊的硬件結(jié)構(gòu)特別適合各類數(shù)字信號(hào)處理算法的實(shí)現(xiàn)，從而使得產(chǎn)品易于實(shí)現(xiàn)和維護(hù)。用 DSP 開發(fā)的產(chǎn)品其成本和風(fēng)險(xiǎn)也比定制的 IC產(chǎn)品相對(duì)要低，特別是對(duì)于批量比較 少 的產(chǎn)品，如果用定制 IC 來實(shí)現(xiàn)開發(fā)成本將難以忍受。同時(shí)與其它類型的微處理器相比， DSP 的指令執(zhí)行周期速度快，DSP 在速度、成本、功耗方面具有不可取代的優(yōu)勢(shì)。 DSP 有兩種解釋：其一是 Digital Signal Processing 的縮寫，即數(shù)字信號(hào)處理；其二是 Digital Signal Processor 即數(shù)字信號(hào)處理器的意思。前者數(shù)字信號(hào)處理是利用計(jì)算機(jī)或?qū)Ｓ锰幚碓O(shè)備，以數(shù)字的形式對(duì)信號(hào)進(jìn)行采集、變換、濾波、估值、增強(qiáng)、壓縮、識(shí)別等處理，以得到符合人們需要的信號(hào)形式。后者數(shù)字信號(hào)處理器是用來完成數(shù)字信號(hào)處理要求的具有特殊結(jié)構(gòu)的一種微處理器，即我們經(jīng)常所說的 DSP 器件。 數(shù)字信號(hào)處理 的一個(gè)重要技術(shù)領(lǐng)域是實(shí)時(shí)數(shù)字信號(hào)處理。實(shí)時(shí)信號(hào)處理是指系統(tǒng)必須在有限的時(shí)間內(nèi)隨外部輸入信號(hào)完成指定的處理功能，即信號(hào)處理速度應(yīng)當(dāng)大于信號(hào)更新 (傳輸 )速度。一個(gè)典型的實(shí)時(shí)信號(hào)處理系統(tǒng)如圖 21 所示 。輸入信號(hào)可能是人的語音信號(hào)、傳真機(jī)信號(hào)或在數(shù)字鏈路中傳輸?shù)囊曨l圖像信號(hào)。輸入信號(hào)在進(jìn)行 A／ D 采樣時(shí)，根據(jù)奈奎斯特采樣定理，采樣頻率至少是輸入帶限信號(hào)最高頻率的 2 倍，在實(shí)際應(yīng)用中一般為 4 倍以上。數(shù)字信號(hào)處理一般是用DSP 芯片及其內(nèi)部運(yùn)行的實(shí)時(shí)處理軟件對(duì) A／ D 轉(zhuǎn)換后的數(shù)字信號(hào)進(jìn)行特定的處理。最后，經(jīng)過處理后的信號(hào)經(jīng)過 D／ A 轉(zhuǎn)換、內(nèi)插和平滑濾波得到連續(xù)的模擬信號(hào)。應(yīng)當(dāng)指出，并非所有的 DSP 系統(tǒng)都具有圖 21 模型中的部件。例如 CD和 MP3 播放器的輸入信號(hào)本身就是數(shù)字信號(hào)。 圖 21 典型實(shí)時(shí)數(shù)字信號(hào)處理系統(tǒng)原理圖 輸入 A/D 轉(zhuǎn)換 數(shù)字信號(hào) 處理 D/A 轉(zhuǎn)換 平滑濾波 混疊濾波 哈爾濱理工大學(xué)學(xué)士學(xué)位論文 5 DSP的基本硬件結(jié)構(gòu)特點(diǎn) 世界上有許多生產(chǎn) DSP 的廠家，如 TI公司的一系列 TMS320C54X、TMS320C6000和 TMS320C55X， 以及 Motoroal公司的 DSP56200等。各廠家生產(chǎn)的芯片的具體功能有所不同，但是一般而言 DSP作為數(shù)字信號(hào)處理 領(lǐng)域的專用微處理器， DSP芯片有一些共同的硬件結(jié)構(gòu)，下面詳細(xì)介紹 DSP的通用硬件結(jié)構(gòu) 。 存儲(chǔ)器和總線結(jié)構(gòu) DSP處理器有著更高的存儲(chǔ)器帶寬。 20世紀(jì) 80年代早期，通用微處理器通常都只有一條總線連到存儲(chǔ)器，每個(gè)時(shí)鐘周期只能訪問一次存儲(chǔ)器，即所謂的馮諾伊曼結(jié)構(gòu)。為解決對(duì)存儲(chǔ)器帶寬的需求問題， DSP處理器發(fā)展了新的存儲(chǔ)器和總線結(jié)構(gòu)，即哈佛結(jié)構(gòu)。哈佛結(jié)構(gòu)允許在單周期可以進(jìn)行多次存儲(chǔ)器訪問。哈佛結(jié)構(gòu)最通常的方法就是使用多個(gè)存儲(chǔ)器，每個(gè)存儲(chǔ)器都有自己的總線，不同的 是 存儲(chǔ)器在一個(gè)周期內(nèi)可以同時(shí)讀寫。通常指令存在一個(gè)存儲(chǔ)器 中，數(shù)據(jù)存在另一個(gè)存儲(chǔ)器中。這樣的安排使得處理器可以同時(shí)獲取指令和數(shù)據(jù)。即采用多總線結(jié)構(gòu)，它在片內(nèi)至少有四套總線：程序地址總線、程序數(shù)據(jù)總線、數(shù)據(jù)的地址總線和數(shù)據(jù)的數(shù)據(jù)總線 [2]。這種分離的程序和數(shù)據(jù)總線，可允許同時(shí)獲得來自程序存儲(chǔ)器的指令字和來自數(shù)據(jù)存儲(chǔ)器的操作數(shù)而互不干擾，這樣使得其可以同時(shí)對(duì)數(shù)據(jù)和程序進(jìn)行尋址。圖 22給出了兩種不同的結(jié)構(gòu)。 圖 22 兩種存儲(chǔ)結(jié)構(gòu) 在改進(jìn)的哈佛結(jié)構(gòu)的基礎(chǔ)上，大多數(shù) DSP芯片采用流水線技術(shù)，即每條指令的執(zhí)行劃分為 取指、譯碼、取數(shù)、執(zhí)行等步驟 [2]，由片內(nèi)多個(gè)功能單元分別完成。則相當(dāng)于多條指令并行執(zhí)行，從而大大提高了運(yùn)算速度。 尋址方式 和傳統(tǒng)的微處理器相比， DSP提供了更多的尋址方式，以適應(yīng) DSP的特定處理要求，更多的尋址方式使 DSP應(yīng)用方便靈活。以 TI公司的 C54X系列 DSP為例，在它的間接尋址方式中，除了通常所使用的增量、減量和變址尋址功能。還增加了位碼倒序?qū)ぶ?、循環(huán)尋址等功能。 在 FFT算法中，經(jīng)常要用到位碼倒序?qū)ぶ贰Ｔ趥鹘y(tǒng)的微處理器上，必須通過軟件編程的方法來實(shí)現(xiàn)，消耗大量的存儲(chǔ)空間和 CPU周期。而在 C54X DSP上，利用如下兩條指令就可以向外設(shè)口 (PA)輸出整序后的 FFT變換結(jié)果了： RPT15 馮諾依 曼結(jié)構(gòu) 總線 通用 處理 器核 程序 /數(shù)據(jù)存儲(chǔ)器 總線 程序存 儲(chǔ)器 數(shù)據(jù)存 儲(chǔ)器 DSP 處理器核 總線 哈佛 結(jié)構(gòu) 哈爾濱理工大學(xué)學(xué)士學(xué)位論文 6 PORTW*AR2十 OB， PA； AR2中存放的是數(shù)據(jù)存儲(chǔ)器中數(shù)據(jù)存放的基地址， ； ARO中存放的則是 FFT長(zhǎng)度的一半 。 DSP算法中的存儲(chǔ)器訪問模式往往是可以預(yù)知的。例如，對(duì) FIR濾波器中的每次采樣，濾波系數(shù)的訪問是從頭到尾連續(xù)的，然后當(dāng)處理下一次采樣的時(shí)候，再?gòu)南禂?shù)矢量的開始進(jìn)行訪問。 DSP處理器的地址生成單元利用這種訪問模式的可預(yù)知性，可以支持特殊的尋址模式，使得在處理一些算法時(shí)，處理器能夠有效的訪問數(shù)據(jù) 。 C54XDSP處理器支持“循環(huán)尋址”，這種尋址模式允許處理器訪問一塊連續(xù)存放的數(shù)據(jù)，然后再自動(dòng)回到塊的開始，這正是 FIR濾波中訪問系數(shù)的模式。循環(huán)尋址對(duì)于 FIFO緩沖的實(shí)現(xiàn)也是非常有用的。 DSP系統(tǒng)的設(shè)計(jì)流程 使用 DSP進(jìn)行系統(tǒng)設(shè)計(jì)的一般流程如圖 23所示，包括硬件設(shè)計(jì)流程和軟件開發(fā)步驟。其設(shè)計(jì)步驟為： 1． 算法模擬階段，即根據(jù)應(yīng)用系統(tǒng)目標(biāo)確定系統(tǒng)性能指標(biāo)。首先應(yīng)根據(jù)系統(tǒng)要求進(jìn)行算法仿真和高級(jí)語言模擬實(shí)現(xiàn)。為了得到最佳系統(tǒng)性能，在這一步驟應(yīng)當(dāng)確定最佳處理方法。例如，為實(shí)現(xiàn)針對(duì)移動(dòng)通信的視頻顯示，需要在給 定的實(shí)現(xiàn)目標(biāo)上作算法選擇、模擬和實(shí)現(xiàn)。最終找到既能滿足設(shè)計(jì)需要，運(yùn)算量又盡可能少的實(shí)現(xiàn)算法。 2． 選擇 DSP芯片。根據(jù)算法要求 (運(yùn)算速度、運(yùn)算精度要求、存儲(chǔ)器要求等 )選擇 DSP芯片，設(shè)計(jì)實(shí)時(shí) DSP系統(tǒng)。此階段包括硬件設(shè)計(jì)和軟件設(shè)計(jì)兩個(gè)方面。硬件設(shè)計(jì)主要根據(jù)系統(tǒng)要求設(shè)計(jì) DSP芯片外圍電路和其他電路 (如轉(zhuǎn)換、控制、存儲(chǔ)、輸出等電路 )[4]。軟件設(shè)計(jì)主要根據(jù)系統(tǒng)要求和所選的 DSP芯片編寫相應(yīng)的DSP匯編軟件。如果系統(tǒng)運(yùn)算量不大，可以采用高級(jí)語言 C和匯編語言混合編程。 3． 硬件和軟件調(diào)試階段。硬件調(diào)試一般采用硬件仿 真器進(jìn)行。軟件調(diào)試一般借助 DSP開發(fā)上具有如軟件模擬器、 DSP開發(fā)系統(tǒng)或仿真器等進(jìn)行。通過比較在 DSP所執(zhí)行的實(shí)時(shí)程序和模擬程序執(zhí)行情況來判斷軟件設(shè)計(jì)是否正確。 4． 集成和系統(tǒng)測(cè)試階段。調(diào)試階段完成后，實(shí)時(shí)程序被固化在 EPROM或者Flash里面。 DSP芯片的選擇標(biāo)準(zhǔn) 設(shè)計(jì) DSP應(yīng)用系統(tǒng)，選擇 DSP芯片是非常重要的一個(gè)環(huán)節(jié)。只有選定了 DSP芯片，才能進(jìn)一步設(shè)計(jì)其外圍電路及系統(tǒng)的其他電路?？偟膩碚f， DSP芯片的選擇應(yīng)根據(jù)實(shí)際的應(yīng)用系統(tǒng)需要而確定。不同的 DSP應(yīng)用系統(tǒng)由于應(yīng)用場(chǎng)合和目的等不盡相同，對(duì) DSP芯片 的選擇也是不同的。一般來說，選擇 DSP芯片時(shí)應(yīng)考慮到如下諸多因素： 1．運(yùn)算速度。當(dāng)算法確定后其運(yùn)算量和限定地完成時(shí)間就確定了。由此估算出所需 DSP運(yùn)算速度地下限。 DSP的運(yùn)算速度可以用下面幾種指標(biāo)來衡量： 指令周期：即執(zhí)行一條指令所需要的時(shí)間，以納秒為單位。如果 DSP芯片平 均在一個(gè)時(shí)鐘周期內(nèi)可以完成一條指令，則其指令周期等于 DSP主頻的倒數(shù)。 哈爾濱理工大學(xué)學(xué)士學(xué)位論文 7 圖 23 DSP系統(tǒng)設(shè)計(jì)流程 MAC時(shí)間 [2]：即執(zhí)行一次乘法累加運(yùn)算的時(shí)間。大多數(shù) DSP芯片可以在一 個(gè)指令周期內(nèi)完成一次 MAC運(yùn)算。 FFT執(zhí)行時(shí)間：即運(yùn)行一個(gè) N點(diǎn) FFT程序所需時(shí)間。 FFT是典型的數(shù)字信號(hào)處理算法，它可以作為綜合衡量 DSP運(yùn)算能力的一個(gè)指標(biāo)。 MIPS／ MFLOPS：其含義是每秒百萬條指令和每秒百萬條浮點(diǎn)操作。則兩個(gè)參數(shù)分別對(duì)應(yīng)于定點(diǎn) DSP和浮點(diǎn) DSP芯片。 2． 運(yùn)算精度。一般地浮點(diǎn) DSP精度高于定點(diǎn) DSP，但耗電量和價(jià)格也比定點(diǎn) DSP貴。一般定點(diǎn) DSP芯片的字長(zhǎng)為 l 6位或 24位，浮點(diǎn)字長(zhǎng)位 32位。累加器都為 40位。雖然適當(dāng)?shù)乃惴梢蕴岣?、保證運(yùn)算精度，但要相應(yīng)增加程序復(fù)雜度和運(yùn)算量。 所以運(yùn)算精度要求是個(gè)折中問題，需要在算法確定階段予以認(rèn)真考慮。 3． 片內(nèi)硬件資源。通過對(duì)算法程序和應(yīng)用目標(biāo)的仔細(xì)分析可以大致判定對(duì)DSP芯片片內(nèi)資源的要求。幾個(gè)重要的考慮因素為：片內(nèi) RAM和 ROM、外部存儲(chǔ)器擴(kuò)展空間、總線接口、 DMA通道、定時(shí)器、中斷、串口，主機(jī)通信，通用端口和 JTAG口等。用戶需要參考廠家推薦 DSP芯片典型應(yīng)用來考慮此項(xiàng)要求。 4． 芯片價(jià)格。芯片價(jià)格是 DSP應(yīng)用產(chǎn)品民用化的重要決定因素。一般成熟 穩(wěn)定的比較適中。在本圖像處理系統(tǒng)中，需要用到處理速度非?？斓?DSP設(shè)計(jì)需要規(guī)范 確定設(shè)計(jì)目標(biāo) 算法研 究與系統(tǒng)模擬實(shí)現(xiàn) 定義系統(tǒng)性能指標(biāo) DSP 芯片選擇 硬件設(shè)計(jì) 硬件調(diào)試 軟件編程 軟件調(diào)試 系統(tǒng)集成和測(cè)試 哈爾濱理工大學(xué)學(xué)士學(xué)位論文 8 芯片。在選擇芯片時(shí)考慮到芯 片的資源的可用性以及性價(jià)比，根據(jù) TI公司資料，一款中高檔的數(shù)字信號(hào)處理器 TMS320VC5509可以滿足本課題的要求。 本系統(tǒng)所用 DSP 介紹 DSP芯片選擇原因 該系統(tǒng)選用 DSP設(shè)計(jì)方案。方案確定后，選擇 DSP處理器的型號(hào)是非常重要的一個(gè)環(huán)節(jié)。應(yīng)從芯片的運(yùn)算速度、片上資源、功耗、開發(fā)工具以及價(jià)格封裝等方面來考慮。因此本系統(tǒng)選擇了 TI公司的 TMS320VC5509芯片，主要是基于以下幾個(gè)方面考慮的 [7]。 1． 運(yùn)算速度： TMS320VC5509的指令速度可以達(dá)到 200MIPS，完全可以實(shí)現(xiàn)實(shí)時(shí)處理的要求。 2 ． 片 上硬 件資源 ： TMS320VC5509 片內(nèi) RAM 容 量為 128K16 位。TMS320VC5509片 上 外設(shè)也很豐富，有 一個(gè)看門狗定時(shí)器 、 2個(gè) 20位的定時(shí)器 、 6通道直接存儲(chǔ)器存取控制器（ DMA） 、 外部存儲(chǔ)器接口（ EMIF） 等，可以滿足該系統(tǒng)數(shù)據(jù)傳輸?shù)囊蟆? 3． 接口能力： TMS320VC5509的 McBSP[13]串行口具有靈活的接口能力，可以通過 McBSP串行口與 各種工業(yè)級(jí)串行設(shè)備 實(shí)現(xiàn)無縫連接。 TMS320VC5509的接口能方便地進(jìn)行外圍電路的設(shè)計(jì)，當(dāng)使用低速的片外存儲(chǔ)器時(shí)，可以自動(dòng)插入等待周期，以解決速 度的匹配。 4． 開發(fā)工具： TI公司為用戶提供了方便的開發(fā)系統(tǒng)，如集成開發(fā)環(huán)境 CCS，它支持軟件的仿真，用戶可以在制作目標(biāo)板之前，利用 CCS開發(fā)系統(tǒng)進(jìn)行算法仿真。 TI公司還為用戶提供了硬件平臺(tái)，有各種類型的硬件仿真器，可對(duì)系統(tǒng)進(jìn)行實(shí)時(shí)軟硬件調(diào)試和硬件仿真。 TMS320VC5509 介紹 TMS320VC5509 是 TI公司推出的定點(diǎn)數(shù)字信號(hào)處理器 C55系列中的一種，TMS320VC5509 通過增加累加 MAC單元，增強(qiáng)了 DSP的運(yùn)算能力，而且性能更好，功耗更低，是目前 TMS320 家族中最省電的芯片。該片上的 資源有 16Mbit flash 、 196k*16bit SRAM 、 2500gate CPLD 模版上留有 JTAG插口， 用戶可以通過仿真器和 CCS下載程序進(jìn)行試驗(yàn) 。其低功耗設(shè)計(jì)，比上