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正文內(nèi)容

eda課程設(shè)計(jì)--頻率計(jì)(更新版)

  

【正文】 m:=n。 end js。 end if。 architecture bhv of sz is begin process(clki) variable count:integer range 0 to v。 end process。g2=39。139。 fb0=bi。)then g1=39。039。039。139。 位選程序 u2: library ieee。 nu1:=0。139。 use 。 end ponent。 end ponent。 end ponent。 g1,g2,g3,g4,g5:out std_logic。實(shí)現(xiàn)的功能是:在測(cè)頻控制電路給的 1HZ 的測(cè)頻信號(hào)下,計(jì)數(shù)器對(duì)待測(cè)頻率的周期進(jìn)行計(jì)數(shù),再由鎖存器鎖存,最終通過(guò)外部的數(shù)碼管將待測(cè)頻率的頻率數(shù)值顯示出來(lái)。039。039。EVENT and FX = 39。 輸出信號(hào)用于進(jìn)位 山東建筑大學(xué)信息與電氣工程學(xué)院課程設(shè)計(jì)說(shuō)明書(shū) VIII END ENTITY CNT10。 頂層文件的設(shè)計(jì),結(jié)果如 下圖 所示 圖 3 LIBRARY IEEE。 山東建筑大學(xué)信息與電氣工程學(xué)院課程設(shè)計(jì)說(shuō)明書(shū) VII THEN DOUT = DIN 。 4 位鎖存器 USE 。039。 END PROCESS。 1Hz CNT_EN,RST_CNT,LOAD : OUT STD_LOGIC)。 (2) 模塊圖形符號(hào)及邏輯功能描述如圖 1 所示。139。 ARCHITECTURE behav OF CNT4B IS SIGNAL CQI : STD_LOGIC_VECTOR(3 DOWNTO 0)。 USE 。 FTCTRL 的計(jì)數(shù)使能信號(hào) CNT_EN 能產(chǎn)生一個(gè) 1S 脈寬的周期信號(hào),并對(duì)頻率計(jì)中的 4 位計(jì)數(shù)器 couter4D 的 ENABL 使能端進(jìn)行同步控制。且讀數(shù)大于 9999時(shí),頻率計(jì)處于超量程狀態(tài),發(fā)出溢出指示,下次量程,量程自動(dòng)增大一檔。量程有 1KHz, 1MHz 兩檔,用 LED 燈指示。測(cè)頻控制信號(hào)可以由一個(gè)獨(dú)立的發(fā)生器來(lái)產(chǎn)生。 LIBRARY IEEE。 END CNT4B。 THEN IF ENA = 39。 END behav。 ENTITY TESTCTL IS PORT ( CLKK : IN STD_LOGIC。 END IF。 ELSE RST_CNT = 39。 LIBRARY IEEE。139。同時(shí)將五個(gè)程序分別編譯后生成的 .vhd 文件加載進(jìn)來(lái),然后進(jìn)行編譯,仿真。輸出計(jì)數(shù)結(jié)果 COUT:OUT STD_LOGIC)。 elsif(FX39。 elsif CQI=9 then CQI:=(others =39。 THEN CQI:=(others =39。 十進(jìn)制加法計(jì)數(shù)器的仿真 如下圖所示: 山東建筑大學(xué)信息與電氣工程學(xué)院課程設(shè)計(jì)說(shuō)明書(shū) IX 總結(jié)與致謝 本實(shí)驗(yàn)設(shè)計(jì)的是四位十進(jìn)制頻率計(jì),利用測(cè)頻控制電路、 4 位鎖存器、 4 位計(jì)數(shù)器和十進(jìn)制的計(jì)數(shù)加法器幾個(gè)模塊完成了我所要的設(shè)計(jì)。 k1,k2,k3,k4:in std_logic。 ao,bo,co,do:buffer std_logic)。 clko:buffer std_logic)。 d1,d2,d3,d4:buffer std_logic_vector(3 downto 0))。 分 頻程序 u1: library ieee。event and fb1=39。 if(nu1=50)then co=not co。 end bhv。 architecture bhv of wx is begin 山東建筑大學(xué)信息與電氣工程學(xué)院課程設(shè)計(jì)說(shuō)明書(shū) XIII process(rst,k1,k2,k3,k4,ai,bi,ci,di) begin if(rst=39。g4=39。g2=39。139。039。g3=39。039。 end if。 end sz。 end if。 q:out integer range 0 to 10000)。)then n:=n+1。 if(clk=39。 end bhv。 end bcd。x2:=0。 x4:=zx3*10。
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