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fpga第一章ppt課件(完整版)

2025-06-10 12:14上一頁面

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【正文】 子程序調(diào)用語句 元件例化語句 由一系列并行語句構(gòu) 成的組合體,它的功能是將結(jié)構(gòu)體中的并行語句組成一個或多個子模塊 定義順序語句模塊,用以將從外部獲得的信號值或內(nèi)部運算數(shù)據(jù)向其他的信號進行賦值 將設(shè)計實體內(nèi)的處理結(jié)果向定義的信號或界面端口進行賦值 可以調(diào)用進程或參數(shù),并將獲得的結(jié)果賦值于信號 對其他的設(shè)計實體做元件調(diào)用說明,并將此元件的端口與其他元件、信號或高層實體的界面端口進行連接 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) ( Flash演示) 總目錄 ENTTITY mux2 IS PORT ( d0, d1: IN BIT; sel: IN BIT; s: OUT BIT) ; END mux2; ARCHITECTURE dataflow OF mux2 IS SIGNAL sig: BIT; BEGIN Sig = (d0 AND sel) OR (NOT sel AND d1); S=sig; END dataflow; 例 : 2選 1數(shù)據(jù)選擇器 信號定義語句(內(nèi)部信號,無方向) 功能描述語句 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 ( BLOCK) 在較大規(guī)模的電子系統(tǒng)設(shè)計中,傳統(tǒng)的硬件電路設(shè)計通常包括一張系統(tǒng)總電路原理圖和若干張子原理圖。 END BLOCK B1。 [進程標號 ] PROCESS [( 敏感信號表 ) ] [IS] [進程說明語句 ] BEGIN 順序描述語句 END PROCESS [進程標號 ]; 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 LIBRARY IEEE。 CASE b IS WHEN 00= y =39。 WHEN OTHERS = y =39。 子程序模塊是利用順序語句定義和完成算法的 , 但子程序不能像進程那樣可以從本結(jié)構(gòu)體的其他塊或進程結(jié)構(gòu)中讀取信號值或向信號賦值 , 只能通過子程序調(diào)用與子程序的界面端口進行通信 。 *: 乘, **:乘方 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 ELSE (a (i) /=1) THEN x_flag := TRUE。 PACKAGE bpac IS FUNCTION max (a: STD_LOGIC_VECTOR。 RETURN tmp。 USE語句有以下兩種常用的格式: 第一種語句格式的作用是向本設(shè)計實體開放指定庫中的特定程序包內(nèi)的所選定的項目 。 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 注意:庫說明語句的作用范圍從一個實體說明開始到它所屬的結(jié)構(gòu)體、配置為止,當(dāng)一個源程序中出現(xiàn)兩個以上實體時,兩條作為使用庫的說明語句應(yīng)在每個設(shè)計實體說明語句前重復(fù)書寫。 程序包的一般書寫格式如下: PACKAGE 程序包名 IS END [PACKAGE] 程序包名; —— 程序包首 PACKAGE BODY 程序包名 IS ┇ —— 程序包體 END [PACKAGE BODY] [程序包名 ]; 程序包由兩部分組成:程序包首和程序包體。 RETURN tw16 IS VARIBLE result: tw16。 END LOOP。 FUNCTION sub(a,b:IN tw16)。 分開描述的好處是 : 當(dāng)函數(shù)的功能需要做某些調(diào)整或數(shù)據(jù)賦值需要變化時,只要改變程序包體的相關(guān)語句就可以了,而無需改變程序包首的說明,這樣就使得需要重新編譯的單元數(shù)目盡可能的減少了。 END and2_arc。 END xor2_arc。 END cfg2。 cfg4將與非邏輯結(jié)構(gòu)體配置給實體 cfg5將異或邏輯結(jié)構(gòu)體配置給實體 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 在程序中使用了 5個默認配置語句來指明設(shè)計實體example_v和哪個結(jié)構(gòu)體一起組成一個完整的設(shè)計 ,見程序過程中的標注。 b: IN STD_LOGIC。 USE 。 END or2_cfg。 END xor2_arc。 Co : OUT STD_LOGIC。 b : IN STD_LOGIC。 FOR U1,U2 : xor2_v USE ENTITY ( xor2_arc)。 END structure。 S : OUT STD_LOGIC)。 ARCHITECTURE structure OF add1_v IS BEGIN S = A XOR B XOR Cin。 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 LIBRARY IEEE。 FOR U5 : or2_v USE ENTITY ( or2_arc)。 END COMPONENT。 END add1_v。 END xor2_cfg。 USE 。 b: IN STD_LOGIC。 END and2_v。 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 異或門仿真波形 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 結(jié)構(gòu)體的配置主要是用來對結(jié)構(gòu)體中引用的元件進行配置。 END cfg1。 END nor2_arc。 USE 。 在這兩種描述方式中,常常需要將其他設(shè)計實體作為元件進行引用,這時就需要將不同元件通過配置安裝到不同的設(shè)計實體中。 BEGIN result := vect_to_int (a)+ vect_to_int (b)。 END int_to_tw16。 VARIBLE local: INTEGER。 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 BEGIN FOR i IN 0 TO 7 LOOP result := result*2。 ENTITY and IS ┇ END and; ARCHITECTURE dataflow OF and IS ┇ END dataflow。 ( 1) USE 庫名 .程序包名 .項目名 。 END bpac。 END bpac。 END LOOP。 章目錄 第一節(jié) 第二節(jié) 第三節(jié) 第四節(jié) 第五節(jié) 總目錄 例:用過程語句設(shè)計的子程序 矢量轉(zhuǎn)換成整數(shù) PROCEDURE vector_to_int (a: IN STD_LOGIC_VECTOR。 END CASE。 WHEN 01= y =39。 ENTITY nor2_v2 IS PORT(a,b: IN STD_LOGIC。與 BLOCK語句一樣,利用 PROCESS語句結(jié)構(gòu)可以描述一個功能獨立的電路。 塊、子程序和進程 章目錄
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