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基于verilog的fpga的電子密碼鎖的設計-文庫吧在線文庫

2024-12-22 05:27上一頁面

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【正文】 s ( posedge clk1 ) begin //檢測線路的下降沿 RXBuf0 = zero1。 /*輸入與輸出的聲明部分,其中, clk0 為輸入的時鐘信號, resetb 為密碼舒服的輸入信號,key 為輸入命令, 需注意的時, key 并不是總在表示密碼,也表示密碼的間隔,如當輸入 4 位密碼后需要一個確認“ enter”信號, 當密碼輸入錯誤時,需要取消“ cancel”信號,這些信號之間在設計中通過有限狀態(tài)轉(zhuǎn)換機實現(xiàn)。/////////////duanxuan reg [7:0] seg。//////段選 output [7:0] dig。 五、程序清單 module passwd_lock( clk0, passed, one1, two1, three1, four1, zero1, change, yes, resetb, seg, dig )。b0110,seven=439。其中正確錯誤的狀 態(tài)轉(zhuǎn)換是通過控制相應的標志位實現(xiàn)的。對于寄存器數(shù)量多而邏輯相對缺乏的 FPGA 器件來說,采用一位獨熱編碼可以有效提高電路的速度和可靠性,也有利于提高器件資源的利用率。 根據(jù)輸出信號產(chǎn)生方法的不同,狀態(tài)機可以分成兩類 :Mealy 型和 Moore 型。在輸入密碼的過程中,當用戶鍵鍵盤 按鍵處理 主控部分 譯碼顯示 顯示 開 /關(guān)門電路 報警電路 FPGA 入錯誤密碼時,報警燈 LED D0 燈亮。 通過仿真調(diào)試,利用可編程邏輯器件 FPGA 的電子密碼鎖的設計基本達到了預 期目的。本文介紹的一種基于現(xiàn)場可編輯門陣列 FPGA 器件的電子密碼鎖的設計方法,采用 VHDL 語言對系統(tǒng)進行描述,并在 EP3C10E144C8 上實現(xiàn)。密碼長度為四位,并且固化在鎖內(nèi),輸入正確密碼后,按確認鍵即可開門,本系統(tǒng)設置為 LED D7 燈亮。狀態(tài)機的下一個狀態(tài)及輸出,不僅與輸入信號有關(guān),而且還有寄存器當前所處的狀態(tài)有關(guān)。 采用一位獨熱編碼,雖然多用了觸發(fā)器,當可以有效節(jié)省和簡化組合電路。當次有效狀態(tài)機(即密碼輸入的狀態(tài)機)發(fā)生轉(zhuǎn)換并且有密碼輸入時,程序會記錄下輸入的密碼在寄存器的其中 4 位里面,最后次有效狀態(tài)轉(zhuǎn)換到確認密碼的狀態(tài)時,會將記錄下的密碼與固化在鎖內(nèi)的密碼進行對比,正確即將主狀態(tài)機轉(zhuǎn)換到通過階段,錯誤則將狀態(tài)機轉(zhuǎn)換到報警階段。b0101, six=439。 可以看到,在復位以后,輸入第 1, 2, 3, 4個密碼(依次為 1111)后, passed 變成高電平 當過了一定的時間后, passed 變成低電平,重新計入鍵盤讀入值,進行下一輪的密碼辨別。 //輸出信號 output [7:0] seg。/////////////weixuan reg [3:0] seg0。 reg [7:0] alarmed。 // RXFall1=RXFall。 // RXFall1=RXFall。 // RXFall1=RXFall。 reg [2:0]next_sub_state。 //通過計時寄存器 reg [7:0]pass_count。 end else begin clk1 = 0。 alarm: if(alarm_count[10]==1)// 由 alarm 轉(zhuǎn)換到 waits 的條件 next_state=waits。b00000000。b00000001。 end //鎖 pass 以后計數(shù)開始,當規(guī)定的時間到達后自動上鎖,并進入 waits 狀態(tài) //pass 定時器 always(posedge clk1 or negedge resetb) begin if(!resetb) pass_count=0。 third: next_sub_state=fourth。amp。 else if(!zero||!one||!two||!three||!four) case(sub_state) first: password[15:12]=key。 else if(main_state==pass||main_state==alarm) try_count=0。b0000。change) begin key_pressed_flag=1。 end else if(!fouramp。key=439。amp。b1000。b1010。 end end //////////////yima//////////////選擇哪一個數(shù)碼管來顯示 always (digyi) begin case(digyi) 339。b11111011。 339。b0001 : seg=739。 //3 439。b1111101。b1001 : seg=739。 //7 439。b0101 : seg=739。b1011011。 endcase end ////////////seg yima///////////////////////對密碼進行譯碼顯示 always (seg0) begin case(seg0) 439。 endcase end ///////////////xuanshu////////////////////選 擇每一個數(shù)碼管要顯示的數(shù)為密碼的高到低位 always (digyi) begin case(digyi) 339。b001: dig=839。 en
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