基于matlab的213卷積碼譯碼器的設計與仿真(存儲版)
【正文】 的 設計與仿真 設計目的 本課程設計主要解決對一個卷積碼序列進行維特比 (Viterbi)譯碼輸出 ,并通過 Matlab 軟件進行設計與仿真。維特比算法則對上述概率譯碼做了簡化，以至成為了一 種實用化的概率算法。譯碼輸出信號和信源模塊產(chǎn)生的原始信號輸入到 Error Rate Calculator(誤比特率統(tǒng)計模塊 )中，統(tǒng)計得到的數(shù)據(jù)一方面通過 Display(顯示模塊 )顯示出來，另一方面通過一個 Selector(選擇器 )把其中的第一個元素 (即編碼信號的誤比特率 )保存到工作區(qū)變量 BitErrorRate 中。對所得序列分別截圖，可得如圖 所示結果。 %準備一個空白圖形 for i=1:length(x) %重復運行 ，檢驗不同條件下硬判決譯碼的性能 SNR=x(i)。 心得體會 此課程設 計對整個通信系統(tǒng)包含的編碼、傳輸和譯碼都進行了設計與仿真，從這些過程中我們看到了通信系統(tǒng)的基本工作原理。 %繪制 x和 y的關系曲線圖，縱坐標采用對數(shù)坐標 hold on %保持已經(jīng)繪制的圖形 執(zhí)行此 M 文件，得到如圖 關系曲線圖。 %x 表示信噪比 y=x。整個系統(tǒng)模塊框圖如圖 所示。 信道模塊如下圖 。如果發(fā)送 L組信息比特，那么對于(n,k)卷積碼來說，可能發(fā)送的序列有 2kL個，計算機或譯碼器需存儲這些序列并進行比較，以找到碼距最小的那個序列。本課程設計便是通過 Matlab 設計一個硬判決維特比譯碼輸出的完整電路，并進行誤碼率分 析。卷積碼的譯碼有兩種方法 —— 軟判決和硬判決。它并不是在網(wǎng)格圖上一次比較所有可能的 2kL條路徑 (序列 )，而是接收一
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