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eda技術(shù)第二章fpgacpld結(jié)構(gòu)與應(yīng)用-全文預(yù)覽

  

【正文】 件? Flash型器件 PLD原理1. 電路符號(hào)表示:非門 與門 或門 異或門 PLD原理2. 電路結(jié)構(gòu)表示: PLD原理3. PROM地址譯碼部分PROM存儲(chǔ)單元陣列輸出緩沖部分與陣列固定或陣列可編程包含所有輸入的最小項(xiàng)利用率低 PLD原理4. PLA與陣列可編程或陣列可編程不需要包含輸入變量的每個(gè)最小項(xiàng)需要化簡(jiǎn)成最簡(jiǎn)的與或表達(dá)式算法復(fù)雜,速度下降 PLD原理5. PAL與陣列可編程或陣列固定簡(jiǎn)化了設(shè)計(jì)算法提高了運(yùn)行速度熔絲工藝生產(chǎn),一次編程,修改不方便 PLD原理6. GAL ( General Array Logic)? EEPROM工藝? 或陣列固定? 與陣列可編程? OLMC( Output Logic Macro Cell)? 專用組合輸出、專用輸入、組合輸出雙向口,寄存器輸出、寄存器 I/O等? 結(jié)構(gòu)圖參看 P35,圖 318 CP
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