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習(xí)題3-組合邏輯電路分析與設(shè)計(jì)-數(shù)字電子技術(shù)-含答案(文件)

2025-09-01 11:03 上一頁面

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【正文】（3）函數(shù)真值表如下： [] 試用4選一數(shù)據(jù)選擇器實(shí)現(xiàn)邏輯函數(shù)。設(shè)四個(gè)輸入變量為A、B、C、D，當(dāng)輸入偽碼時(shí)Y1為1，作為告警輸出；當(dāng)輸入大于或等于5時(shí)，Y2為1，作為四舍五入輸出。）解：二進(jìn)制和8421碼和數(shù)如下圖所示：由真值表得邏輯函數(shù)表達(dá)式為：[] 試用ROM實(shí)現(xiàn)8421BCD碼到余3碼的轉(zhuǎn)換。解：ENTITY orgate IS PORT（a，b：IN BIT； y：OUT BIT）； END ENTITY orgate；ARCHITECTURE one OF orgate ISBEGINy=a XOR b；END ARCHITECTURE one；[] 試編寫一個(gè)實(shí)現(xiàn)半加器的VHDL源程序。如果通過修改邏輯設(shè)計(jì)消除冒險(xiǎn)現(xiàn)象，就加上冗余項(xiàng)。解：Y1和Y的波形的波形圖如圖所示：[] ，判斷該電路是否存在冒險(xiǎn)現(xiàn)象，如果存在，請(qǐng)通過修改邏輯設(shè)計(jì)消除冒險(xiǎn)現(xiàn)象。解

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