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習(xí)題3-組合邏輯電路分析與設(shè)計-數(shù)字電子技術(shù)-含答案(文件)

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【正文】（3）函數(shù)真值表如下： [] 試用4選一數(shù)據(jù)選擇器實現(xiàn)邏輯函數(shù)。設(shè)四個輸入變量為A、B、C、D，當(dāng)輸入偽碼時Y1為1，作為告警輸出；當(dāng)輸入大于或等于5時，Y2為1，作為四舍五入輸出。）解：二進制和8421碼和數(shù)如下圖所示：由真值表得邏輯函數(shù)表達式為：[] 試用ROM實現(xiàn)8421BCD碼到余3碼的轉(zhuǎn)換。解：ENTITY orgate IS PORT（a，b：IN BIT； y：OUT BIT）； END ENTITY orgate；ARCHITECTURE one OF orgate ISBEGINy=a XOR b；END ARCHITECTURE one；[] 試編寫一個實現(xiàn)半加器的VHDL源程序。如果通過修改邏輯設(shè)計消除冒險現(xiàn)象，就加上冗余項。解：Y1和Y的波形的波形圖如圖所示：[] ，判斷該電路是否存在冒險現(xiàn)象，如果存在，請通過修改邏輯設(shè)計消除冒險現(xiàn)象。解

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