dsp課件第二章tms320lf240x硬件結構(已修改)
2025-03-05 13:32 本頁面
【正文】 第 2章 TMS320LF240x硬件結構 CPU ? 先進的多總線結構。 ? 32位中央算術邏輯運算單元（ CALU） 。 ? 16位 16位的硬件乘法器（ MUL）。 ? 32位累加器（ ACC） 。 ? 輸入與輸出定標寄存器。 ? 乘積定標移位器。 ? 64 K字程序存儲器 、 64 K字數(shù)據(jù)存儲器以及 64 K字 I/O空間 。 存儲器 指令系統(tǒng) ? 累加器 、 算術和邏輯運算指令 。 ? 輔助寄存器和數(shù)據(jù)頁面指針指令 。 ? TREG、 PREG和乘法指令 。 ? 轉移指令 。 ? 控制指令 。 ? I/O和存儲器操作指令 。 片內外設 ? 看門狗 （ WD） 定時器模塊 。 ? 數(shù)字輸入輸出 （ I/O） 模塊 。 ? 事件管理器 （ EV） 模塊 。 ? 模數(shù)轉換器 （ ADC） 模塊 。 ? 串行通訊接口 （ SCI） 模塊 。 ? 串行外設接口 （ SPI） 模塊 。 ? CAN控制器模塊 。 ? 采用高性能靜態(tài) CMOS技術 ， 供電電壓為 。 ? 可用 IDLE指令進入低功耗模式 。 電源 ? 具有符合 （ JTAG） 。 在片仿真接口 速度 ?單周期定點指令的執(zhí)行時間為 50ns、 35ns或 25ns(20MIPS，或 40MIPS)。 TMS320LF240x的總線結構 ? PAB — 程序地址總線：提供訪問程序存儲區(qū)的地址。 ? DRAB — 數(shù)據(jù)讀地址總線：提供從數(shù)據(jù)存儲器讀取數(shù)據(jù)的地 址。 ? DWAB — 數(shù)據(jù)寫地址總線：提供寫數(shù)據(jù)存儲器的地址。 ? PRDB — 程序讀總線：它載有從程序存儲器讀取的指令代碼 及表格信息等，并送到 CPU。 ? DRDB — 數(shù)據(jù)讀總線：它將數(shù)據(jù)從數(shù)據(jù)存儲器載送到中央算 術邏輯單元（ CALU）和輔助寄存器單元（ ARAU）。 ? DWEB — 數(shù)據(jù)寫總線：它將數(shù)據(jù)送至程序存儲器和數(shù)據(jù)存儲 器。 ? 采用各自獨立的數(shù)據(jù)地址總線分別用于數(shù)據(jù)讀 DBAB和數(shù)據(jù)寫 DWAB，因此， CPU的讀寫可在一個周期內進行。 ? 獨立的程序空間和數(shù)據(jù)空間允許 CPU同時訪問指令和數(shù)據(jù)。 總線結構特點 TMS320LF240x系列芯片是 16位定點 DSP，采用哈佛結構，其程序和數(shù)據(jù)存儲器分別獨立且有各自的總線結構。芯片內部由 3部分組成：中央處理單元（ CPU）、存儲器及片內外設。 CPU的基本組成包括： 32位中央算術邏輯運算單元（ CALU） ； 32位累加器（ ACC） ；輸入與輸出數(shù)據(jù)比例移位器； 16位 16位的乘法器（ MUL）以及乘積比例移位器。 中央處理單元（ CPU） CPU功能結構圖 ? 功能：將來自存儲器的 16位數(shù)據(jù)左移 0~16位送往中央算術邏輯單元（ CALU）。 ?
教學課件相關推薦
鄂ICP備17016276號-1