vhdl實驗半加器等等指導書-文庫吧
2025-05-08 18:08 本頁面
【正文】 1 三八譯碼器真值表譯碼器不需要像編碼器那樣用一個輸出端指示輸出是否有效。但可以在輸入中加入一個輸出使能端，用來指示是否將當前的輸入進行有效的譯碼，當使能端指示輸入信號無效或不用對當前信號進行譯碼時，輸出端全為高電平，表示無任何信號。本例設(shè)計中沒有考慮使能輸入端，自己設(shè)計時可以考慮加入使能輸入端時，程序如何設(shè)計。三、 實驗內(nèi)容 在本實驗中，用三個撥動開關(guān)來表示三八譯碼器的三個輸入（A、B、C）；用八個LED來表示三八譯碼器的八個輸出（D0D7）。通過輸入不同的值來觀察輸入的結(jié)果與三八譯碼器的真值表（表11）是否一致。實驗箱中的撥動開關(guān)與FPGA的接口電路如下圖11所示，當開關(guān)閉合（撥動開關(guān)的檔位在下方）時其輸出為低電平，反之輸出高電平。其電路與FPGA的管腳連接如表12所示撥動開關(guān)的輸出圖11 撥動開關(guān)與FPGA接口電路信號名稱對應(yīng)FPGA（EP2C35）管腳名信號說明K1E15從K1輸出到FPGA的E15K2B14從K2輸出到FPGA的B14K3F9從K3輸出到FPGA的F9K4B15從K4輸出到FPGA的B15K5A15從K5輸出到FPGA的A15K6F11從K6輸出到FPGA的F11K7A16從K7輸出到FPGA的A16K8F13從K8輸出到FPGA的F13K9F14從K8輸出到FPGA的F14K10A17從K8輸出到FPGA的A17K11H7從K8輸出到FPGA的H7K12A18從K8輸出到FPGA的A18表12 撥動開關(guān)與FPGA管腳連接表當FPGA與其對應(yīng)的端口為高電平時LED就會發(fā)光，反之LED燈滅。其與FPGA對應(yīng)的管腳連接如表13所示。 信號名稱對應(yīng)FPGA（EP1C12）管腳名說明D1E9從FPGA的E9輸出至D1D2A11從FPGA的A11輸出至D2D3E11從FPGA的E11輸出至D3D4B13從FPGA的B13輸出至D4D5E14從FPGA的E14輸出至D5D6A13從FPGA的A13輸出至D6D7L7從FPGA的L7輸出至D7D8B19從FPGA的B19輸出至D8D9M8從FPGA的M8輸出至D9D10A19從FPGA的A19輸出至D10D11M7從FPGA的M7輸出至D11D12B20從FPGA的B20輸出至D12表13 LED燈與FPGA管腳連接表四、 實驗步驟下面將通過這個實驗，向讀者介紹QUARTUSII的項目文件的生成、編譯、管腳分配以及時序仿真等的操作過程。建立工程文件1)選擇開始程序Altera，運行QUARTUSII軟件。2)選擇軟件中的菜單FileNew Project Wizard，新建一個工程。3）點擊圖14中的NEXT進入工作目錄，工程名的設(shè)定對話框。第一個輸入框為工程目錄輸入框，用戶可以輸入如e:/eda等工作路徑來設(shè)定工程的目錄，設(shè)定好后，所有的生成文件將放入這個工作目錄。第二個輸入框為工程名稱輸入框，第三個輸入框為頂層實體名稱輸入框。用戶可以設(shè)定如EXP1，一般情況下工程名稱與實體名稱相同。使用者也可以根據(jù)自已的實際情況來設(shè)定。4）點擊NEXT，進入下一個設(shè)定對話框，按默認選項直接點擊NEXT進行器件選擇對話框。這里我們以選用Cyclone系列芯片EP2C35F484C8為例進行介紹。用戶可以根據(jù)使用的不同芯片來進行設(shè)定，其方法基本一致。 首先在對話框的左上方的Family下拉菜單中選取Cyclone，在中間右邊的Speed grade下拉菜單中選取8，在左下方的Available devices框中選取EP1C12F324C8，點擊NEXT完成器件的選取，進入EDA TOOL設(shè)定界面。5）按默認選項，點擊NEXT出現(xiàn)新建工程以前所有的設(shè)定信息，點擊FINISH完成新建工程的建立。建立圖形設(shè)計文件 1）在創(chuàng)建好設(shè)計工程后，選擇FileNEW…菜單，出現(xiàn)新建設(shè)計文件類型選擇窗口。這里我們以建立圖形設(shè)計文件為例進行說明，其它設(shè)計輸入方法與之基本相同。2）在New對話框中選擇Device Design Files頁下的Block Diagram/Schematic File，點擊OK按鈕，打開圖形編輯器對話框。圖中標明了常用的每個按鈕的功能。QUARTUSII圖形編輯器也稱塊編輯器（Block Editor），用于以原理圖（Sche
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