ch8模擬量的輸入輸出-文庫吧
2025-07-29 14:58 本頁面
【正文】 ，它只用兩種阻值的電阻 (R和 2R)。 R2R梯形電阻網(wǎng)絡 RfViV0…Vr e fn 12 1 0?2 R 2 R 2 R2 RR RRVn 1V2V1V02 R+D/A轉(zhuǎn)換器的主要技術(shù)指標 ? 分辨率（ Resolution） ? 輸入的二進制數(shù)每 177。 1個最低有效位 (LSB)使輸出變化的程度。 ? 一般用輸入數(shù)字量的位數(shù)來表示 : 如 8位、 10位 例：一個滿量程為 5V的 10位 DAC， 177。 1 LSB的變化將使輸出變化 5/(2101)=5/1023== ? 轉(zhuǎn)換精度（誤差） ? 實際輸出值與理論值之間的最大偏差。 ? 一般用最小量化階 ⊿ 來度量，如 177。 1/2 LSB 也可用滿量程的百分比來度量，如 % FSR LSB: Least Significant Bit FSR: Full Scale Range) ? 轉(zhuǎn)換時間 ? 從開始轉(zhuǎn)換到與滿量程值相差 177。 1/2 LSB所對應的模擬量所需要的時間 t V 1/2 LSB tC VFULL 0 典型 D/A轉(zhuǎn)換器 ? DAC0832 ? 特性： ? 8位電流輸出型 D/A轉(zhuǎn)換器 ? T型電阻網(wǎng)絡 ? 差動輸出 ? 引線圖見教材 p351 DAC0832內(nèi)部結(jié)構(gòu) 輸 入 數(shù) 據(jù)～4 7～1 3 1 61 9121 81 7X F E RW R 2W R 1C SI L E＆ ≥ 1≥ 1L E 1L E 2R f b8 位輸 入寄 存器8 位D A C寄 存器8 位D / A轉(zhuǎn) 換器 VR E FI O U T 2I O U T 1R f bA G N D ( 模 擬 地 )V C C ( + 5 V 或 + 1 5 V ）2 01 0391 11 28 D A C 0 8 3 2 框 圖D G N D （ 數(shù) 字 地 ）D 0 D 7～～引腳功能 ? D7～ D0：輸入數(shù)據(jù)線 ? ILE：輸入鎖存允許 ? CS：片選信號 用于把數(shù)據(jù)寫入到輸入鎖存器 ? WR1：寫輸入鎖存器 ? WR2：寫 DAC寄存器 ? XFER：允許輸入鎖存器的數(shù)據(jù)傳送到 DAC寄存器 上述二個信號用于啟動轉(zhuǎn)換 ? VREF：參考電壓， 10V～ +10V，一般為 +5V或 +10V ? IOUT IOUT2： D/A轉(zhuǎn)換差動電流輸出，接運放的輸入 ? Rfb：內(nèi)部反饋電阻引腳，接運放輸出 ? AGND、 DGND：模擬地和數(shù)字地 工作時序 ? D/A轉(zhuǎn)換可分為兩個階段： ? CS=0、 WR1=0、 ILE=1，使輸入數(shù)據(jù)鎖存到輸入寄存器； ? WR2=0、 XFER=0，數(shù)據(jù)傳送到 DAC寄存器，并開始轉(zhuǎn)換。 D 0 D 7～ C SW R 1I L E（ 高 電 平 ）W R 2X F E R（ 模 擬 輸 出 電 流 變 化 ）寫輸入寄存器 寫 DAC寄存器 工作方式 ? 單緩沖方式 ? 使輸入鎖存器或 DAC寄存器二者之一處于直通 。 CPU只需一次寫入即開始轉(zhuǎn)換?？刂票容^簡單。見教材 p352圖。 ? 雙緩沖方式（標準方式） ? 轉(zhuǎn)換要有兩個步驟： ? 將數(shù)據(jù)寫入輸入寄存器 ? CS=0、 WR1=0、 ILE=1 ? 將輸入寄存器的內(nèi)容寫入 DAC寄存器 ? WR2=0、 XFER=0 ? 優(yōu)點：數(shù)據(jù)接收與 D/A轉(zhuǎn)換可異步進行； 可實現(xiàn)多個 DAC同步轉(zhuǎn)換輸出 ——分時寫入 、 同步轉(zhuǎn)換 ? 直通方式 ? 使內(nèi)部的兩個寄存器都處于直通狀態(tài)。模擬輸出始終跟隨輸入變化。 ? 不能直接與數(shù)據(jù)總線連接 ，需外加并行接口 (如 74LS37 8255等 )。 雙緩沖方式 —— 同步轉(zhuǎn)換舉例 A10A0 譯碼器 08321 08322 port1 port2 port3 雙緩沖方式的程序段示例 本例中三個端口地址的用途： port1 選擇 08321的輸入寄存器 port2 選擇 08322的輸入寄存器 port3 選擇 08321和 08322的 DAC寄存器 MOV AL， data 。 要轉(zhuǎn)換的數(shù)據(jù)送 AL MOV DX，
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