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vhdl文本輸入設(shè)計(jì)流程-展示頁(yè)

2025-02-22 01:31本頁(yè)面
  

【正文】 腳名 按鍵 “ ADD”即可 注意引腳屬性 錯(cuò)誤引腳名將 無正確屬性! 再編譯一次, 將引腳信息 進(jìn)去 選擇編程器, 準(zhǔn)備將設(shè)計(jì) 好的半加器 文件下載到目 器件中去 編程窗 在編程窗打開 的情況下選擇 下載方式設(shè)置 選擇此項(xiàng)下 載方式 下載(配置) 成功! 5 硬件測(cè)試 選擇電路 模式為“ 6” 模式選擇鍵 “ s”為高’ 電平 注意時(shí)鐘 頻率選擇 CLOCK5: a 頻率選擇 1024Hz CLOCK0: b 頻率選擇 256Hz 演講完畢,謝謝觀看! 。STEP1: 建立 工作庫(kù)文件夾 STEP2: 輸入設(shè)計(jì)項(xiàng)目 原理圖 /VHDL文本代碼 STEP3: 存盤,注意 原理圖 /文本取名 STEP4: 將設(shè)計(jì)項(xiàng) 目設(shè)置成 Project STEP5: 選 擇目標(biāo)器件 STEP11: 硬件測(cè)試 STEP9: 引腳 鎖定并編譯 STEP8: 仿真測(cè) 試和波形分析 STEP7: 建立仿 真波形
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