章觸發(fā)器及時(shí)序邏輯電路電子技術(shù)習(xí)題及解答沈陽(yáng)工業(yè)大學(xué)-展示頁(yè)
2024-10-15 15:07本頁(yè)面
【正文】 相加，試分析 其工作過(guò)程。所求波形如圖 142所示。 YC的波形由 Q3A與 Q3B相“與”后決定。 解 移位寄存器 B的 Q3B接 DOB，數(shù)碼在 CP 作用下不斷地循環(huán)， Q3B的狀態(tài)依次為 101110111…. 。 第十二章 觸發(fā)器及時(shí) 序邏輯電路 例題及選擇題 制作人：龔淑秋 例 141 圖 141是由兩個(gè) 4位左移位寄存器 A、 B（均由維持阻塞 D觸發(fā)器組成）、“與門(mén)” C和 JK觸發(fā)器 FD組成。 A寄存器的初始狀態(tài)為 Q3Q2Q1Q0=1010， B寄存器的初始狀態(tài)為 Q3Q2Q1Q0=1011， FD的初態(tài) QD=0，試畫(huà)出 在 CP作用下圖中 Q3A、 Q3B、 YC、 QD的波形。移位寄存器 A的輸入狀態(tài) DOA= Q3A Q3B， 根據(jù)給定的初態(tài)值，在CP的作用下， Q3A的狀態(tài)依次是 101010101… 。觸發(fā)器 FD是下降沿觸發(fā)的 JK觸發(fā)器， QD的波形將隨 YC的狀態(tài)變化，并滯后 YC的波形半個(gè) CP周期。 QD FD K J YC 7 amp。 amp。 amp。 amp。 amp。 amp。 amp。 amp。 2）令 SRG4（ 1）、 SRG4（ 2）處于并行輸入狀態(tài) 即 S1= S2 =1，利用送數(shù)脈沖將加數(shù) A3 A2 A1 A0 和被加數(shù) B3 B2 B1 B0分別送入相應(yīng)的寄存器中。 4）每次相加結(jié)果，本位和 SI存入寄存器 SRG4（ 3 ） 中，進(jìn)位位存入進(jìn)位觸發(fā)器 C中，供下一位相加時(shí) 使用。需注意的是 ，計(jì)算結(jié)果的最 高位由進(jìn)位觸發(fā)器 C的輸出端 Q取出。其邏輯符號(hào)如圖 144a所示。 解：首先要把 D， JK觸發(fā)器連成計(jì)數(shù)形式的 T`觸發(fā)器 ,即Qn+1=D=Qn；而 J=K=1。再次，置 “ 0”端，有圓圈平時(shí)接高電平 “ 1”，無(wú)圓圈的應(yīng)該低電平 “ 0”才能正常工作。 Q4 Rd Rd Q1 Q2 Q3 Rd Rd Rd Rd Rd Q Q Q Q Q K J J K Q Q Q Q Q K D D a) Q b) D F1 F2 F3 Fd J CP 1 1 1 1 圖 144 例 143圖 例 144 分析圖 145電路實(shí)現(xiàn)何種邏輯功能，其 中 X是控制端，對(duì) X=0和 X=1分別分析，假定 初始狀態(tài)為 Q2=1， Q1=1。 2）驅(qū)動(dòng)方程為： J1 =X + Q2 K1 =1 ； J2 =X + Q1 K2 =1 3）列狀態(tài)轉(zhuǎn)換表如表 141所示。無(wú)效狀態(tài) Q2 Q1 =11在上述兩種情況下只需一個(gè) CP就進(jìn)入有效狀態(tài)，因而能自啟動(dòng)。 CP X 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 2 2 1 3 1 4 1 1 1 1 3 4 Q1 Q2 J1 =X + Q2 J2 =X + Q1 K2 =1 K1 =1 解 1） 由表 142可見(jiàn)， CC40161（ CC40160）的 Cr可直接進(jìn)行復(fù)位操作， 與 CP信號(hào)無(wú)關(guān)，這與教材上介紹的 T1161 （ T416 CC4016 CC40 163）需在 CP控制下復(fù)位，即同步復(fù)位有所不同（其他功能相同）。采 用同樣的方法可構(gòu)成十、十二進(jìn)制計(jì)數(shù)器，只要將與非門(mén)的輸入端分別 接至 12所對(duì)應(yīng)的狀態(tài)輸出端即可。 2）用低位（片 1）的進(jìn)位輸出端 C1連接高位（片 2）的使能端 EP ET2， 兩片的 CP共同。兩個(gè) 4位二進(jìn)制計(jì)數(shù)器級(jí)聯(lián)構(gòu)成的 8位二進(jìn)制計(jì) 數(shù)器如圖 146所示。將兩個(gè)芯片的進(jìn)位輸 出端通過(guò)一個(gè)與與非門(mén)產(chǎn)生 LD所需的置數(shù)脈沖，預(yù)置數(shù) N=256183=73，將 73 所對(duì)應(yīng)的輸入信號(hào)端接高電平 1，其余輸入端接低電平 0，即將 1A（ 2O）、 1D （ 23 ）、 2C（ 26）接高電平，其余接地，如圖 147所示。其功能表如下：
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