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基于vhdl的八路搶答器設(shè)計--eda課程設(shè)計-文庫吧資料

2025-06-11 09:16本頁面
  

【正文】 ,輸出給數(shù)碼管。同時, 門 G1 處 于關(guān)門狀態(tài),封鎖 CP 信號,使定時電路保持00 狀態(tài)不變,從而實現(xiàn)功能 ③ 的要求。當(dāng)選手在定時時間內(nèi)按動搶答鍵時, 1Q= 1,經(jīng) G3 反相, A= 0,封鎖 CP信號,定時器處于保持工作狀態(tài);同時,門 G2的輸出 ST =1,74LS148 處于禁止工作狀態(tài),從而實現(xiàn)功能 ② 的要求。圖 43 的工作原理是:主持人控制開關(guān)從 清除 位置撥到 開始 位置時,來自于圖 41 中的 74LS279 的輸出 1Q=0,經(jīng) G3反相 , A= 1,則時鐘信號 CP能夠加到 74LS192 的 CPD 時鐘輸入端,定時電路進行遞減計時。 根據(jù)上面的功能要求,設(shè)計的時序控制電路如圖 54所示。 ② 當(dāng)參賽選手按動搶答鍵時,揚聲器發(fā)聲,搶答電路和定時電路停止工作。 PR 為控制信號,當(dāng) PR 為高電平時,多諧振蕩器工作,反之,電路停振。 11 圖 52 第三節(jié) 搶答器設(shè)計中的報警電路 由 555 定時器和三極管構(gòu)成的報警電路如圖 53 所示。該電路簡單,無需用到晶振,芯片都是市場上容易購得的??深A(yù)置時間的電路選用十進制同步加減計數(shù)器 74LS192 進行設(shè)計,具體電路如圖 52 所示 。( LS148 為8線-3線優(yōu)先編碼器 。當(dāng)按鍵松開即按下時, 74LS148 的 ,1?EXY 此時由于仍為 1Q=1,使 ST =1,所以 74LS148 仍處于禁止?fàn)顟B(tài),確保不會出二次按鍵時輸入信號,保證了搶答者的優(yōu)先性。當(dāng)開關(guān)S置于 “ 開始 ” 時,搶答器處 ,010012 ?YYY ,0?EXY 經(jīng) RS 鎖存后, 1Q=1,BI =1, 74LS48 處于工作狀態(tài), 4Q3Q2Q=101,經(jīng)譯碼顯示為 “5” 。該電路完成兩個功能:一是分辨出選手按鍵的先后,并鎖存優(yōu)先搶答者的編號,同時譯碼顯示電路顯示編號;二是禁止其他選手按鍵操作無效?,F(xiàn)簡單介紹搶答器設(shè)計中的搶答電路、定時電路、報警電路、時序控制電路、顯示及譯碼電路 。優(yōu)先編碼電路、鎖存器、譯碼電路將參賽隊的輸入信號在顯示器上輸出;用控制電路和主持人開關(guān)啟動報警電路,以上兩部分組成主體電路。( 74LS148 為 8 線- 3 線優(yōu)先編碼器,表 1 為其真值表,圖 3為邏輯圖; 74LS279 為四個 /R- /S 鎖存器,表 2為其真值表,圖 4 為邏輯圖。同時 1Q=1,使74LS148 的 =1, 74LS148 處于禁止?fàn)顟B(tài),從而封鎖了其他按鍵的輸入。 當(dāng)系統(tǒng)清除按鍵松開時,搶答器處于等待狀態(tài)。 1Q 為 0,使 74LS148的使能端 =0, 74LS148 處于允許編碼狀態(tài),同時 1Q 為 0,使 74LS48 的滅燈輸入端 =0,數(shù)碼管無顯示。該電路主要完成兩個功能:一是分辨出選手按鍵的先后,并鎖存優(yōu)先搶答者的編號;二是禁止其他選手按鍵,其按鍵操作無效。 圖 41 第二節(jié) 優(yōu)先判斷與編號鎖存電路 優(yōu)先判斷與編號鎖存電路如圖 42 所示。當(dāng)一輪搶答之后,優(yōu)先搶答選手的編號一直保持到主持人將系統(tǒng)清除為止。接通電源后,后臺工作人員將檢測開關(guān) S置“檢測”狀態(tài),數(shù)碼管在正常清除下,顯示“ ”;當(dāng)后臺工作人員將檢測開關(guān) S 置“搶答”狀態(tài),主持按系統(tǒng)清除按鍵,搶答器處于禁止?fàn)顟B(tài),編號顯示器滅燈;主持人松開,宣布“開始”,搶答器工作。搶答器的工作流程分為、系統(tǒng)復(fù)位、正常流程、犯規(guī)流程等幾部分,如圖 22所示。 圖 21 搶答器結(jié)構(gòu)框圖 4 第三節(jié) 搶答器的工作流程 圖 22 搶答器的基本工作原理 :在搶答競賽或呼叫時,有多個信號同時或不加載程序 運 行 行 開始 開始數(shù)碼管顯 示 FFF 開始搶 按時間倒計時 開始前有選手搶按 顯示犯規(guī)選手號碼并伴有語音報警 倒計時結(jié) 束,超時 有選手 搶按 顯示FFF 顯示選手號碼,倒計 時時間 ,語音報警,答 題 ,答題時間倒計時 正常流程 犯規(guī)流程 若超過答題 時間,則數(shù) 碼管顯示FFF 答題完畢 根據(jù)選手表現(xiàn),規(guī) 則由主持人減 分 5 同時送入主電路中,搶答器內(nèi)部的寄存器工作,并識別、記錄第一個號碼,同時內(nèi)部的定時器開始工作,記錄有關(guān)時間并產(chǎn)生超時信號。當(dāng)一輪搶答之后,定時器停止、禁止二次搶答、定時器顯示剩余時間。定時器倒計時,揚聲器給出聲響提示。擴展電路完成檢測數(shù)碼管工作情況。 第二節(jié) 搶答器的工作原理簡介 如圖 21 所示為搶答器的結(jié)構(gòu)框圖,它由主體電路和擴展電路兩部分組成。 擴展功能:該電路具有犯規(guī)報警功能。即選手 按動按鈕,鎖存相應(yīng)的編號,揚聲器發(fā)出聲響提示,數(shù)碼顯示選手號碼。設(shè)置一個系統(tǒng)清除和搶答控制開關(guān) Reset, 該開關(guān)由主持人控制。其中一人先按下?lián)尨疰I,蜂鳴器發(fā)出鳴叫,數(shù)碼顯示該人號碼,其他人再按鍵,系統(tǒng)不再響應(yīng),直至主持人按鍵清零,下一次搶答開始。 8路搶答器控制系統(tǒng)是娛樂活動中經(jīng)常使用的重要基礎(chǔ)設(shè)備之一,根據(jù)搶答要 求,系統(tǒng)所需實現(xiàn)的功能如下: ( 1)主持人按鍵清零,數(shù)碼顯示 0,蜂鳴器不叫,進入搶答狀態(tài)。搶答器要求有八路搶答輸入,搶答邏輯設(shè)計合理(具有搶答鎖定),搶答編號顯示,搶答成功指示,搶答完成后狀態(tài)復(fù)位。根據(jù)給定題目設(shè)計數(shù)字電路,來加深對可編程邏輯器件的理解和掌握。學(xué)習(xí)集成開發(fā)軟件 MAX+plus II/Quartus II 的使用及設(shè)計過程。目前 EDA 技術(shù)已在各大公司、企事業(yè)單位和科研教學(xué)部門廣泛使用。 現(xiàn)在對 EDA 的概念或范疇用得很寬。 EDA 技術(shù)的出現(xiàn),極大地提高了電路設(shè)計的效率和可操作性,減輕了設(shè)計者的勞動強度。這一切極大地改變了傳統(tǒng)的數(shù)字系統(tǒng)設(shè)計方法、設(shè)計過程和設(shè)計觀念,促進了 EDA 技術(shù)的迅速發(fā)展。在電子技術(shù)設(shè)計領(lǐng)域,可編程邏輯器件(如CPLD、 FPGA)的應(yīng)用,已得到廣泛的普及,這些器件為數(shù)字系統(tǒng)的設(shè)計帶來了極大的靈活性。 1 第一章 EDA 技術(shù)簡介 EDA 在通信行業(yè)(電信)里的另一個解釋是企業(yè)數(shù)據(jù)架構(gòu),
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