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數(shù)字邏輯電路教程ppt第2章4mos邏輯門-wenkub.com

2024-10-02 18:05 本頁面
   

【正文】 ? 由 TTL門組成上面邏輯門由于 10kΩ大于開門電阻 RON, 所以 , 無論 A、 B為何值 0?F[例 ]試分別寫出由 TTL門和 CMOS門構成的邏輯圖的表達式或邏輯值。 ? 使用 CMOS和 TTL時 , 不用的輸入端都不得懸空 。 ? 另外 , 高速 CMOS電路使用 5V電源 , 邏輯電平與 TTL電平兼容 。 ? 扇出系數(shù)大只表明帶同類門的個數(shù)多 ,而不一定表明輸出電流大 。 集成 TTL和 CMOS門的結構和特點 ? CMOS門的輸出高電平電流和輸出低電平電流相等; ? 而 TTL門的輸出高電平電流遠小于輸出低電平電流 , 而且 CMOS門輸出低電平電流遠小于 TTL門的輸出低電平電流 。 集成 TTL和 CMOS門的結構和特點 ? CMOS門的功耗較 TTL門的功耗小很多 。 集成 TTL和 CMOS門的結構和特點 ? CMOS門的輸入電流遠小于 TTL門的輸入電流 。 ? TTL門輸出為低電平時 , 輸出級的 T5管處干飽和導通狀態(tài) , 輸出電阻很小 (約在10Ω以內(nèi) )。當有發(fā)射極電流從發(fā)射極流出 , 并通過接在TTL門輸入端的電阻 RI到地時 , 就會在 RI上產(chǎn)生壓降 , 即在 TTL門輸入端加上了電壓 。 集成 TTL和 CMOS門的結構和特點 ? 而 CMOS門的輸入端為 NMOS管和 PMOS管的柵極 (接在一起 ), 當 CMOS門的輸入端懸空時 , 不可能在柵一源之間加上電壓 , 當然 MOS管就不會導通 , 故不能認為 CMOS門輸入端懸空邏輯上為 l。 ? 在使用邏輯門時 , 必須考慮它們的特點 。 ? 除 CMOS之外 , MOS電路還有 NMOS和PMOS兩種電路 。 ? ECL的工作速度最快 , 但抗干擾能力差 ,多用于超高速電路中 。 ? CMOS非門由一個 NMOS管和一個 PMOS管構成 。 ? TTL門和 CMOS門都有多種系列 。 ? 對于與、與非、與或非中的與,根據(jù) A與 1為 A,A與 A為 A,可以將多余輸入端通過電阻接電源,或與有用輸入端并接。 ?故電路實現(xiàn)了 非邏輯功能 。 TG F A 圖 238 例圖 200kΩ VDD ? 解: 由模擬開關的功能知:當 A=1時 ,開關接通 。 ? 由此可見, CMOS傳輸門的導通和截止取決于控制端所加的電平。 VDD vI/vO vO/vI TP TN C C (a) 邏輯電路 TG vI/vO vO/vI C C (b)邏輯符號 圖 236 傳輸門 VDD vI/vO vO/vI TP TN C C (a) 邏輯電路 工作條件 設 NMOS管 TN和 PMOS管 TP的開啟電壓絕對值均為 3V,輸入信號電壓的變化范圍在 0~10V之間,加在兩管柵極上的控制信號的高、低電平分別為 10V和0V CC( C=10V, =0V或 C=0V, =10V)。 它是利用結構上完全對稱的 NMOS管和 PMOS管,按閉環(huán)互補形式連接而成的一種 雙向傳輸開關 。 A是輸入端 , E是控制端 , F是輸出端 。 圖中兩個PMOS負載管 T1和 T2串聯(lián),兩個 NMOS工作管 T3和 T4并聯(lián)。 圖中兩個串聯(lián)的NMOS管 T1和 T2為工作管,兩個并聯(lián)的 PMOS管T3和 T4為負載管。 原因 :由于 CMOS反相器的工作管和負載管不同時導通 , 因此其輸出電壓不取決于兩管的導通電阻之比 。 VDD T2(P) T1(N) vO F vI A S S G G D D 圖 232 CMOS反相器 vI輸入高電平時 ? 由于 T2的截止時相當于一個大電阻 , T1的導通電阻相當于一個較小的電阻 , 所以電源電壓幾乎全部降落在負載管T2上 , 使反相器輸出低電平且很低 , VOL≈0V。 但對于 PMOS負載管,由于柵極電位較低,使柵源電壓絕對值大于開啟電壓的絕對值 |VT2|,因此 T2充分導通 。 電路組成 如圖 232為 CMOS反相器電路 , 是由互補的增強型 NMOS管 T1和 PMOS管 T2串聯(lián)組成的 。 VDD T3 T1 F A T2 B T5 T4 F1 工作原理 ? 當 A、 B都為高電平或都為低電平時 , TT2都截止 , F1為高電平 , F為低電平; VDD T3 T1 F A T2 B T5 T4 F1 工作原理 ? 當 A、 B中有一個為高電平而另一個為低電平時 , T1和 T2中必有一個管導通 , 致使 F1為低電平 , F為高電平 。 VDD T3 T2 F A 圖 2
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