【文章內(nèi)容簡介】 ，SMI復(fù)位Busy bit，然后用從PHY中讀到的數(shù)據(jù)來更新MII數(shù)據(jù)寄存器。 SMI讀操作 STM32串口通訊STM32的串口是相當(dāng)豐富的，功能也很強勁。最多可提供5路串口（MiniSTM32使用的是STM32F103RBT6，具有3個串口），有分數(shù)波特率發(fā)生器、支持單線光通信和半雙工單線通訊、支持LIN、智能卡協(xié)議和IrDASIR ENDEC規(guī)范（僅串口3支持）、具有DMA等。 485電路 串口最基本的設(shè)置，就是波特率的設(shè)置。STM32的串口使用起來還是蠻簡單的，只要你開啟了串口時鐘，并設(shè)置相應(yīng)IO口的模式，然后配置一下波特率，數(shù)據(jù)位長度，奇偶校驗位等信息，就可以使用了。下面，我們就簡單介紹下這幾個與串口基本配置直接相關(guān)的寄存器。 1，串口時鐘使能。串口作為STM32的一個外設(shè)，其時鐘由外設(shè)時鐘使能寄存器控制，這里我們使用的串口1是在APB2ENR寄存器的第14位。APB2ENR寄存器在之前已經(jīng)介紹過了，這里不再介紹。只是說明一點，就是除了串口1的時鐘使能在APB2ENR寄存器，其他串口的時鐘使能位都在APB1ENR。 2，串口復(fù)位。當(dāng)外設(shè)出現(xiàn)異常的時候可以通過復(fù)位寄存器里面的對應(yīng)位設(shè)置，實現(xiàn)該外設(shè)的復(fù)位，然后重新配置這個外設(shè)達到讓其重新工作的目的。一般在系統(tǒng)剛開始配置外設(shè)的時候，都會先執(zhí)行復(fù)位該外設(shè)的操作。串口1的復(fù)位是通過配置APB2RSTR寄存器的第14位來實現(xiàn)的。APB2RSTR寄存器的各位描述如下：從上圖可知串口1的復(fù)位設(shè)置位在APB2RSTR的第14位。通過向該位寫1復(fù)位串口1，寫0結(jié)束復(fù)位。其他串口的復(fù)位位在APB1RSTR里面。 3，串口波特率設(shè)置。每個串口都有一個自己獨立的波特率寄存器USART_BRR，通過設(shè)置該寄存器達到配置不同波特率的目的。該寄存器的各位描述如下：、 寄存器USART_BRR各位描述前面提到STM32的分數(shù)波特率概念，其實就是在這個寄存器里面體現(xiàn)的。最低4位用來存放小數(shù)部分DIV_Fraction，[15:4]這12位用來存放整數(shù)部分DIV_Mantissa。高16位未使用。這里波特率的計算通過如下公式計算 。這里的pclkx（x=2）是給外設(shè)的時鐘（PCLK1用于串口5，PCLK2用于串口1），USARTDIV是一個無符號的定點數(shù)，它的值可以有串口的BRR寄存器值得到。而我們更關(guān)心的是如何從USARTDIV的值得到USART_BRR的值，因為一般我們知道的是波特率，和PCLKx的時鐘，要求的就是USART_BRR的值。 下面我們來介紹如何通過USARTDIV得到串口USART_BRR寄存器的值，假設(shè)我們的串口1要設(shè)置為9600的波特率，而PCLK2的時鐘為72M。這樣，我們根據(jù)上面的公式有：USARTDIV=72000000/9600*16=那么得到：DIV_Fraction=16*=12=0X0C。DIV_Mantissa= 468=0X1D4。這樣，我們就得到了USART1BRR的值為0X1D4C。只要設(shè)置串口1的BRR寄存器值為0X1D4C就可以得到9600的波特率。 4，串口控制。STM32的每個串口都有3個控制寄存器USART_CR1~3，串口的很多配置都是通過這3個寄存器來設(shè)置的。這里我們只要用到USART_CR1就可以實現(xiàn)我們的功能了。 寄存器USART_BRR各位描述BIT 13: 串口功能；BIT 12: MODE，字長。0:1個開始位，8個數(shù)據(jù)位，1位停止位（默認）；1:1個開始位，9位數(shù)據(jù)位，1位停止位（默認）；*注意：停止位的長度可在USART_CR2寄存器中設(shè)置。BIT 11: WAKE 喚醒功能BIT 10: 校檢使能位，當(dāng)激活奇偶校驗功能時，置位該位將自動往要傳輸數(shù)據(jù)的高位字節(jié)處插入就校驗位。BIT 09: Parity Selection，0：偶校驗；1：奇校驗。BIT 08: PE Interrupt EnableBIT 07: 發(fā)送緩沖區(qū)空中斷使能位BIT 06: 發(fā)送完成中斷使能位BIT 05: 接收緩沖區(qū)非空中斷使能位BIT 04: Idle Interrupt EnableBIT 03: Transfer EnableBIT 02: Receive EnableBIT 01: Receiver WakeupBIT 00: Send Break 5，數(shù)據(jù)發(fā)送與接收。STM32的發(fā)送與接收是通過數(shù)據(jù)寄存器USART_DR來實現(xiàn)的，這是一個雙寄存器，包含了TDR和RDR。當(dāng)向該寄存器寫數(shù)據(jù)的時候，串口就會自動發(fā)送，當(dāng)收到收據(jù)的時候，也是存在該寄存器內(nèi)。該寄存器的各位描述如下： 寄存器USART_DR各位描述可以看出，雖然是一個32位寄存器，但是只用了低9位（DR[8:0]），其他都是保留。 DR[8:0]為串口數(shù)據(jù)，包含了發(fā)送或接收的數(shù)據(jù)。由于它是由兩個寄存器組成的，一個給發(fā)送用(TDR)，一個給接收用(RDR)，該寄存器兼具讀和寫的功能。TDR寄存器提供了內(nèi)部總線和輸出移位寄存器之間的并行接口。RDR寄存器提供了輸入移位寄存器和內(nèi)部總線之間的并行接口。 當(dāng)使能校驗位(USART_CR1種PCE位被置位)進行發(fā)送時，寫到MSB的值(根據(jù)數(shù)據(jù)的長度不同，MSB是第7位或者第8位)會被后來的校驗位該取代。當(dāng)使能校驗位進行接收時，讀到的MSB位是接收到的校驗位。 6，串口狀態(tài)。串口的狀態(tài)可以通過狀態(tài)寄存器USART_SR讀取。USART_SR的各位描述如下：這里我們關(guān)注一下兩個位，第6位RXNE和TC。RXNE（讀數(shù)據(jù)寄存器非空），當(dāng)該位被置1的時候，就是提示已經(jīng)有數(shù)據(jù)被接收到了，并且可以讀出來了。這時候我們要做的就是盡快去讀取USART_DR，通過讀USART_DR可以將該位清零，也可以向該位寫0，直接清除。TC（發(fā)送完成），當(dāng)該位被職位的時候，表示USART_DR內(nèi)的數(shù)據(jù)已經(jīng)被發(fā)送完成了。如果設(shè)置了這個位的中斷，則會產(chǎn)生中斷。該位也有兩種清零方式：1）讀USART_SR，寫USART_DR。2）直接向該位寫0。 DM9161用法介紹DM9161AEP是一款完全集成的和符合成本效益單芯片快速以太網(wǎng)PHY。DM9161AEP通過可變電壓的 MII 或 RMII 標準數(shù)字接口連接到 MAC 層，支持 HP AutoMDIX?。是目前常見的一款物理層收發(fā)器，由于全球的MCU集成度不斷提高，由早先的MAC+PHY+MII的衍生到現(xiàn)在的PHY，在以太網(wǎng)部分的成本，逐漸降低。有如下特點 LQFP封裝 ：，　?。ㄍ扑]使用MII） （AUTOmix） %的廠家的MCU完全兼容，是ATMEL推薦使用的單口PHY。注：目前DM9161AEP支持的溫度范圍是075176。，而工業(yè)級的DM9161BIEP是支持40176。到85176。在應(yīng)用過程中，DM9161AEP常出現(xiàn)的錯誤是，晶振的連接，以及網(wǎng)絡(luò)變壓器的匹配，所以應(yīng)該慎重選擇。DM9161引腳圖如下所示： DM9161引腳圖 DM9161引腳說明16腳 TXER/TXD [4]：輸入腳，傳輸錯誤或者是第五個TXD數(shù)據(jù)位，在100兆模式下，此腳為高，同時TXEN為高，暫停信號代替實際的數(shù)據(jù)。在10兆模式下這個輸入腳被忽略，在旁路模式下（旁路4B5B）此腳變成TXD[4]腳，第五個TXD的數(shù)據(jù) of 5B信號。20,19,18,17腳 TXD [0:3] 發(fā)送數(shù)據(jù)，4位數(shù)據(jù)輸入（與TXCLK同步）在10兆或者100兆的半字節(jié)模式，在10兆的GPSI模式（7線）下，TXD [0]被用作串行數(shù)據(jù)輸入腳，TXD [1:3]被忽略。輸入腳即芯片發(fā)送數(shù)據(jù)給它，它接收后再發(fā)送。21腳TXEN：傳輸使能，高電平表示TXD [0:3]上數(shù)據(jù)是合法的在10兆或者100兆模式下。在10兆的GPSI模式（7線）下，高電平顯示TXD [0]上數(shù)據(jù)合法。22腳TXCLK/ISOLATE：輸出腳，當(dāng)剛上電時是輸入腳，拉低，發(fā)送時鐘腳，為TXEN, TXD, and TXER. TXCLK的傳輸提供時鐘參考，有PHY提供。25MHZ是100兆半字節(jié)模式，10兆是10兆GPSI (7Wired) mode（說是7線好像只用單線傳輸）。ISOLATE的設(shè)置是：當(dāng)上電復(fù)位時是輸入，0：,1：.24腳MDC:輸入腳，管理數(shù)據(jù)的時鐘腳，MDIO管理數(shù)據(jù)的同步時鐘，這個時鐘由管理芯片提供，.25腳MDIO:輸入/輸出腳，雙向的管理數(shù)據(jù)可能被管理芯片或者PHY提供。29,28,27,26 RXD[0:3]/PHYAD[0:3]：三態(tài)輸出，上電輸入，拉低，在10/100兆MII模式四位輸出（與RXCLK同步)。在10兆的GPSI模式（7線）下，RXD [0]腳是串行數(shù)據(jù)輸出腳，RXD [1:3] are ignored,PHY address [0:3]，上電復(fù)位成輸入腳，PHY地址檢測輸入腳。32腳 MDINTR：輸入/輸出，上電輸入，拉低，狀態(tài)中斷輸出腳，當(dāng)有一個狀態(tài)改變（包括link, speed, duplex depend on interrupt register [21]）即由狀態(tài)改變同時中斷也設(shè)置了，才會輸出。如果原來是低，則中斷時輸出高，如果是高則中斷時輸出低。34腳 RXCLK/10BTSER：三態(tài)輸出腳，上電輸入，拉高，接收時鐘由PHY提供時間參考為RXDV, RXD, and RXER.。PHY可能從接收的數(shù)據(jù)中恢復(fù)RXCLK參考，或者從25MHZ在100M MII模式下， MII模式下，10MHZ在 10Mbps GPSI (7Wired) mode。10BTSER僅支持10M模式（上電輸入），0 = GPSI (7Wired) mode in 10M mode，1 = MII mode in 10M mode35腳CRS/PHYAD[4]：三態(tài)輸出，上電輸入，拉低，載波感應(yīng)檢測或者PHYAD[4]，在10 BASET或者100BASETX的半雙工模式下，高電平表示載波的存在是因為接收或者傳輸有效（正在進行中）在repeater或者全雙工模式下，這個信號置高顯示載波的存在僅僅因為接