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fpga程序設(shè)計(jì)環(huán)境搭建及應(yīng)用(編輯修改稿)

2025-02-04 14:35 本頁(yè)面

　

【文章內(nèi)容簡(jiǎn)介】 11 Select Device 本項(xiàng)目采用Cyclone系列本項(xiàng)目采用 EP1C3T144 封裝為 TQFP，引腳數(shù) 144 速度等級(jí)為 8 hwadee 2022/2/5 12 Select the Specify EDA Tools 無(wú)第三方 EDA工具按 Next hwadee 2022/2/5 13 進(jìn)入項(xiàng)目編輯環(huán)境菜單欄項(xiàng)目瀏覽標(biāo)簽工具欄工作區(qū) hwadee 2022/2/5 14 新設(shè)計(jì)文檔建立建立新設(shè)計(jì)文件 hwadee 2022/2/5 15 文件類型選取建立頂層原理圖文件 hwadee 2022/2/5 16 Save AS 新建頂層原理圖文件 hwadee 2022/2/5 17 庫(kù)元件選用雙擊項(xiàng)層圖空白處彈出 hwadee 2022/2/5 18 VHDL語(yǔ)言文件建立 hwadee 2022/2/5 19 輸入 VHDL文本一個(gè)鎖存器 hwadee 2022/2/5 20 存盤并加入項(xiàng)目改成自己的元件 entity 名字，注意下面應(yīng)點(diǎn) 上 hwadee 2022/2/5 21 編譯 VHDL語(yǔ)言文件置為頂層實(shí)體綜合分析 hwadee 2022/2/5 22 建立元件符號(hào) 點(diǎn)擊鼠標(biāo)右鍵選取此項(xiàng) hwadee 2022/2/5 23 加

點(diǎn)擊復(fù)制文檔內(nèi)容

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