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[計算機軟件及應用]第三講原理圖輸入設計方法(編輯修改稿)

2025-01-04 02:31 本頁面
 

【文章內容簡介】 :編程下載 (1) 下載方式設定。 圖 418 設置編程下載方式 (2) 下載。 圖 419 向 EF1K30下載配置文件 下載(配置) 成功! 步驟 8:設計頂層文件 (1) 仿照前面的“步驟 2”,打開一個新的原理圖編輯窗口 圖 420 在頂層編輯窗中調出已設計好的半加器元件 (2) 完成全加器原理圖設計 , 并以文件名 。 (3) 將當前文件設置成 Project, 并選擇目標器件為 EPF10K10LC844。 (4) 編譯此頂層文件 , 然后建立波形仿真文件。 圖 421 在頂層編輯窗中設計好全加器 (5) 對應 ,參考圖中輸入信號 cin、 bin和 ain輸入信號電平的設置,啟動仿真器 Simulator, 觀察輸出波形的情況。 (6) 鎖定引腳、編譯并編程下載,硬件實測此全加器的邏輯功能。 圖 422 1位全加器的時序仿真波形 設計流程歸納 圖 423 MAX+plusII一般設計流程 補充說明 1. 編譯窗口的各功能項目塊含義 Compiler Netlist Extractor Database Builder Logic Synthesizer Partitioner Timing SNF Extractor Fitter Assembler 2. 查看適配報告 2位十進制數(shù)字頻率計設計 設計有時鐘使能的兩位十進制計數(shù)器 (1) 設計電路原理圖。 圖 424 用 74390設計一個有時鐘使能的兩位十進制計數(shù)器 (2) 計數(shù)器電路實現(xiàn) 圖 425 調出元件 74390 圖 426 從 Help中了解 74390的詳細功能 (3) 波形仿真 圖 427 兩位十進制計數(shù)器工作波形 頻率計主結構電路設計 圖 428 兩位十進制頻率計頂層設計原理圖文件 圖 429 兩位十進制頻率計測頻仿真波形 測頻時序控制電路設計 圖 430 測頻時序控制電路 圖 431 測頻時序控制電路工作波形 頻率計頂層電路設計 圖 432 頻率計頂層電路原理圖 (文件: ) 圖 433 頻率計工作時序波形 設計項目的其他信息和資源配置 (1) 了解設計項目的結構層次 圖 434 頻率計 ft_top項目的設計層次 (2) 了解器件資源分配情況 圖 435 適
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