主流雙核微處理器技術(shù)分析及性能對比(編輯修改稿)
2024-10-07 13:27 本頁面
【文章內(nèi)容簡介】 1MB二級緩存，兩個核心加起來一共擁有 2MB。 ? 由于處理器中的兩個內(nèi)核都擁有獨立的緩存，因此必須保證每個物理內(nèi)核的緩存信息必須保持一致，否則就會出現(xiàn)運算錯誤。 計算機體系結(jié)構(gòu)課程論文課堂報告 ? 例如在系統(tǒng)的內(nèi)存數(shù)據(jù)區(qū)記錄著 A＝ 1；如果Core1對此數(shù)據(jù)區(qū)進行讀寫操作，并且改寫為A＝ 0，那么 Core2的 cache也必須進行更新，把 A更新為 0，否則的話，在以后的操作中數(shù)據(jù)就會出錯。 ? 此即 cache數(shù)據(jù)的一致性問題，雙核心處理器需要“仲裁器”來作協(xié)調(diào)。 ? Intel將這個協(xié)調(diào)工作交給了北橋芯片：兩個核心需要同步更新處理器內(nèi)緩存的數(shù)據(jù)時，需要通過前端總線再通過北橋作更新。 計算機體系結(jié)構(gòu)課程論文課堂報告 技術(shù)剖析 AMD篇 ? AMD的技術(shù)架構(gòu)為實現(xiàn)雙核和多核奠定了堅實的基礎(chǔ) , 其 Athlon 64處理器內(nèi)部整和了內(nèi)存控制器 , 在當(dāng)初Athlon 64設(shè)計時就為雙核心做了考慮。 ? AMD采用了 SRQ(System Request Queue,系統(tǒng)請求隊列 )技術(shù) ,在工作的時候每一個核心都將其請求放在SRQ中 ,當(dāng)獲得資源之后請求將會被送往相應(yīng)的執(zhí)行核心 ,所以其緩存數(shù)據(jù)的一致性不需要通過北橋芯片 ,直接在處理器內(nèi)部就可以完成。 ? AMD雙核心處理器的仲裁器是在 CPU內(nèi)部而不是在北橋芯片上，所以在主板芯片組的選擇上要比 Intel雙核心處理器要寬松得多，甚至可以說與主板芯片組無關(guān)。 計算機體系結(jié)構(gòu)課程論文課堂報告 ? 由于成本方面考慮 ,目前 AMD是采用雙核心共享單內(nèi)存控制器的做法。 計算機體系結(jié)構(gòu)課程論文
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