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基于vhdl文本輸入法的樂曲演奏電路的設(shè)計(留存版)

2025-08-10 12:26上一頁面

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【正文】 設(shè)計初期,面對完全陌生的設(shè)計課題無從下手,不知所措。 鍵盤輸入信號驍顧燁鶚巰瀆蕪領(lǐng)鱺賻驃弒綈閶魎齠。EVENT AND CLK=39。 計數(shù)器清0ELSE COUNT0=COUNT0+1。 8 WHEN 9=INDEX0=10000000。 5 WHEN 25=INDEX0=00010000。USE 。分頻系數(shù)773Hz,音符顯示1001111,顯示低音WHEN00000010=TONE0=912。CODE=0100100。HIGH=39。ENTITY FENPIN ISPORT(CLK1: IN STD_LOGIC。ELSIF COUNT=4 THEN 若計數(shù)器計4PRECLK=39。139。COUNT2:=NOT COUNT2。ENTITY DIANZIQIN ISPORT(CLK32MHZ: IN STD_LOGIC。 輸入自動演奏信號穡釓虛綹滟鰻絲懷紓濼視嬌賭謗駔墮。END COMPONENT。 調(diào)用數(shù)控分頻模塊飪籮獰屬諾釙誣苧徑凜騙橥峽軋饈俠。COMPONENT FENPIN 引用FENPIN元件愜執(zhí)緝蘿紳頎陽灣熗鍵艤訥贓棧馴嘆。END。LIBRARY IEEE。BEGINIF(FULLSPKS39。)THEN PRECLK脈沖上升沿觸發(fā)視絀鏝鴯鱭鐘腦鈞欖糲僉爾魷癆駱鈐。)THEN 據(jù)時鐘信號為1時 COUNT:=COUNT+1。LIBRARY IEEE。039。HIGH=39。CODE=1001111。END PROCESS。 4 WHEN 21=INDEX0=00000100。 5 WHEN 5=INDEX0=00010000。BEGIN IF(CLK239。CLK2=39。 AUTO: IN STD_LOGIC。5 結(jié)束語通過這次VHDL課程設(shè)計,不僅增強了我們的實踐動手能力,也讓我們對課堂上所學(xué)到的理論知識的理解加深了許多,這給我們提供了一個在學(xué)習(xí)生活中很難得的理論聯(lián)系實際的機會。鶼漬螻偉閱劍鯫腎邏蘞闋簣擇睜鮪謅。釷鵒資贏車贖孫滅獅贅慶獷緞瑋鱘將。139。EVENT AND PRECLK=39。WHEN OTHERS =TONE0=2047。圖31 AUTO模塊的符號編輯圖 音調(diào)發(fā)生模塊音調(diào)發(fā)生模塊的作用是產(chǎn)生音階的分頻預(yù)置值。039。預(yù)頌圣鉉儐歲齦訝驊糴買闥齙絀鰒現(xiàn)。謀蕎摶篋飆鐸懟類蔣薔點鉍雜簍鰩驅(qū)。 課程設(shè)計目的 本課程設(shè)計主要是基于VHDL文本輸入法設(shè)計樂曲演奏電路,該系統(tǒng)基于計算機中時鐘分頻器的原理,采用自頂向下的設(shè)計方法來實現(xiàn),通過按鍵輸入來控制音響或者自動演奏已存入的歌曲?;赩HDL文本輸入法的樂曲演奏電路的設(shè)計摘 要本課程設(shè)計主要采用EDA技術(shù)設(shè)計一個簡易的八音符電子琴,它可通過按鍵輸入來控制音響從而演奏出已存入的樂曲。系統(tǒng)由樂曲自動演奏模塊、音調(diào)發(fā)生模塊和數(shù)控分頻模塊三個部分組成。2 EDA、VHDL簡介EDA技術(shù)是以計算機為工作平臺,融合了應(yīng)用電子技術(shù)、計算機技術(shù)、信息處理及智能化技術(shù)的最新成果,進行電子產(chǎn)品的自動設(shè)計。3 簡易電子琴的設(shè)計過程根據(jù)系統(tǒng)設(shè)計要求,系統(tǒng)該系統(tǒng)基于計算機中時鐘分頻器的原理,設(shè)計采用自頂向下的設(shè)計方法,通過按鍵輸入來控制音響或者自動演奏已存入的歌曲。 計數(shù)器值指0,時鐘信號為0壇摶鄉(xiāng)囂懺蔞鍥鈴氈淚躋馱釣繢鯨鎦。當(dāng)8位發(fā)聲控制輸入信號中的某一位為高電平時,則對應(yīng)某一音階的數(shù)值將輸出,該數(shù)值即為該音階的分頻預(yù)置值,分頻預(yù)置值控制數(shù)控分頻模塊進行分頻,由此得到每個音階對應(yīng)的頻率。CODE=0000001。139。THENSPKS=39。本課程設(shè)計的仿真平臺是MAX+plusⅡ,通過對VHDL源程序進行編譯檢錯,然后創(chuàng)建波形文件(),加入輸入輸出變量,選擇適用的芯片(EP1K30QC2082)以及設(shè)定仿真結(jié)束時間(100us),設(shè)置好輸入初值進行仿真,得到仿真波形圖。 電路功能驗證 如果說前面的過程都是理論上進行軟件設(shè)計制作,那么電路驗證則是硬件產(chǎn)生實際結(jié)果的必要步驟,它是軟件編程導(dǎo)入硬件系統(tǒng)得到最終設(shè)計目標(biāo)的一個過程。能夠借此機會了解到部分EDA技術(shù)的知識和學(xué)習(xí)運用其中一種硬件描述語言VHDL編程實現(xiàn)各種常用器件的功能,這是在哪堂講課上都得不到的一筆財富。 鍵盤輸入/自動演奏綻萬璉轆娛閬蟶鬮綰瀧恒蟬轅紗魚臚。039。EVENT AND CLK2=39。 5 WHEN 6=INDEX0=00010000。 3 WHEN 22=INDEX0=00000010。END BEHAVIORAL。HIGH=39。139。麩肅鵬鏇轎騍鐐縛縟糶爾攤鱘嫗騅鐳。USE 。 判斷計數(shù)器取值為1攙閿頻嶸陣澇諗譴隴瀘鐙澮蹤島騁檻。 IF COUNT11TONE1 THEN 若計數(shù)器11值小于音符信號1偽澀錕攢鴛擋緬鐒鈞錠鈴鉍蹌鏟驊擷。EVENT AND FULLSPKS=39。USE 。ARCHITECTURE ART OF DIANZIQIN ISCOMPONENT AUTO 引用 AUTO元件鰻順褸悅漚縫囅屜鴨騫鬩藶騍擯駟謔。PORT(CLK1: IN STD_LOGIC。13 / 13。 SPKS: OUT STD_LOGIC)。 AUTO: IN STD_LOGIC。USE 。)THEN 音頻信號輸出上升沿有效時鏃鋝過潤啟婭澗駱讕瀘載撻贏禱驛懼。FULLSPKS=39。139。USE 。CODE=0000000。WHEN00010000=TONE0=1197。 溈氣嘮戇萇鑿鑿櫧諤應(yīng)釵藹紼較騮額。LIBRARY IEEE。 2 WHEN 24=INDEX0=00010000。 6 WHEN 8=INDEX0=10000000。)THEN 時鐘信號2為1 IF(COUNT0=31)THEN 計數(shù)器值為31 COUNT0=0。 ELSIF(CLK39。 時鐘輸出 INDEX2: IN STD_LOGIC_VECTOR(7 DOWNTO 0)。另一方面我們也發(fā)現(xiàn)了在平時學(xué)習(xí)過程中難于發(fā)現(xiàn)的許多缺點跟不足。紂憂蔣氳頑薟驅(qū)藥憫騖覲僨鴛鋅鮚嗚。慫闡譜鯪逕導(dǎo)嘯畫長涼馴鴇撟鉍鲞謠。 揚聲器輸出為1ELSE SPK=’0’。FULLSPKS=39。039。該模塊的唯一輸入信號INDEX對應(yīng)就是自動模塊中最后的輸出INDEX0,音符顯示信號CODE,高低音顯示信號HIGH和音符分頻系數(shù)都是根據(jù)音符輸入確定的。EVENT AND CLK=39。滲釤嗆儼勻諤鱉調(diào)硯錦鋇絨鈔陘鰍陸。廈礴懇蹣駢時盡繼價騷巹癩龔長鰥檷。該設(shè)計最重要的一點就是通過按鍵控制不
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