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最新用vhdl設計三八譯碼器。。超贊版(完整版)

2025-08-01 00:45上一頁面

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【正文】 OUTP[7..0]CS1YIMA_138譯碼器內部電路:38譯碼器引腳排列圖:38譯碼器的功能表:輸 入輸 出S1+A2A1A010000011111111000110111111100101101111110011111011111010011110111101011111101110110111111011011111111110011111111111111111無論從邏輯圖還是功能表我們都可以看到38譯碼器的八個輸出管腳,任何時刻要么全為高電平1—芯片處于不工作狀態(tài),要么只有一個為低電平0,其余7個輸出管腳全為高電平1。電路中如果把作為“數(shù)據”輸入端(在同一個時間),而將作為“地址”輸入端,那么從送來的數(shù)據只能通過所指定的一根輸出線送出去。END yangdan_DECODER。039。039。039。039。最后完成了我的設計任務——基于VHDL譯碼器的設計。 OUTP:OUT BIT_VECTOR (7 DOWNTO 0))。 WHEN INP=001 ELSE 39。 WHEN INP=011 ELSE 39。 WHEN INP=101 ELSE 39。 WHEN INP=111 ELSE 39。 定義端口,38譯碼器有3個輸入8個輸出END。 WHEN111=Y=10000000。 END CASE。 WHEN001=Y=00000010。END ART3。 OUTP(6)=39。 OUTP(4)=39。 OUTP(2)=39。ARCHITECTURE ART3 OF yangdan_DECODER ISBEGIN OUTP(0)=39。本次設計課不僅僅培養(yǎng)了我們實際操作能力,也培養(yǎng)了我們靈活運用課本知識,理論聯(lián)系實際,獨立自主的進行設計的能力。其仿真圖如圖所示: 三八譯碼器功能時序仿真圖6 結果分析對其仿真圖進行仿真分析:OUTP譯碼輸出標志,INP為輸入信號組,它由INP[2]
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