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基于maxii系列cpld的微波爐控制器芯片設(shè)計(jì)(完整版)

2025-07-24 14:50上一頁面

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【正文】 0000111111100010000110200101011011300111001111401001100110501011101101601101111101701110000111810001111111910011101111d10101011110o10111011100n11001010100E1101111100129設(shè)計(jì)內(nèi)容狀態(tài)控制符號圖狀態(tài)控制電路的VHDL實(shí)現(xiàn)如下:LIBRARY IEEE。圖5 數(shù)據(jù)裝載電路模塊框圖當(dāng)LD_DONE有效時,輸出烹調(diào)結(jié)束的信息數(shù)據(jù)數(shù)據(jù)。當(dāng)LD_TEST有效時,輸出數(shù)碼管測試數(shù)據(jù)--包括6個輸入信號和4個輸出信號。圖1 微波爐控制器的系統(tǒng)框圖接通電源初始狀態(tài)時間設(shè)置顯示8888烹調(diào)完成SET_TTEST?START?時間到?NYNYNYNY圖2 工作流程圖首先,對系統(tǒng)進(jìn)行復(fù)位清零,使其各電路模塊均處于初始狀態(tài);當(dāng)烹飪時間設(shè)置信號SET_T有效時,讀入時間信號KEY[3..0]的取值,此時系統(tǒng)顯示設(shè)置的時間信息,再按下SET_T確定設(shè)置時間完成。 (2) 時間設(shè)置出錯及工作過程的取消等情況的處理:設(shè)置一個復(fù)位按鍵。第2章 設(shè)計(jì)目的該設(shè)計(jì)用VHDL語言在MAX+PLUSⅡ軟件平臺上通過編譯、模擬、仿真,完成了微波爐控制功能,實(shí)現(xiàn)了微波爐的測試、時間設(shè)置、烹調(diào)計(jì)時、完成提示等設(shè)計(jì),并對時鐘分頻作了一定的探討。浙江科技學(xué)院嵌入式系統(tǒng)(EDA技術(shù))課程設(shè)計(jì)報告書課題名稱:基于MAX II系列CPLD的微波爐控制器芯片設(shè)計(jì)院、系 : 自動化與電氣工程學(xué)院 專業(yè)班級: 建筑電氣智能化 目 錄第一章 緒論 1第二章 設(shè)計(jì)目的 2第三章 設(shè)計(jì)要求 3 微波爐的功能要求 3 3第四章 設(shè)計(jì)思想 4 4 4第五章 設(shè)計(jì)內(nèi)容 5 6 8 9 11 20設(shè)計(jì)總結(jié) 23感 言 24參考文獻(xiàn) 25I第1章 緒論隨著人們生活水平的提高和信息化的發(fā)展,家用電器層出不窮,各種功能也越來越完善,其中微波爐是現(xiàn)代家庭的必備產(chǎn)品已經(jīng)成為人們?nèi)沼蒙钪械谋夭豢缮俚膹N房電器,大大降低了家庭婦女的工作量和工作強(qiáng)度,它的質(zhì)量和性能的高低,將會極大的影響人們的生活水平和質(zhì)量。此設(shè)計(jì)采用了現(xiàn)場可編程邏輯器件FPGA的 ASIC設(shè)計(jì),由控制模塊、裝載模塊、計(jì)時模塊和顯示模塊四大模塊組成,而且它可以將所有器件集成在一塊芯片上,體積大大減小,且外圍電路很簡單,易于實(shí)現(xiàn)。 (3)數(shù)碼管狀態(tài)的檢測:設(shè)置數(shù)碼管檢測按鍵,按動該按鍵后,數(shù)碼管能夠顯示“8888”的信息。按下開始鍵START,系統(tǒng)進(jìn)入烹調(diào)狀態(tài),COOK信號變?yōu)楦唠娖?,時鐘計(jì)數(shù)器開始減法計(jì)數(shù),MINMIN0、SECSEC0顯示剩余烹調(diào)時間。圖3 狀態(tài)控制電路模塊框圖根據(jù)微波爐工作流程的描述,分析狀態(tài)轉(zhuǎn)換條件及輸出信號,可以得到如圖4所示的微波爐控制器的狀態(tài)轉(zhuǎn)換圖。當(dāng)L_CLK有效時,輸出烹調(diào)的設(shè)置時間數(shù)據(jù)。USE 。 顯示電路測試信號 CLK:IN STD_LOGIC。END controllor。 ELSIF CLK39。 THEN 復(fù)位時不論任何狀態(tài)數(shù)碼管都將顯示0000 DATATMP = (others = 39。 END IF。 否則自動加1 END IF。 IF KEY(0)39。 DATA = DATATMP。139。039。 LD_CLK=39。 WHEN SET_CLOCK= 烹調(diào)時間測試狀態(tài) LD_CLK=39。 WHEN IDLE= 初始狀態(tài)定義 IF TEST=39。 LD_CLK=39。139。 COOK=39。USE 。END loader。 中間變量定義 CASE TEMP IS WHEN100=測試 DATAOUT=ALLS。USE 。END t10。 ELSIF CLK39。 END IF。 END PROCESS。 EN:IN STD_LOGIC。 THEN TMP= 0000。139。139。USE 。 分個位 MIN1:OUT STD_LOGIC_VECTOR(3 DOWNTO 0)。 輸出 CARRY_OUT:OUT STD_LOGIC 狀態(tài) )。END COMPONENT t6。 U2:t6 PORT MAP(S0,LOAD,CLR,COOK,DATA(7 DOWNTO 4),SEC1,S1)。ENTITY YMQ47 IS PORT( AIN4:IN STD_LOGIC_VECTOR(3 DOWNTO 0)。 4 WHEN0101=DOUT7=1101101。 n WHEN1101=DOUT7=1111001。通過與同學(xué)探討和請教老師,終于把問題都解決了,并加深了對數(shù)字時鐘原理和設(shè)計(jì)思路的了解。,但還是復(fù)習(xí)了書本的知識,對自己來說更是一大進(jìn)步。,我會在以后的實(shí)驗(yàn)中努力彌補(bǔ)不足之處。做課程設(shè)計(jì)時,先查閱大量的相關(guān)知識,要把原理吃透,確定一個大的設(shè)計(jì)方向,在按照這個方向分模塊的把要實(shí)現(xiàn)的功能用流程圖的形式展示。 END CASE。 6 WHEN0111=DOUT7=0000111。 END ENTITY YMQ47。 U4:t6 PORT MAP(S2,LOAD,CLR,COOK,DATA(15 DOWNTO 12),MIN1,S3)。SIGNAL S0:STD_LOGIC。COMPONENT t6 IS PORT( CLK:IN STD_LOGIC。END counter。 LOAD,CLR:IN STD_LOGIC。039。
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