基于fpga的雷達(dá)中心控制器的設(shè)計(jì)(完整版)
【正文】 ............................................. 5 濾波器的實(shí)現(xiàn) ............................................................................................ 6 原理圖法設(shè)計(jì) FIR 濾波器 .................................................................... 6 編程法 設(shè)計(jì) FIR 濾波器 ........................................................................ 6 4 DSP 鏈路口通信與雷達(dá)單元模塊和波形產(chǎn)生器 .............................. 9 DSP 鏈路口通信的原理及實(shí)現(xiàn) ...................................................................... 9 雷達(dá)單元模塊和波 形產(chǎn)生器 ...................................................................... 12 雷達(dá)單元模塊和波形產(chǎn)生器的原理 .................................................. 12 5 參考文獻(xiàn) ............................................................................................................. 15 參考文獻(xiàn) ...................................................................................................................... 15 6 致謝 ....................................................................................................................... 15 致謝 .................................................................................................... 錯(cuò)誤 !未定義書(shū)簽。其研究目的為了解決雷達(dá)與計(jì)算機(jī)之間的數(shù)據(jù)處理問(wèn)題，在計(jì)算機(jī)與雷達(dá)之間加一個(gè)雷達(dá)中心控制器，實(shí)現(xiàn)數(shù)據(jù)的快速處理及 實(shí)時(shí)監(jiān)控。 實(shí)驗(yàn)方法是利用 FPGA 的 VHDL 編程的方法，實(shí)現(xiàn)對(duì)雷達(dá)中心控制器的設(shè)計(jì)及實(shí)現(xiàn)。 1 引言 : 國(guó)內(nèi)外對(duì)雷達(dá)中心控制器這方面的研究還相對(duì)較少，這方面的相關(guān)的文章也相對(duì)較少，對(duì)此很有研究的價(jià)值。 其中關(guān)于 FPGA 的發(fā)展也是很快速，其主要的優(yōu)點(diǎn)決定了其發(fā)展前途 ,主要優(yōu)點(diǎn)有 FPGA 不僅可以解決電子系統(tǒng)小型化、低功耗、可靠性高等問(wèn)題，而且其開(kāi)發(fā)周期短、開(kāi)發(fā)軟件投入少、芯片價(jià)格不斷降低，促使 FPGA 越來(lái)越多地取代了ASIC 的市場(chǎng)，特別是對(duì)小 批量、 多品種的產(chǎn)品需求，使 FPGA 成為首選。中心控制器和信號(hào)處理機(jī) DSP 之間為異步通信，我們使用兩個(gè) FIFO 分別存 放兩路數(shù)據(jù)，對(duì)兩個(gè) FIFO 的要求完全相同。于 AD9059 的介紹， AD9059 5 是 8 位單片雙通道模數(shù)轉(zhuǎn)換器，主要由 2個(gè)跟蹤 /保持電路 (T/H)、 2 個(gè)模數(shù)轉(zhuǎn)換器 (ADCA、 ADCB)和一個(gè) 的基準(zhǔn)電源等組成，具有高速、高性能、低功耗及易使用等特性， 60MSPS 的編碼速率和 120MHz 的最大功率模擬帶寬使其在多路數(shù)據(jù)采樣系統(tǒng)中表現(xiàn)出優(yōu)秀的動(dòng)態(tài)性能。而 IIR 濾波器需要執(zhí)行無(wú)限數(shù)量次卷積。 use 。 use 。 variable tmp,old:signed (7 downto 0)。)。 then tmp:=sample。 for i in 3 downto 0 loop shift(i+1):=shift(i)。 4 DSP 鏈路口通信與雷達(dá)單元模塊和波形產(chǎn)生器 DSP 鏈路口通信的原理及實(shí)現(xiàn) 在 DSP 鏈路口通信前面，經(jīng)過(guò)兩個(gè)緩存器，出來(lái)兩路八位數(shù)據(jù)，因?yàn)殒溌房谕ㄐ诺臄?shù)據(jù)線是八 位的，最終要改成八位輸出，所以其完成的功能是： 第一步：將兩路 8位數(shù)據(jù)進(jìn)行合并； 第二部是 鏈路口每次傳輸一個(gè)合并后的 16 位數(shù)據(jù) (高位在前 )，分兩次傳輸，每次傳輸 8位。data1(7 downto 0)。 Entity data_send is Port(clk:in std_logic。 進(jìn)行定義； begin datab(15 downto 0)=data(15 downto 0)。 end if。 end if。 設(shè)計(jì)四個(gè)按鍵，有兩個(gè)按鍵可控制四個(gè)不同的雷達(dá)單元；另外兩個(gè)按鍵可控制波形產(chǎn)生器以產(chǎn)生四種不同的探測(cè)波形。 begin q=aamp。d2=39。d2=39。d2=39。d1
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