vhdl程序的基本結(jié)構(gòu)vhdl程序一般由5個(gè)部分組成(存儲(chǔ)版)
【正文】 調(diào)用語(yǔ)句 、元件例化語(yǔ)句。 END BLOCK 塊標(biāo)號(hào) ?？梢岳门渲谜Z(yǔ)句為實(shí)體指定一個(gè)構(gòu)造體。 END small_count。 P A C K A G E 程 序 包 名 I S [ 說(shuō) 明 語(yǔ) 句 ] ；E N D 程 序 包 名 。 SUBTYPE cpu_bus IS STD_LOGIC_VECTOR(k1 DOWNTO 0)。 PACKAGE upac IS CONSTANT k: INTEGER:=4。 電子線路的設(shè)計(jì)與仿真 32 2021/6/15 PACKAGE 已在設(shè)計(jì)實(shí)體中定義的數(shù)據(jù)類型、子程序或數(shù)據(jù)對(duì)象對(duì)于其它的實(shí)體是不可用的，或者說(shuō)是不可見(jiàn)的。 ARCHITECTURE count_64k OF counter IS END count_64k。 子程序調(diào)用語(yǔ)句 過(guò)程名（參數(shù)表） 。] [塊說(shuō)明部分 。 構(gòu)造體－ 構(gòu)造體說(shuō)明語(yǔ)句 定義本構(gòu)造體內(nèi)部使用的信號(hào)、常數(shù)、數(shù)據(jù)類型 和函數(shù) 因?yàn)樗鼈儍H限于內(nèi)部使用，所以沒(méi)有也不需要有 方向的說(shuō)明 構(gòu)造體－ 功能描述語(yǔ)句 具體描述構(gòu)造體的行為和結(jié)構(gòu)。 模式 : in, out, inout, buffer Inout和 buffer都是雙向端口，但 buffer只能有一個(gè)驅(qū)動(dòng)源 例 : Port (a, b: in bit。] End [entity]實(shí)體名 。 例 : Library ieee。 use ?？梢远? 義端口大小、元件數(shù)目及定時(shí)特性等 Generic ([constant]參數(shù)名 :[in]子類型標(biāo)識(shí) [:=靜態(tài)表達(dá)式 ]。 實(shí)體說(shuō)明 實(shí)體語(yǔ)句部分 是設(shè)計(jì)實(shí)體接口的共同部分。 并行信號(hào)賦值語(yǔ)句 簡(jiǎn)單賦值語(yǔ)句 目標(biāo)信號(hào) = 表達(dá)式 。 類屬子句用于參數(shù)的定義；端口子句用于信號(hào)的定義；塊說(shuō)明部分對(duì)該塊要用到的信號(hào)、常數(shù)、元件和子程序等進(jìn)行說(shuō)明；塊語(yǔ)句部分對(duì)該塊的功能進(jìn)行描述，塊語(yǔ)句部分的語(yǔ)句是并行執(zhí)行的，和書(shū)寫(xiě)順序無(wú)關(guān)。 最簡(jiǎn)單的缺省配置格式結(jié)構(gòu) CONFIGURATION 配置名 OF 實(shí)體名 IS FOR 構(gòu)造體名 END FOR。 CONFIGURATION big_count OF
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