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第5章微處理器的硬件特性及微機系統(tǒng)組成(留存版)

2025-09-03 11:28上一頁面

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【正文】 T/ R DEN OE OE OE 29 最小組態(tài)的總線形成 ? 20位地址總線 —— 可采用 3個三態(tài)鎖存器8282進行鎖存和驅(qū)動 ? 8位數(shù)據(jù)總線 —— 可采用數(shù)據(jù)收發(fā)器8286進行驅(qū)動 ? 系統(tǒng)控制信號 —— 由 8086引腳直接提供 30 最大模式操作 ? 8086/8088的數(shù)據(jù) /地址等引腳在最大組態(tài)與最小組態(tài)時相同 ? 有些控制信號不相同 , 主要是用于輸出操作編碼信號 , 由總線控制器 8288譯碼產(chǎn)生系統(tǒng)控制信號: ? S S S0—— 3個狀態(tài)信號 ? LOCK—— 總線封鎖信號 ? QS QS0—— 指令隊列狀態(tài)信號 ? RQ/GT0、 RQ/GT1—— 2個總線請求 /同意信號 。 ? T狀態(tài):時鐘周期 , CPU處理動作的最小單位 。 8086 CPU需 3片鎖存器鎖存地址信號 。 12 控制總線 (續(xù) 2) ?4. TEST ? 測試 , 輸入 、 低電平有效 ? 該引腳與 WAIT指令配合使用 ? 當 CPU執(zhí)行 WAIT指令時 , 它將在每個時鐘周期對該引腳進行測試:如果無效 , 則程序踏步并繼續(xù)測試;如果有效 , 則程序恢復運行 ? 也就是說 , WAIT指令使 CPU產(chǎn)生等待 , 直到引腳有效為止 ? 在使用協(xié)處理器 8087時 , 通過引腳和 WAIT指令 ,可使 8088與 8087的操作保持同步 13 控制總線 (續(xù) 3) ?5. INTR( Interrupt Request) ? 可屏蔽中斷請求 , 輸入 、 高電平有效 ? 有效時 , 表示請求設備向 CPU申請可屏蔽中斷 ? 該請求的優(yōu)先級別較低 , 并可通過關中斷指令 CLI清除標志寄存器中的 IF標志 、 從而對中斷請求進行屏蔽 ?6. NMI( NonMaskable Interrupt) ? 不可屏蔽中斷請求 , 輸入 、 上升沿有效 ? 有效時 , 表示外界向 CPU申請不可屏蔽中斷 ? 該請求的優(yōu)先級別高于 INTR, 并且不能在 CPU內(nèi)被屏蔽 ? 當系統(tǒng)發(fā)生緊急情況時 , 可通過他向 CPU申請不可屏蔽中斷服務 14 控制總線 (續(xù) 4) ? 7. RESET ? 復位請求 , 輸入 、 高電平有效 ? 該信號有效 , 將使 CPU回到其初始狀態(tài);當他再度返回無效時 ,CPU將重新開始工作 ? 8088復位后 CS= FFFFH、 IP= 0000H, 所以程序入口在物理地址 FFFF0H ? 8. CLK( Clock) ? 時鐘輸入 ? 系統(tǒng)通過該引腳給 CPU提供內(nèi)部定時信號 。 ? T1時為 BHE, 表示 AD15— AD8為有效數(shù)據(jù) 。 74LS24 74LS245雙向總線緩沖器 。1 第 5章 微處理器的硬件特性及微機系統(tǒng)組成 ? 教學重點 ? 8086/8088的兩種工作模式 ? 最小模式下的引腳信號和總線形成 ? 最小模式下的總線時序 2 幾個名詞 ? 指令周期:執(zhí)行 1條指令所需要的時間 。
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