數(shù)字電子技術(shù)課程設(shè)計(jì)報(bào)告紙(交通燈控制器模版)(留存版)
【正文】 t CLK_in。 reg[25:0] temp。 input[3:0] a。圖7 交通燈控制時(shí)序流程圖源程序：module control(clk,date,JSin,LD,YS,LED)。 LED=39。等驅(qū)動(dòng)安裝完成后，點(diǎn)擊Quartusll軟件常用工具欄上的按鈕，打開下載界面，點(diǎn)擊Start按鈕即可完成下載。 LED=39。 else LD=1。 end endendmodule模塊如圖5： 數(shù)碼管顯示及譯碼模塊根據(jù)共陰極數(shù)碼管，本模塊電路選用CD4511，具體電路原理圖如圖5所示。圖4 74192設(shè)計(jì)的減法計(jì)數(shù)器電路圖方案二。根據(jù)整個(gè)系統(tǒng)中各模塊電路的需求，本模塊主要實(shí)現(xiàn)將EDA實(shí)驗(yàn)板上50MHz晶振產(chǎn)生的時(shí)鐘脈沖經(jīng)過分頻得到1Hz的時(shí)鐘信號(hào)，考慮到應(yīng)用觸發(fā)器或計(jì)數(shù)器來設(shè)計(jì)，電路實(shí)現(xiàn)比較困難和繁瑣，因此選擇應(yīng)用Verilog硬件描述語言來設(shè)計(jì)設(shè)計(jì)本模塊電路，具體程序如下：module clk_div(CLK_in,CLK_out)。 always (posedge CLK_in) begin if(temp=25000000) begin temp=0。 output[3:0] q。 input clk。b1000011001。5 總結(jié)在這次課程中，我完成了任務(wù)，設(shè)計(jì)出來了交通燈電路圖。b00000011。 always (negedge clk) begin
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