【正文】 觸發(fā)信號(hào)可以用電平或邊沿操作，鎖存器是觸發(fā)器的一種應(yīng)用類型。 endcaseend答案是代碼2在綜合時(shí)更容易產(chǎn)生latch。比如現(xiàn)在用一個(gè)clk接到latch的使能端(假設(shè)是高電平使能),這樣需要的setup時(shí)間，就是數(shù)據(jù)在時(shí)鐘的下降沿之前需要的時(shí)間，但是如果是一個(gè)DFF，那么setup時(shí)間就是在時(shí)鐘的上升沿需要的時(shí)間。所以，在ASIC中使用 latch的集成度比DFF高，但在FPGA中正好相反，因?yàn)镕PGA中沒有標(biāo)準(zhǔn)的latch單元，但有DFF單元，一個(gè)LATCH需要多個(gè)LE才能實(shí)現(xiàn)。前者的作用是將外設(shè)送來的數(shù)據(jù)暫時(shí)存放，以便處理器將它取走；后者的作用是用來暫時(shí)存放處理器送往外設(shè)的數(shù)據(jù)。寄存器的存儲(chǔ)電路是由鎖存器或觸發(fā)器構(gòu)成的，因?yàn)橐粋€(gè)鎖存器或觸發(fā)器能存儲(chǔ)1位二進(jìn)制數(shù)，所以由N個(gè)鎖存器或觸發(fā)器可以構(gòu)成N位寄存器。當(dāng)收到輸入脈沖時(shí)，觸發(fā)器輸出就會(huì)根據(jù)規(guī)則改變狀態(tài)，然后保持這種狀態(tài)直到收到另一個(gè)觸發(fā)。鎖存器不同于觸發(fā)器，它不在鎖存數(shù)據(jù)時(shí)，輸出端的信號(hào)隨輸入信號(hào)變化，就像信號(hào)通過一個(gè)緩沖器一樣；一旦鎖存信號(hào)起鎖存作用，則數(shù)據(jù)被鎖住，輸入信號(hào)不起作用。 二、觸發(fā)器觸發(fā)器（FlipFlop，簡(jiǎn)寫為 FF），也叫雙穩(wěn)態(tài)門，又稱雙穩(wěn)態(tài)觸發(fā)器。在CP上升沿時(shí)刻打入到寄存器。當(dāng)負(fù)載不具有非選通輸出為高阻特性時(shí)，將起到隔離作用；當(dāng)總線的驅(qū)動(dòng)能力不夠驅(qū)動(dòng)負(fù)載時(shí)，將起到驅(qū)動(dòng)作用。DFF由時(shí)鐘沿觸發(fā)，同步控制。這對(duì)于下一級(jí)電路是極其危險(xiǎn)的。b1。而另外一方面，今天許多計(jì)算機(jī)是同步的，這就意味著所有的時(shí)序電路的輸出信號(hào)隨著全局的時(shí)鐘信號(hào)同時(shí)做出改變。鎖存器的輸出對(duì)輸入透明的，輸入是什么，輸出就是什么，這就是鎖存器不穩(wěn)定的原因，而觸發(fā)器是由兩個(gè)鎖存器構(gòu)成的一個(gè)主從觸發(fā)器，輸出對(duì)輸入是不透明的，必須在時(shí)鐘的上升/下降沿才會(huì)將輸入體現(xiàn)到輸出，所以能夠消除輸入的毛刺信號(hào)。除了ASIC里可以節(jié)省資源以外，latch在同步設(shè)計(jì)里出現(xiàn)的可能還是挺小的，現(xiàn)在處理過程中大都放在ff里打一下。也就是說，latch借的時(shí)間也是有限的。latch將靜態(tài)時(shí)序分析變得極為復(fù)雜。通過緩沖區(qū)，可以使進(jìn)程之間的相互等待變少，從而使從速度慢的設(shè)備讀入數(shù)據(jù)時(shí)，速度快的設(shè)備的操作進(jìn)程不發(fā)生間斷。一般由D觸發(fā)器組成，有公共輸入/輸出使能控制端和時(shí)鐘，一般把使能控制端作為寄存器電路的選擇信號(hào)，把時(shí)鐘控制端作為數(shù)據(jù)輸入控制信號(hào)。該數(shù)據(jù)可表示音序器的狀態(tài)、計(jì)數(shù)器的價(jià)值、在計(jì)算機(jī)內(nèi)存的ASCII字符或任何其他的信息。鎖存器是電平觸發(fā)的存儲(chǔ)單元，數(shù)據(jù)存儲(chǔ)的動(dòng)作取決于輸入時(shí)鐘（或者使能）信號(hào)的電平值，當(dāng)鎖存器處于使