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基于pll信號發(fā)生器的設(shè)計(專業(yè)版)

2024-08-03 18:40上一頁面

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【正文】 。 BCD碼轉(zhuǎn)換程序 。 EEPROM發(fā)送數(shù)據(jù)緩沖單元 MRD EQU 6CH 。從一開始題目的講解,到簡單的查找資料,到程序的設(shè)計及調(diào)試,再到后期元器件的買件、制作,李老師不厭其煩、盡心盡力的幫助我。表81頻率與電壓的對應(yīng)關(guān)系(頻率單位MHz)理想頻率2535455565758595105測得頻率電壓(V) 9 結(jié)論由于晶體振蕩器單頻點(diǎn)的局限性,難于滿足多頻點(diǎn)的要求。當(dāng)控制字是8600H時,也就是R0、RR2為000時,選擇步進(jìn)為1K的標(biāo)準(zhǔn)頻率,頻率范圍從25MHz到54MHz,根據(jù) ()N是分頻比,為輸入BU2614的頻率, 為標(biāo)準(zhǔn)信號源頻率可計算出分頻比的范圍: () ()轉(zhuǎn)化成十六進(jìn)制的變化范圍是從61A8H到D2F0H。③ 程序存儲器89C51共有4096個E2PROM,用于存放用戶程序,原始數(shù)據(jù)或表格。在由外部程序存儲器取指期間,每個機(jī)器周期兩次/PSEN有效。當(dāng)P2口被寫“1”時,其管腳被內(nèi)部上拉電阻拉高,且作為輸入。 存儲電路的設(shè)計存儲電路如圖611所示,由于A0、AA2沒有被AT24C02使用,所以它們可以不接或直接接VSS、VCC。在開始信號以后,總線即被認(rèn)為處于忙狀態(tài);在結(jié)束信號以后的一段時間內(nèi),總線被認(rèn)為是空閑的。I2C總線的控制完全由掛接在總線上的主器件送出的地址和數(shù)據(jù)決定。由變壓器出來的交流信號分別經(jīng)過兩個L7812CV,一路直接接到低通和L7805CV;另一路L7812CV的輸出直接接到L7805CV,它的輸出單獨(dú)供給給單片機(jī)。CT、GT等用于頻率測量與計數(shù)的控制。BU2614內(nèi)部主要有相位比較器PD、可編程分頻器、參考分頻器、高穩(wěn)定晶體振蕩器及內(nèi)部控制器組成。壓控振蕩電路由芯片內(nèi)部Q7和Q6,10腳和12腳外接LC諧振回路組成正反饋的正弦振蕩電路[4],其振蕩頻率: ()() 、分別為電感、電容大小,為變?nèi)荻O管的電容量。結(jié)果使得=在與的相位成為一致時,PD端子會成為高阻抗?fàn)顟B(tài),使PLL被鎖定(Lock)。通常基準(zhǔn)振蕩器都使用晶體振蕩器,所以高頻振蕩的頻率穩(wěn)定度與晶體振蕩器相同。其組成框圖如32所示。為了提高頻率的穩(wěn)定度,經(jīng)常采用晶體振蕩器等方法來解決,但它很難產(chǎn)生多個頻率信號。由于采用了集成芯片,電路設(shè)計簡單,系統(tǒng)可靠性高,并且利用鎖相環(huán)頻率合成技術(shù)可以使輸出頻率穩(wěn)定度進(jìn)一步提高。設(shè)計中采用鎖相環(huán)式的頻率合成技術(shù),利用鎖相環(huán),使輸出的正弦波頻率與晶體振蕩器的穩(wěn)定度一樣。反之,當(dāng)是產(chǎn)生負(fù)脈沖。在線性范圍內(nèi),這一線性可用下列方程來表示。圖64 電感切換電路 鎖相環(huán)式頻率合成器的設(shè)計 BU2614的管腳圖與內(nèi)部組成BU2614為16管腳芯片,其管腳圖如圖65所示。置0時為通道打開。此控制電路是用三級管和光偶來控制輸出的高低電平,使開關(guān)二級管截止或?qū)ǎㄒ妶D64),從而來切換電感量。⑵ 雙向傳輸?shù)慕涌谔匦浴鹘y(tǒng)的單片機(jī)串行接口的發(fā)送和接收一般都各用一條線,而I2C總線則根據(jù)器件的功能通過軟件程序使其可工作于發(fā)送或接收方式。⑷ 數(shù)據(jù)的傳送 在數(shù)據(jù)傳送過程中,必須確認(rèn)數(shù)據(jù)傳送的開始和結(jié)束??偩€競爭的仲裁是在兩個層次上進(jìn)行的。P1口管腳寫入1后,被內(nèi)部上拉為高,可用作輸入,P1口被外部下拉為低電平時,將輸出電流,這是由于內(nèi)部上拉的緣故。在FLASH編程期間,此引腳用于輸入編程脈沖。89C51單片機(jī)包含中央處理器、程序存儲器(ROM)、數(shù)據(jù)存儲器(RAM)、定時/計數(shù)器、并行接口、串行接口和中斷系統(tǒng)等幾大單元及數(shù)據(jù)總線、地址總線和控制總線等三大總線[14]。 頻率測量顯示電路顯示電路如圖615所示[15]。軟件流程圖如圖772所示。在此,我要感謝在我做畢業(yè)設(shè)計期間幫助過我的老師。 EEPROM時鐘傳送口 SLA EQU 6AH 。VIICREAD 。 BCDST: MOV R7,18H CLR C MOV 39H,00H MOV 38H,00H MOV 37H,00HKKK: MOV A,34H RLC A MOV 34H,A MOV A,35H RLC A MOV 35H,A MOV A,36H RLC A MOV 36H,A MOV A,37H ADDC A,37H DA A MOV 37H,A MOV A,38H ADDC A,38H DA A MOV 38H,A MOV A,39H ADDC A,39H DA A MOV 39H,A DJNZ R7,KKK MOV A,39H ANL A,0FH MOV 56H,A MOV A,39H SWAP A ANL A,0FH MOV 57H,A MOV A,38H ANL A,0FH MOV 54H,A MOV A,38H SWAP A ANL A,0FH MOV 55H,A MOV A,37H ANL A,0FH MOV 52H,A MOV A,37H SWAP A ANL A,0FH MOV 53H,A MOV 51H,00H MOV 50H,00H LCALL DISP NOP NOP RETDISP: MOV A,57H ADD A,70H MOV P2,A LCALL DELAY MOV A,56H ADD A,60H MOV P2,A CALL DELAY MOV A,55H ADD A,50H MOV P2,A CALL DELAY MOV A,54H ADD A,40H MOV P2,A CALL DELAY MOV A,53H ADD A,30H MOV P2,A CALL DELAY MOV A,52H ADD A,20H MOV P2,A CALL DELAY MOV A,51H ADD A,10H MOV P2,A CALL DELAY MOV A,50H ADD A,00H MOV P2,A CALL DELAY MOV P2,0FFH RET。 EEPROM尋址字節(jié)讀 ORG 0000H AJMP START ORG 0030HSTART: MOV SP,80H MOV R4,08H 。同時,此次畢業(yè)設(shè)計也是對我的綜合素質(zhì)的一種鍛煉和培養(yǎng),使之能更加耐心、細(xì)致、謹(jǐn)慎、科學(xué)地思考遇到的難題,同時鍛煉了創(chuàng)新能力。 本設(shè)計的優(yōu)點(diǎn)是,通過切換電感可擴(kuò)大鎖相環(huán)的帶寬,實(shí)現(xiàn)25MHz到110MHz可調(diào)的頻率,結(jié)果滿足設(shè)計要求。分頻比可通過按鍵來調(diào)整。當(dāng)/EA端保持高電平時,此間內(nèi)部程序存儲器。P2口當(dāng)用于外部程序存儲器或16位地址外部數(shù)據(jù)存儲器進(jìn)行存取時,P2口輸出地址的高八位。它讀寫操作是通過單片機(jī)的控制來實(shí)現(xiàn)的[12]。開始信號后,系統(tǒng)中的各個器件將自己的地址和主器件送到總線上的地址進(jìn)行比較,如果與主器件發(fā)送到總線上的地址一致,則該器件即為被主器件尋址的器件,其接收信息還是發(fā)送信息則由第8位(R/W)確定。當(dāng)總線空閑時,兩根線都是高電平。 存儲電路設(shè)計 AT24C02管腳介紹AT24C02是美國ATMEL公司的低功耗CMOS串行EEPROM,它是內(nèi)含2568位存儲空間,具有工作電壓寬(~)、擦寫次數(shù)多(大于10000次)、寫入速度快(小于10ms)等特點(diǎn)。該設(shè)計選擇R0、RR2 為000或110。可編程分頻器按照16位數(shù)據(jù)的控制要求,把 focs振蕩頻率信號經(jīng)過參考分頻之后的頻率信號fd與fr在PD中進(jìn)行比較,當(dāng) fd不等于fr時由PD輸出電壓VD控制VCO,使 focs穩(wěn)定在確定頻率上。MC1648需要外接一個由電感和電容組成的并聯(lián)諧振回路[5]。系統(tǒng)能捕捉最大的頻率失諧范圍稱為捕捉帶或捕捉范圍。當(dāng)壓控振蕩器的頻率由于某種原因而發(fā)生變化時,必然相應(yīng)地產(chǎn)生相位的變化。晶振諧波發(fā)生器分頻器倍頻器混頻器fOut2fOut3fOut1圖32 直接式頻率合成方案2:采用模擬鎖相式頻率合成器技術(shù),通過環(huán)路分頻器降頻,將VCO的頻率降低,與參考頻率進(jìn)行鑒相?;陬l率合成器的這以一特點(diǎn),利用鎖相式頻率合成技術(shù),可以制作高穩(wěn)定度、寬頻帶的正弦波信號發(fā)生器。該方法實(shí)現(xiàn)簡單,但是調(diào)試?yán)щy,而且輸出頻率不易靈活控制[1]。此電路可以很好地選擇所需頻率信號,抑制雜散分量,并且避免了大量的濾波器,采用大規(guī)模的集成芯片,與前兩種方案相比可以簡化頻率合成部分的設(shè)計,有利于集成化和小型化。 鑒相器的時序圖當(dāng)與 的關(guān)系為。它的特性可用瞬時振蕩頻率與控制電壓υC之間的關(guān)系曲線來表示,如圖61所示。⑵ 電感切換電路為了擴(kuò)大頻率的帶寬,通過切換電源來切換電感。數(shù)據(jù)和狀態(tài)字共32位,從低位到高位依次排列為:D0、D1……D 15 、圖66 CLK、DATA、CE的邏輯關(guān)系P0、PP2 、*、*、*、*、CT、R0、RR S、PS、*、GT、TS。振蕩器中心頻率不穩(wěn)主要由溫度、濕度、直流電源等外界因素引起,其變化是緩慢的,鎖相環(huán)路只對VCO平均中心頻率不穩(wěn)定所引起的分量(處于低通濾波器通帶之內(nèi))起作用,使其中心頻率鎖定在設(shè)定的頻率上。它通過SDA(串行數(shù)據(jù)線)及SCL(串行時鐘線)兩根線在連到總線上的器件之間傳送信息,并根據(jù)地址識別每個器件:不管是單片機(jī)、存儲器、LCD驅(qū)動器還是鍵盤接口[11]。其后,第一個結(jié)束高電平期的器件又將SCL線拉成低電平。⑸ 總線競爭的仲裁 總線上可能掛接有多個器件,有時會發(fā)生兩個或多個主器件同時想占用總線的情況。P0能夠用于外部程序數(shù)據(jù)存儲器,它可以被定義為數(shù)據(jù)/地址的低八位。當(dāng)8051通電,時鐘電路開始工作,系統(tǒng)即初始復(fù)位。如采用外部時鐘源驅(qū)動器件,XTAL2應(yīng)不接。89C51內(nèi)置最高頻率達(dá)12MHz的時鐘電路,用于產(chǎn)生整個單片機(jī)運(yùn)行的脈沖時序,
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