計算機(jī)組成原理第五章中央處理器習(xí)題課(更新版)
【正文】 BUS→R2 ， BUS→R3 ， BUS→MBR ， BUS→MAR ； ?③ 控制 ALU運(yùn)算的微命令 4個：算術(shù)加，算術(shù)減，邏輯與，邏輯或； ?④ 控制移位方式的命令 2個：左移，右移； ?⑤ 控制主存操作的微命令 2個：存儲器讀，存儲器寫。 ?（ 2）采用字段直接譯碼法設(shè)計微指令格式如下（不包括順序控制部分）： X X X X X X X X X X X X X X X 3位 4位 1位 2位 2位 3位 001： MDR → A 010： R1 →A 011： R2 →A 100： R3 → A 001： PC → B 010： R1 →B 011： R1 →B 100： R2→B 101： R2 →B 110： R3 →B 111： R3 →B 01： + 10： 11： M 01： R 10： L 11： V 1： +1 0001： PCout 0010： PCin 0011： R1out 0100： R1in 0101： R2out 0110： R2in 0111： R3out 1000： R3in 微指令格式的設(shè)計（微命令部分） ?（ 3）由于操作數(shù)（補(bǔ)碼）已分別放在 R1和R2中，根據(jù)圖給的數(shù)據(jù)通路，計算（ 1/2）（ ab） → R2的微程序流程圖如下： ?可見，執(zhí)行周期只需用一條微指令即可。 ?解答：組合邏輯控制器的設(shè)計思想主要是采用硬布線邏輯 —— ?首先根據(jù)指令系統(tǒng)，寫出對應(yīng)機(jī)器指令的全部微操作及其節(jié)拍安排，然后列出操作時間表，再寫出每一種微操作的邏輯表達(dá)式，化簡后畫出相應(yīng)的邏輯圖，即完成了設(shè)計； ?這種邏輯電路主要是由門電路構(gòu)成的復(fù)雜樹型網(wǎng)絡(luò)，一旦構(gòu)成后，除非重新設(shè)計和物理上對它重新接線，否則要增加新的控制功能是不可能的。 ?解答：組合邏輯控制器框圖如下。 ?三、判斷題 ? 運(yùn)算器中的累加器沒有加法器功能，有寄存器功能。 ? 1任何一條指令的執(zhí)行過程都是一個（ A）序列的執(zhí)行過程。 通?？刂破鞯脑O(shè)計可分為（ A）和（ B）兩大類，相對應(yīng)的控制器結(jié)構(gòu)就有（ C）式和（ D）式，前者采用的核心器件是（ E），后者采用的核心器件是（ F）。 ? 1狀態(tài)寄存器用來存放（ ）。 ?一、選擇題 ? 用 PLA器件設(shè)計的控制器稱為 PLA控制器，從技術(shù)實(shí)現(xiàn)的途徑來看， PLA控制器是一種（ ）。 ?一、選擇題 ? 微指令執(zhí)行的順序控制問題，實(shí)際上是如何確定下一條微指令的地址的問題，通常用的一種方法是斷定方式，其基本思想是（ ）。 ? 指令周期是（ ）。 ? A. 只適用于 CPU控制的方式； ? B. 由統(tǒng)一時序信號控制的方式； ? C. 所有指令執(zhí)行時間都相同的方式。 ? A. 8位微處理器； B. 16位微處理器； ? C. 準(zhǔn) 16位微處理器。 ? A. 存儲器的容量； ? B. 指令字長； ? C. 機(jī)器字長。 ? 在程序執(zhí)行過程中，控制器控制計算機(jī)的運(yùn)行總是處于（ ① ）、分析指令和（ ② ）的循環(huán)之中。 ? 時序信號產(chǎn)生器提供機(jī)器所需的（ A）時序信號，在組合邏輯控制器中，時序信號常采用（ B）三級體制；在微程序控制器中，常采用（ C）二級體制。 ? 1某計算機(jī)采用微程序控制，操作控制字段為 80位，如果采用 完全水平型 微指令，則可定義（ A）種微操作。 ? 在取指令操作完成之后， PC中存放的是下一條實(shí)際執(zhí)行的指令的地址。（也可用教材 Wilkes模型圖） PC OP ADDR 微命令控制 順序控制 … … 微地址 形成部件 IR uIR uAR CM 狀態(tài)條件 中斷系統(tǒng) 時序電路 控制臺 ? 比較組合邏輯控制器和微程序控制器的組成。 ? 設(shè)有一運(yùn)算器通路如下圖所示。 ?它的控制存儲器容量為 128個單元，微指令要完成有條件和無條件轉(zhuǎn)移的功能。下面給出一個微程序執(zhí)行的流程圖，圖中，根據(jù)指令寄存器IR的第三位即 IR3決定微程序的 a點(diǎn)分支流向。 ? （ 4）簡述完成指令 ADD Y的數(shù)據(jù)通路（ Y為內(nèi)存地址， ADD功能為（ AC） +（ Y） → AC
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