電子課程設(shè)計(jì)---八路彩燈循環(huán)顯示-免費(fèi)閱讀
【正文】 六、總結(jié) 通過(guò)這次課程設(shè)計(jì)，不僅讓我了解了 怎么用 Quartus II 去設(shè)計(jì) VHDL 程序，更重要的還讓我學(xué)會(huì)了、理解 了“做事一定要有次序和對(duì)事物的總體把握”這句話。 五、 總體設(shè)計(jì)電路圖 總體電路原理圖 圖（ 5） 電路原理圖 8 時(shí)序仿真圖 圖（ 6）時(shí)序仿真結(jié)果 仿真 分析：有仿真結(jié)果可以看出，在清零端 CLR 輸入無(wú)效時(shí)，在時(shí)鐘脈沖的作用下， LED[7..0]的狀態(tài)分別為 011111111， 10111111， 11011111， 11101111，11110111， 11111011， 11111101， 11111110。 elsif s= 011010 then s1=00000001。 elsif s= 010010 then s1=10000001。 elsif s= 001010 then s1=00001000。 elsif s= 000010 then s1=00100000。139。 6花色 signal s1 :std_logic_vector(7 downto 0)。 use 。五 種模式循環(huán)切換，復(fù)位鍵（ CLR）控制系統(tǒng)的運(yùn)行與停止。 5 四、 功能模塊 LED(狀態(tài)機(jī) )模塊 圖（ 3） LED（狀態(tài)機(jī)）模塊 LED 模塊由兩個(gè)主控進(jìn)程控制， 時(shí)序進(jìn)程和輔助進(jìn)程組成，各進(jìn)程分工明確。 20MHZ clock signal end cdxs。 ledd=s(1)。 ledd=s(1)。 elsif s= 000111 then s1=00000001。 elsif s= 001111 then s1=00011000。 elsif s= 010111 then s1=01000000。
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