fpga課程設(shè)計(jì)--基于vhdl的2fsk的信號發(fā)生器-預(yù)覽頁
【正文】 代表信息的二進(jìn)制矩形脈沖序列，即使2FSK信號。圖2 2FSK調(diào)制信號發(fā)生器框圖（1）．分頻器 kHz， kHz兩個(gè)正弦信號。（2）．m序列產(chǎn)生器m序列是偽隨機(jī)序列的一種，它的顯著特點(diǎn)是：隨機(jī)特性，預(yù)先可確定性，循環(huán)特性。m序列產(chǎn)生器的電路結(jié)構(gòu)如圖3所示。圖4 信號跳變檢測電路（4）．2:1數(shù)據(jù)選擇器2:1數(shù)據(jù)選擇器用于選擇正弦波產(chǎn)生器的兩個(gè)輸入時(shí)鐘。本例要求得到的是兩個(gè)不同頻率的正弦信號，實(shí)驗(yàn)中對正弦波每個(gè)周期采樣100個(gè)點(diǎn)，即采樣速率為原正弦信號頻率的100倍，因此完全可以在接收端將原正弦信號不失真地恢復(fù)出來，從而可以在接收端對FSK信號正確地解調(diào)。實(shí)驗(yàn)表明，采用8位分辨率和每周期100個(gè)采樣點(diǎn)可以達(dá)到相當(dāng)不錯(cuò)的效果。狀態(tài)機(jī)共有8位輸出(Q7～Q0)，經(jīng)DAC變換為模擬信號輸出。圖5 2FSK仿真波形圖下圖6所示為產(chǎn)生的2FSK波形，可以明顯地看到在M_MODE跳變前后VALUE的碼元寬度相差一倍，實(shí)現(xiàn)了2FSK的頻率變化來傳遞數(shù)字信息，即120KHz表示信號“0”，240KHz表示信號“1”。USE 。 正弦波發(fā)生器時(shí)鐘 MODE:IN STD_LOGIC。 VALUE: out std_logic_vector (7 DOWNTO 0)。 記錄100個(gè)狀態(tài) SIGNAL COUNT50: INTEGER RANGE 0 TO 49。 0，1跳變標(biāo)志 SIGNAL M: std_logic_vector (2 DOWNTO 0)。) THEN IF (COUNT = 10) THEN COUNT=1。輸出時(shí)鐘翻轉(zhuǎn)一次 ELSE COUNT=COUNT+1。PROCESS(CLK240) 分頻為120KHz的CLK120信號 BEGIN IF (CLK24039。 END IF。139。 END IF。EVENT AND CODERATE= 39。 END IF。139。M_CODE=M(0)。039。END PROCESS。EVENT AND SINCLK= 39。139。) AND (MODE=39。 END IF。 when 1=value=10000111。 when 5=value=10100110。 when 9=value=11000011。 when 13=value=11011100。 when 17=value=11101111。 when 21=value=11111010。 when 25=value=11111111。 when 29=value=11111010。 when 33=value=11101111。 when 37=value=11011100。 when 41=value=11000011。 when 45=value=10100110。 when 49=value=10000111。 when 53=value=01100111。 when 57=value=01001001。 when 61=value=00101110。 when 65=value=00011000。 when 69=value=00001000。 when 73=value=00000001。 when 77=value=00000001。 when 81=value=00001000。 when 85=value=00011000。 when 89=value=00101110。 when 93=value=01001001。 when 97=value=01100111。 END CA
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